臺(tái)灣成功大學(xué)的關(guān)于無(wú)人機(jī)自動(dòng)駕駛控制的論文集(1) 這包共4篇，分別為： 無(wú)人飛機(jī)速度控制器設(shè)計(jì)與實(shí)現(xiàn) 無(wú)人飛行船自主性控制設(shè)計(jì)與實(shí)現(xiàn) 無(wú)人飛行載具導(dǎo)引飛控整合自動(dòng)駕駛儀參數(shù)選取之研究 無(wú)人飛行載具導(dǎo)引飛控之軟體與硬體模擬
標(biāo)簽： lunwen
上傳時(shí)間： 2013-08-03
上傳用戶：luominghua
隨著半導(dǎo)體制造技術(shù)不斷的進(jìn)步，SOC(System On a Chip)是未來(lái)IC產(chǎn)業(yè)技術(shù)研究關(guān)注的重點(diǎn)。由于SOC設(shè)計(jì)的日趨復(fù)雜化，芯片的面積增大，芯片功能復(fù)雜程度增大，其設(shè)計(jì)驗(yàn)證工作也愈加繁瑣。復(fù)雜ASIC設(shè)計(jì)功能驗(yàn)證已經(jīng)成為整個(gè)設(shè)計(jì)中最大的瓶頸。 使用FPGA系統(tǒng)對(duì)ASIC設(shè)計(jì)進(jìn)行功能驗(yàn)證，就是利用FPGA器件實(shí)現(xiàn)用戶待驗(yàn)證的IC設(shè)計(jì)。利用測(cè)試向量或通過(guò)真實(shí)目標(biāo)系統(tǒng)產(chǎn)生激勵(lì)，驗(yàn)證和測(cè)試芯片的邏輯功能。通過(guò)使用FPGA系統(tǒng)，可在ASIC設(shè)計(jì)的早期，驗(yàn)證芯片設(shè)計(jì)功能，支持硬件、軟件及整個(gè)系統(tǒng)的并行開(kāi)發(fā)，并能檢查硬件和軟件兼容性，同時(shí)還可在目標(biāo)系統(tǒng)中同時(shí)測(cè)試系統(tǒng)中運(yùn)行的實(shí)際軟件。FPGA仿真的突出優(yōu)點(diǎn)是速度快，能夠?qū)崟r(shí)仿真用戶設(shè)計(jì)所需的對(duì)各種輸入激勵(lì)。由于一些SOC驗(yàn)證需要處理大量實(shí)時(shí)數(shù)據(jù)，而FPGA作為硬件系統(tǒng)，突出優(yōu)點(diǎn)是速度快，實(shí)時(shí)性好。可以將SOC軟件調(diào)試系統(tǒng)的開(kāi)發(fā)和ASIC的開(kāi)發(fā)同時(shí)進(jìn)行。 此設(shè)計(jì)以ALTERA公司的FPGA為主體來(lái)構(gòu)建驗(yàn)證系統(tǒng)硬件平臺(tái)，在FPGA中通過(guò)加入嵌入式軟核處理器NIOS II和定制的JTAG(Joint Test ActionGroup)邏輯來(lái)構(gòu)建與PC的調(diào)試驗(yàn)證數(shù)據(jù)鏈路，并采用定制的JTAG邏輯產(chǎn)生測(cè)試向量，通過(guò)JTAG控制SOC目標(biāo)系統(tǒng)，達(dá)到對(duì)SOC內(nèi)部和其他IP(IntellectualProperty)的在線測(cè)試與驗(yàn)證。同時(shí)，該驗(yàn)證平臺(tái)還可以支持SOC目標(biāo)系統(tǒng)后續(xù)軟件的開(kāi)發(fā)和調(diào)試。 本文介紹了芯片驗(yàn)證系統(tǒng)，包括系統(tǒng)的性能、組成、功能以及系統(tǒng)的工作原理；搭建了基于JTAG和FPGA的嵌入式SOC驗(yàn)證系統(tǒng)的硬件平臺(tái)，提出了驗(yàn)證系統(tǒng)的總體設(shè)計(jì)方案，重點(diǎn)對(duì)驗(yàn)證系統(tǒng)的數(shù)據(jù)鏈路的實(shí)現(xiàn)進(jìn)行了闡述；詳細(xì)研究了嵌入式軟核處理器NIOS II系統(tǒng)，并將定制的JTAG邏輯與處理器NIOS II相結(jié)合，構(gòu)建出調(diào)試與驗(yàn)證數(shù)據(jù)鏈路；根據(jù)芯片驗(yàn)證的要求，設(shè)計(jì)出軟核處理器NIOS II系統(tǒng)與PC建立數(shù)據(jù)鏈路的軟件系統(tǒng)，并完成芯片在線測(cè)試與驗(yàn)證。 本課題的整體任務(wù)主要是利用FPGA和定制的JTAG掃描鏈技術(shù)，完成對(duì)國(guó)產(chǎn)某型DSP芯片的驗(yàn)證與測(cè)試，研究如何構(gòu)建一種通用的SOC芯片驗(yàn)證平臺(tái)，解決SOC驗(yàn)證系統(tǒng)的可重用性和驗(yàn)證數(shù)據(jù)發(fā)送、傳輸、采集的實(shí)時(shí)性、準(zhǔn)確性、可測(cè)性問(wèn)題。本文在SOC驗(yàn)證系統(tǒng)在芯片驗(yàn)證與測(cè)試應(yīng)用研究領(lǐng)域，有較高的理論和實(shí)踐研究?jī)r(jià)值。
上傳時(shí)間： 2013-05-25
上傳用戶：ccsp11
中穎單片機(jī)各個(gè)功能模塊的例程，能夠幫助朋友了解SINOWEALTH的單片機(jī)。
上傳時(shí)間： 2013-05-24
上傳用戶：zhengjian
外圍電路設(shè)計(jì)例程，有助于擴(kuò)展對(duì)單片機(jī)的了解，使編程靈活應(yīng)用
標(biāo)簽： 單片機(jī) 外圍電路設(shè)計(jì)
上傳時(shí)間： 2013-07-26
上傳用戶：3到15
本文對(duì)Windows NT 操作系統(tǒng)的多線程同步機(jī)制和同步對(duì)象進(jìn)行了分析，以其在檢測(cè)儀和經(jīng)緯儀同步通信程序開(kāi)發(fā)中的應(yīng)用為例，論述了如何通過(guò)共享事件來(lái)實(shí)現(xiàn)應(yīng)用程序和設(shè)備驅(qū)動(dòng)程序的同步通信，并給出了
標(biāo)簽： 多線程 同步機(jī)制 中的應(yīng)用 應(yīng)用程序
上傳時(shí)間： 2013-06-30
上傳用戶：小楓殘?jiān)?/p>
SoC(System On a Chip)又稱為片上系統(tǒng)，是指將微處理器、模擬IP核、數(shù)字IP核和存儲(chǔ)器（或片外存儲(chǔ)器接口）集成在單一芯片上。SoC產(chǎn)品不斷朝著體積小、功能強(qiáng)的方向發(fā)展，芯片內(nèi)部整合越來(lái)越多的功能。ARM架構(gòu)作為嵌入式系統(tǒng)流行的應(yīng)用，其應(yīng)用的擴(kuò)展面臨軟件擴(kuò)充的問(wèn)題，而X86平臺(tái)上卻有很多軟件資源。若將已有的X86軟件移植到ARM平臺(tái)，則可以在一定程度上解決軟件擴(kuò)充的問(wèn)題。 本論文針對(duì)X86指令在ARM中兼容的應(yīng)用，以智能手機(jī)的應(yīng)用為例，提出了基于ARM嵌入式平臺(tái)，使用X86指令到ARM指令的二進(jìn)制翻譯模塊，達(dá)到對(duì)X86指令的兼容。主要研究ARM公司的片上總線系統(tǒng)——AMBA AHB和AMBA APB片上總線標(biāo)準(zhǔn)。對(duì)Multi-layer總線結(jié)構(gòu)進(jìn)行研究，分析了Multi-layer AHB系統(tǒng)中使用的Bus Matrix模塊的結(jié)構(gòu)，從Bus Matrix模塊的內(nèi)部矩陣結(jié)構(gòu)和系統(tǒng)架構(gòu)兩方面針對(duì)系統(tǒng)的特點(diǎn)作出優(yōu)化。 最后介紹了論文采用的事物級(jí)模型與Verilog HDL協(xié)同仿真的方法和系統(tǒng)的控制過(guò)程，通過(guò)仿真結(jié)果的比較，驗(yàn)證了利用二進(jìn)制翻譯模塊實(shí)現(xiàn)X86指令執(zhí)行的可行性和優(yōu)化后的架構(gòu)較適合于X86翻譯系統(tǒng)的應(yīng)用。
上傳時(shí)間： 2013-06-28
上傳用戶：釣鰲牧馬
本論文研究了基于ARM+Linux的嵌入式測(cè)控系統(tǒng)。論文闡述了嵌入式測(cè)控系統(tǒng)的特點(diǎn)。結(jié)合目前比較流行的SOC硬件技術(shù)，嵌入式軟件技術(shù)，以及目前較前沿的無(wú)線傳感器網(wǎng)絡(luò)技術(shù)，對(duì)構(gòu)建一個(gè)既能進(jìn)行本地多傳感器信息采集又能進(jìn)行數(shù)據(jù)處理以及具有人機(jī)交互界的嵌入式測(cè)控系統(tǒng)進(jìn)行了架構(gòu)設(shè)計(jì)，即采用ARM+Linux架構(gòu)。 論文詳細(xì)介紹了系統(tǒng)的硬件設(shè)計(jì)，包括核心板設(shè)計(jì)和應(yīng)用底板設(shè)計(jì)。其中核心板又包括微處理器的設(shè)計(jì)和存儲(chǔ)器的設(shè)計(jì)；對(duì)于應(yīng)用板，介紹了基于CS8900A的網(wǎng)絡(luò)模塊的設(shè)計(jì)，基于RS232和RS485的串行總線設(shè)計(jì)，以及基于ZigBee的無(wú)線模塊設(shè)計(jì)。同時(shí)，本論文詳細(xì)的介紹了系統(tǒng)的軟件設(shè)計(jì)。結(jié)合本系統(tǒng)所采用的U-Boot介紹了嵌入式Bootloader設(shè)計(jì)，并針對(duì)本系統(tǒng)的板級(jí)硬件對(duì)U-Boot進(jìn)行了移植。結(jié)合本系統(tǒng)采用的Linux操作系統(tǒng)介紹了嵌入式操作系統(tǒng)的概念，并對(duì)Linux進(jìn)行了板級(jí)移植。在分析研究嵌入式文件系統(tǒng)的特點(diǎn)的基礎(chǔ)上，確定Cramfs作為本系統(tǒng)的根文件系統(tǒng)，并結(jié)合現(xiàn)有的開(kāi)源軟件Busybox搭建了一個(gè)完整的根文件系統(tǒng)命令集。 在本系統(tǒng)硬、軟件平臺(tái)上，研究了終端應(yīng)用層上的開(kāi)發(fā)。并完成了在終端上的嵌入式圖形用戶界面QT的移植，并且為系統(tǒng)開(kāi)發(fā)出相應(yīng)的I/O和A/D設(shè)備驅(qū)動(dòng)驅(qū)動(dòng)程序。 論文在最后介紹了本系統(tǒng)的一個(gè)簡(jiǎn)單應(yīng)用，即利用QT圖形庫(kù)和多線程編程技術(shù)，在現(xiàn)有的硬件平臺(tái)上設(shè)計(jì)出了一個(gè)溫度和濕度的無(wú)線數(shù)據(jù)采集程序。顯示直觀，界面友好，體現(xiàn)了本平臺(tái)具有一定的應(yīng)用前景。
標(biāo)簽： ARMLinux 嵌入式 測(cè)控 平臺(tái)設(shè)計(jì)
上傳時(shí)間： 2013-07-06
上傳用戶：martinyyyl
新手資料，AVR單片機(jī)GCC程序設(shè)計(jì)及其設(shè)計(jì)例程
標(biāo)簽： AVR GCC 單片機(jī) 程序設(shè)計(jì)
上傳時(shí)間： 2013-06-11
上傳用戶：mosliu
自己寫的一個(gè)FPGA串口通信的例程，已通過(guò)了軟件驗(yàn)證，發(fā)給現(xiàn)在在學(xué)習(xí)FPGA通信的朋友。
上傳時(shí)間： 2013-07-25
上傳用戶：wsm555
隨著半導(dǎo)體技術(shù)與數(shù)字集成電路(微處理器、存貯器以及標(biāo)準(zhǔn)邏輯門電路等)技術(shù)的迅速發(fā)展，特別是隨著計(jì)算機(jī)技術(shù)的發(fā)展，在工業(yè)生產(chǎn)和科學(xué)技術(shù)研究的各行各業(yè)中，人們利用PC機(jī)的強(qiáng)大處理功能代替?zhèn)鹘y(tǒng)儀器的某些部件，開(kāi)發(fā)出各種測(cè)量?jī)x器(虛擬儀器)，傳統(tǒng)儀器的數(shù)字邏輯部分多是采用分立集成電路(IC)組成，分立IC愈多，給系統(tǒng)的電路設(shè)計(jì)、調(diào)試及維護(hù)帶來(lái)諸多不便。而隨著EDA技術(shù)的飛速發(fā)展，大規(guī)模可編程邏輯芯片CPLD / FPGA應(yīng)運(yùn)而生。這類芯片可以替代幾十甚至上百塊通用IC芯片，而且，因其可用硬件描述語(yǔ)言進(jìn)行芯片設(shè)計(jì)、支持在線編程和在系統(tǒng)編程等優(yōu)點(diǎn)而備受青睞。本課題主要是用FPGA實(shí)現(xiàn)一個(gè)驗(yàn)證平臺(tái)。用于SOC及IPCore的驗(yàn)證。用FPGA系統(tǒng)驗(yàn)證板實(shí)現(xiàn)在實(shí)際硬件環(huán)境中的驗(yàn)證可以彌補(bǔ)ASIC 設(shè)計(jì)流程中仿真的不足, 通過(guò)該驗(yàn)證也可以加快ASIC設(shè)計(jì)且降低由于邏輯問(wèn)題所造成ASIC 開(kāi)發(fā)中的成本損耗。本文首先介紹了EDA技術(shù)的發(fā)展，然后介紹了FPGA，SOC,和IPCore的一些基本概念，分析了FPGA在現(xiàn)代集成電路設(shè)計(jì)領(lǐng)域的一些應(yīng)用。最后，具體設(shè)計(jì)了一塊用設(shè)計(jì)驗(yàn)證的開(kāi)發(fā)板，并討論了其設(shè)計(jì)結(jié)構(gòu)，流程及驗(yàn)證方法。
上傳時(shí)間： 2013-05-16
上傳用戶：bakdesec
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