內(nèi)容包括： 仿真器原理圖.rar CPLD_XDS510的源碼.rar 24C01配置文件.rar XDS510 Windows驅(qū)動(dòng)程序 詳細(xì)制作過(guò)程說(shuō)明文檔 簡(jiǎn)介：介紹了基于USB2.0接口的DSP仿真器的研制方法。采用該方法，只需要設(shè)計(jì)出DSP仿真器的硬件系統(tǒng)和CPLD程序，USB驅(qū)動(dòng)程序的設(shè)計(jì)采用TI公司提供的源程序，使得仿真器的研制十分簡(jiǎn)單易行。該仿真器通過(guò)實(shí)際產(chǎn)品測(cè)試，性能可靠。廣大的DSP開(kāi)發(fā)者可以使用本文提供的方法制作仿真器。
標(biāo)簽： 510 CPLD_XDS Windows
上傳時(shí)間： 2014-01-25
上傳用戶：杜瑩12345
mediaplayer 基于QT4下的播放器源碼！
標(biāo)簽： mediaplayer QT4 播放器 源碼
上傳時(shí)間： 2014-11-27
上傳用戶：希醬大魔王
FPGA 開(kāi)發(fā)板源碼。芯片為Mars EP1C6F.VHDL語(yǔ)言。可實(shí)現(xiàn)一些基本的功能。如乘法器、加法器、多路選擇器等。
上傳時(shí)間： 2017-05-25
上傳用戶：shizhanincc
基于18f4550ICD2、16F877的PIC單片機(jī)燒寫器仿真器ICD2制作源碼 錯(cuò)誤更正：877的RA4口要上拉一個(gè)5K電阻,R11<4R7,74hc07不行必須用74LS07 如果想重?zé)齀C，4550的CONFIG請(qǐng)參考BMP文件 1。調(diào)試時(shí)最好有一個(gè)有保護(hù)的HUB，分步進(jìn)行 2。焊好后，電位器旋到0，不插隊(duì)IC，通電測(cè)各點(diǎn)電壓，并調(diào)好12V 3。只插4550，連PC，應(yīng)能發(fā)現(xiàn)新硬件，重點(diǎn)查晶體，USB電壓， 4。插好所有IC，連PC，用ICD2的自檢功能，能讀出三個(gè)電壓，見(jiàn)CHECK。BMP 5。最后連是連目標(biāo)板，如果復(fù)位電容大于103原裝ICD2都不會(huì)認(rèn)識(shí)目標(biāo)IC，不同目標(biāo)IC最好用不同IDE，如16F639用6。61版可以，可進(jìn)入7。5版就不好用，有些IDE版很不完善，可以多試
標(biāo)簽： ICD2 16F877 f4550 07
上傳時(shí)間： 2014-08-18
上傳用戶：huangld
FPGA開(kāi)發(fā)板配套Verilog HDL代碼。芯片為Mars EP1C6F。是基礎(chǔ)實(shí)驗(yàn)的源碼。包括加法器、減法器、乘法器、多路選擇器等。
標(biāo)簽： Verilog EP1C6F FPGA Mars
上傳時(shí)間： 2014-11-10
上傳用戶：15736969615
arm lpc2300定時(shí)器設(shè)計(jì)源碼 實(shí)現(xiàn)lpc2300的定時(shí)控制
標(biāo)簽： 2300 lpc arm 定時(shí)器
上傳時(shí)間： 2013-12-17
上傳用戶：zhanditian
此源碼是文檔simulation.rar__關(guān)于光孤子在光纖耦合器中傳輸?shù)姆抡嫜芯康膍atlab程序
標(biāo)簽： simulation matlab 源碼
上傳時(shí)間： 2017-05-29
上傳用戶：ardager
超聲測(cè)距c語(yǔ)言程序 利用定時(shí)器產(chǎn)生40khz站空比50 的方波 通過(guò)檢測(cè)收到超聲波的時(shí)間來(lái)測(cè)距
標(biāo)簽： khz 40 超聲測(cè)距 c語(yǔ)言
上傳時(shí)間： 2013-11-25
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鋸齒波信號(hào)發(fā)生器 函數(shù)信號(hào)源采用數(shù)字存儲(chǔ)方式存儲(chǔ)一到幾個(gè)周期，再用時(shí)間計(jì)數(shù)，循環(huán)執(zhí)行的方法實(shí)現(xiàn)函數(shù)信號(hào)的連續(xù)輸出
標(biāo)簽： 鋸齒波 信號(hào)發(fā)生器 函數(shù) 信號(hào)源
上傳時(shí)間： 2017-06-05
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asp寫的一個(gè)mp3播放器(帶源碼)，供學(xué)習(xí)交流
上傳時(shí)間： 2017-06-06
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