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PCi-X

  • PCI Arbitor by VHDL

    PCI Arbitor by VHDL

    標(biāo)簽: Arbitor VHDL PCI by

    上傳時(shí)間: 2013-08-18

    上傳用戶:h886166

  • 基于FPGA的PCI接口源代碼及Testbenc

    基于FPGA的PCI接口源代碼及Testbenc

    標(biāo)簽: Testbenc FPGA PCI 接口

    上傳時(shí)間: 2013-08-20

    上傳用戶:sun_pro12580

  • 用vhdl編寫的pci源代碼。花了我2000多元錢買來(lái)的

    用vhdl編寫的pci源代碼。花了我2000多元錢買來(lái)的,編譯通過(guò)!

    標(biāo)簽: vhdl 2000 pci 編寫

    上傳時(shí)間: 2013-08-29

    上傳用戶:brilliantchen

  • 利用高速FPGA實(shí)現(xiàn)PCI總線接口的設(shè)計(jì)方案

    PCI是一種高性能的局部總線規(guī)范,可實(shí)現(xiàn)各種功能標(biāo)準(zhǔn)的PCI總線卡。本文簡(jiǎn)要介紹了PCI總線的特點(diǎn)、信號(hào)與命令,提出了一種利用高速FPGA實(shí)現(xiàn)PCI總線接口的設(shè)計(jì)方案。\r\n

    標(biāo)簽: FPGA PCI 總線接口 設(shè)計(jì)方案

    上傳時(shí)間: 2013-08-30

    上傳用戶:brain kung

  • 基于FPGA的PCI總線接口的設(shè)計(jì)方案

    基于FPGA的PCI總線接口的設(shè)計(jì)方案\r\n~!

    標(biāo)簽: FPGA PCI 總線接口 設(shè)計(jì)方案

    上傳時(shí)間: 2013-09-01

    上傳用戶:heart520beat

  • 一種X波段頻率合成器的設(shè)計(jì)方案

      在非相參雷達(dá)測(cè)試系統(tǒng)中,頻率合成技術(shù)是其中的關(guān)鍵技術(shù).針對(duì)雷達(dá)測(cè)試系統(tǒng)的要求,介紹了一種用DDS激勵(lì)PLL的X波段頻率合成器的設(shè)計(jì)方案。文中給出了主要的硬件選擇及具體電路設(shè)計(jì),通過(guò)對(duì)該頻率合成器的相位噪聲和捕獲時(shí)間的分析,及對(duì)樣機(jī)性能的測(cè)試,結(jié)果表明該X波段頻率合成器帶寬為800 MHz、輸出相位噪聲優(yōu)于-80 dBc/Hz@10 kHz、頻率分辨率達(dá)0.1 MHz, 可滿足雷達(dá)測(cè)試系統(tǒng)系統(tǒng)的要求。測(cè)試表明,該頻率合成器能產(chǎn)生低相噪、高分辨率、高穩(wěn)定度的X波段信號(hào),具有較好的工程應(yīng)用價(jià)值。

    標(biāo)簽: X波段 頻率合成器 設(shè)計(jì)方案

    上傳時(shí)間: 2013-10-21

    上傳用戶:pkkkkp

  • X波段低相噪跳頻源的設(shè)計(jì)

    結(jié)合直接數(shù)字頻率合成(DDS)和鎖相環(huán)(PLL)技術(shù)完成了X波段低相噪本振跳頻源的設(shè)計(jì)。文章通過(guò)軟件仿真重點(diǎn)分析了本振跳頻源的低相噪設(shè)計(jì)方法,同時(shí)給出了主要的硬件選擇和詳細(xì)電路設(shè)計(jì)過(guò)程。最后對(duì)樣機(jī)的測(cè)試結(jié)果表明,本方案具有相位噪聲低、頻率控制靈活等優(yōu)點(diǎn),滿足了實(shí)際工程應(yīng)用。

    標(biāo)簽: X波段 跳頻源

    上傳時(shí)間: 2013-11-12

    上傳用戶:jiwy

  • x電容和y電容介紹

    X電容是指跨于L-N之間的電容器, Y電容是指跨于L-G/N-G之間的電容器。(L=Line, N=Neutral, G=Ground).

    標(biāo)簽: 電容

    上傳時(shí)間: 2014-12-23

    上傳用戶:haohao

  • PCI ExpressTM Architecture

    PCI ExpressTM Architecture Add-in Card Compliance Checklist for the PCI Express Base 1.0a SpecificationThe PCI Special Interest Group disclaims all warranties and liability for the use of this document and the information contained herein and assumes no responsibility for any errors that may appear in this document, nor does the PCI Special Interest Group make a commitment to update the information contained herein.Contact the PCI Special Interest Group office to obtain the latest revision of this checklistQuestions regarding the ths document or membership in the PCI Special Interest Group may be forwarded tPCI Special Interest Group5440 SW Westgate Drive #217Portland, OR 97221Phone: 503-291-2569Fax: 503-297-1090 DISCLAIMERThis document is provided "as is" with no warranties whatsoever, including any warranty of merchantability, noninfringement, fitness for any particular purpose, or any warranty otherwise arising out of any proposal, specification, or sample.  The PCI SIG disclaims all liability for infringement of proprietary rights, relating to use of information in this specification.  No license, express or implied, by estoppel or otherwise, to any intellectual property rights is granted herein.

    標(biāo)簽: Architecture ExpressTM PCI

    上傳時(shí)間: 2013-11-03

    上傳用戶:gy592333

  • Allegro15.X培訓(xùn)教材

    Allegro15[1].X培訓(xùn)教材

    標(biāo)簽: Allegro 15 培訓(xùn)教材

    上傳時(shí)間: 2013-10-22

    上傳用戶:bpgfl

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