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asterisk 計(jì)費(fèi)模塊，提供軟交換機(jī)計(jì)費(fèi)之用。
上傳時(shí)間： 2014-01-08
上傳用戶(hù)：lxm
一篇來(lái)自臺(tái)灣中華大學(xué)的論文--《無(wú)線(xiàn)射頻系統(tǒng)標(biāo)簽晶片設(shè)計(jì)》，彩色版。其摘要為：本論文討論使用於無(wú)線(xiàn)射頻辨識(shí)系統(tǒng)(RFID)之標(biāo)籤晶片系統(tǒng)的電路設(shè)計(jì)和晶片製作，初步設(shè)計(jì)標(biāo)籤晶片的基本功能，設(shè)計(jì)流程包含數(shù)位軟體及功能的模擬、基本邏輯閘及類(lèi)比電路的設(shè)計(jì)與晶片電路的佈局考量。 論文的第一部份是序論、射頻辨識(shí)系統(tǒng)的規(guī)劃、辨識(shí)系統(tǒng)的規(guī)格介紹及制定，而第二部份是標(biāo)籤晶片設(shè)計(jì)、晶片量測(cè)、結(jié)論。 電路的初步設(shè)計(jì)功能為:使用電容作頻率緩衝的Schmitt trigger Clock、CRC-16的錯(cuò)誤偵測(cè)編碼、Manchester編碼及使用單一電路做到整流、振盪及調(diào)變的功能，最後完成晶片的實(shí)作。
標(biāo)簽： 大學(xué) 論文 無(wú)線(xiàn)射頻
上傳時(shí)間： 2016-08-27
上傳用戶(hù)：tb_6877751
使用C#程式語(yǔ)言開(kāi)發(fā)，並執(zhí)行於.NET Framework下；是研習(xí)「蟻拓尋優(yōu)法」不可或缺的軟體工具。系統(tǒng)使用ACO (Ant Colony Optimization)演算公式模擬螞蟻的覓食行徑抉擇。使用者可以設(shè)定費(fèi)洛蒙和食物氣味強(qiáng)度等相關(guān)參數(shù)以及動(dòng)態(tài)設(shè)定障礙物的位置和形狀，研習(xí)螞蟻覓食的最短路徑形成過(guò)程。研習(xí)各種參數(shù)設(shè)定對(duì)螞蟻覓食行為的影響，了解費(fèi)落蒙機(jī)制對(duì)蟻拓尋優(yōu)化法的影響。本系統(tǒng)可支援柔性計(jì)算教學(xué)，研習(xí)蟻拓優(yōu)化法中人工螞蟻的隨機(jī)搜尋模式和啟發(fā)式法則設(shè)計(jì)原理。
標(biāo)簽： 程式
上傳時(shí)間： 2013-12-24
上傳用戶(hù)：anng
這是流行的Blackfin系列中入門(mén)級(jí)BF531DSP的最小系統(tǒng)PCB原理圖，為protel格式，是開(kāi)發(fā)固件代碼必備的圖紙。
標(biāo)簽： Blackfin 531 DSP PCB
上傳時(shí)間： 2013-12-17
上傳用戶(hù)：qb1993225
華碩電腦pcb設(shè)計(jì)規(guī)范，內(nèi)部資料， PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: (1) ”P(pán)CB LAYOUT 基本規(guī)範(fàn)”:為R&D Layout時(shí)必須遵守的事項(xiàng), 否則SMT,DIP,裁板時(shí)無(wú)法生產(chǎn). (2) “錫偷LAYOUT RULE建議規(guī)範(fàn)”: 加適合的錫偷可降低短路及錫球. (3) “PCB LAYOUT 建議規(guī)範(fàn)”:為製造單位為提高量產(chǎn)良率,建議R&D在design階段即加入PCB Layout. (4) ”零件選用建議規(guī)範(fàn)”: Connector零件在未來(lái)應(yīng)用逐漸廣泛, 又是SMT生產(chǎn)時(shí)是偏移及置件不良的主因,故製造希望R&D及採(cǎi)購(gòu)在購(gòu)買(mǎi)異形零件時(shí)能顧慮製造的需求, 提高自動(dòng)置件的比例. (5) “零件包裝建議規(guī)範(fàn)”:,零件taping包裝時(shí), taping的公差尺寸規(guī)範(fàn),以降低拋料率.
標(biāo)簽： pcb 華碩電腦 設(shè)計(jì)規(guī)范
上傳時(shí)間： 2013-12-16
上傳用戶(hù)：奇奇奔奔
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標(biāo)簽： AspUpload Highslide SWFUpload AspJpeg
上傳時(shí)間： 2013-12-21
上傳用戶(hù)：84425894
課件教程類(lèi)專(zhuān)輯 64個(gè) 3.44GPCB制程綜覽 279頁(yè) 3.3M.ppt
標(biāo)簽：
上傳時(shí)間： 2014-05-05
上傳用戶(hù)：時(shí)代將軍
PCB及CAD相關(guān)資料專(zhuān)輯 174冊(cè) 3.19GAutoCAD及Protel課件 37.4M PDF版.rar
標(biāo)簽：
上傳時(shí)間： 2014-05-05
上傳用戶(hù)：時(shí)代將軍
設(shè)計(jì)高速電路必須考慮高速訊 號(hào)所引發(fā)的電磁干擾、阻抗匹配及串音等效應(yīng)，所以訊號(hào)完整性 (signal integrity)將是考量設(shè)計(jì)電路優(yōu)劣的一項(xiàng)重要指標(biāo)，電路日異複雜必須仰賴(lài)可 靠的軟體來(lái)幫忙分析這些複雜的效應(yīng)，才比較可能獲得高品質(zhì)且可靠的設(shè)計(jì)， 因此熟悉軟體的使用也將是重要的研究項(xiàng)目之一。另外了解高速訊號(hào)所引發(fā)之 各種效應(yīng)(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設(shè)計(jì)的重點(diǎn)之一。目前高速示波器的功能越來(lái)越多，使用上很複雜，必須事先 進(jìn)修學(xué)習(xí)，否則無(wú)法全盤(pán)了解儀器之功能，因而無(wú)法有效發(fā)揮儀器的量測(cè)功能。 其次就是高速訊號(hào)量測(cè)與介面的一些測(cè)試規(guī)範(fàn)也必須熟悉，像眼圖分析，探針 效應(yīng)，抖動(dòng)(jitter)測(cè)量規(guī)範(fàn)及高速串列介面量測(cè)規(guī)範(fàn)等實(shí)務(wù)技術(shù)，必須充分 了解研究學(xué)習(xí)，進(jìn)而才可設(shè)計(jì)出優(yōu)良之教學(xué)教材及教具。
標(biāo)簽： 高速電路
上傳時(shí)間： 2021-11-02
上傳用戶(hù)：jiabin
U盤(pán)大小的PCB容納JLINK和USB轉(zhuǎn)串口兩大功能。最新JLINK固件讓下載暢通無(wú)阻。根據(jù)通用外殼設(shè)計(jì)版型，提供外殼鏈接。已經(jīng)過(guò)測(cè)試。
上傳時(shí)間： 2021-11-03
上傳用戶(hù)：ttalli
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