本書(shū)中，系統(tǒng)地介紹了現(xiàn)代電力電子變換裝置及其PWM控制策略，具有內(nèi)容系統(tǒng)全面、范例豐富詳盡、原理深入淺出、理論與實(shí)際緊密結(jié)合等特點(diǎn)。第1～9章主要關(guān)注脈寬調(diào)制技術(shù)；第10～16章主要關(guān)注電流控制技術(shù)。其中，第1章和第2章講述兩種基本的PWM控制策略；第3章介紹PWM控制中的三相逆變器的過(guò)調(diào)制問(wèn)題；第4～6章是對(duì)不同PWM控制方法的詳細(xì)介紹；第7章介紹了PWM控制中的電磁干擾問(wèn)題；第8章和第9章講述了多重與多相功率變換器的PWM控制策略；第10～15章分別以同步電機(jī)和直流電源為例詳細(xì)介紹了各種不同的電流控制方法；第16章介紹了多電平變換器的電流控制方法。 譯者序 引言 第1章用于兩電平三相電壓型逆變器的載波脈寬調(diào)制1 11引言1 12參考電壓va ref、vb ref、vc ref3 13參考電壓Pa ref、Pb ref、Pc ref6 14va、vb、vc與Pa、Pb、Pc之間的聯(lián)系8 15PWM信號(hào)的產(chǎn)生8 151反鋸齒波8 152傳統(tǒng)鋸齒形載波11 153三角形載波12 154說(shuō)明16
上傳時(shí)間： 2022-06-23
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基于LTspice的射極跟隨器仿真實(shí)驗(yàn)1，實(shí)驗(yàn)要求與目的（1）進(jìn)一步掌握靜態(tài)工作點(diǎn)的調(diào)試方法，深入理解靜態(tài)工作點(diǎn)的作用。（2）調(diào)節(jié)電路的跟隨范圍，使輸出信號(hào)的跟隨范圍最大。（3）測(cè)量電路的電壓放大倍數(shù)、輸入電阻和輸出電阻。（4）測(cè)量電路的頻率特性。2·實(shí)驗(yàn)原理在射極跟隨器電路中，信號(hào)由基極和地之間輸入，由發(fā)射極和地之間輸出，集電極交流等效接地，所以，集電極是輸入/輸出信號(hào)的公共端，故稱(chēng)為共集電極電路。又由于該電路的輸出電壓是跟隨輸入電壓變化的，所以又稱(chēng)為射極跟隨器。3.實(shí)驗(yàn)電路射極跟隨器電路如圖 1所示。4.實(shí)驗(yàn)步驟（1）靜態(tài)工作點(diǎn)的調(diào)整。按圖 1連接電路，輸入信號(hào)由信號(hào)發(fā)生器產(chǎn)生一個(gè)幅度為 1V、頻率為1kHz的正弦信號(hào)。要注意使信號(hào)不失真輸出。（2）跟隨范圍調(diào)節(jié)。增大輸入信號(hào)直到輸出出現(xiàn)失真，觀察出現(xiàn)了飽和失真還是截止失真，再增大或減小信號(hào)，使失真消除。再次增大輸入信號(hào)，若出現(xiàn)失真，再調(diào)節(jié)信號(hào)使輸出波形達(dá)到最大不失真輸出，此時(shí)電路的靜態(tài)工作點(diǎn)是最佳工作點(diǎn)，輸入信號(hào)是最大的跟隨范圍。最后輸入信號(hào)增加到28 v，電路達(dá)到最大不失真輸出如圖 2所示。最大輸入、輸出信號(hào)波形如圖 3所示。
上傳時(shí)間： 2022-06-26
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1.深入研究PCIe和千兆以太網(wǎng)，了解PCIe和千兆以太網(wǎng)的技術(shù)優(yōu)勢(shì)，具體分析PCle和千兆以太網(wǎng)的傳輸協(xié)議，詳細(xì)說(shuō)明PCleTLP數(shù)據(jù)包格式和以太網(wǎng)標(biāo)2.完成PCIe DMA數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)。設(shè)計(jì)方案主要包括兩大部分，分別是FPGA端Verilog邏輯模塊開(kāi)發(fā)以及PC端的驅(qū)動(dòng)和C應(yīng)用程序開(kāi)發(fā)。FPGA端基于PCle IP Core完成了發(fā)送接收引擎模塊、寄存器讀寫(xiě)控制模塊和FIFO讀寫(xiě)控制模塊的設(shè)計(jì)。定義了相應(yīng)模塊的接口，并分析了數(shù)據(jù)傳輸?shù)臅r(shí)序。PC端采用WinDriver進(jìn)行PCle的驅(qū)動(dòng)開(kāi)發(fā)，并根據(jù)WinDriver提供的驅(qū)動(dòng)API函數(shù)完成C應(yīng)用程序的設(shè)計(jì)。3.完成千兆以太網(wǎng)數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)。設(shè)計(jì)方案也主要包括兩大部分，分別是FPGA端Verilog邏輯模塊開(kāi)發(fā)以及PC端Winpcap應(yīng)用程序開(kāi)發(fā)。FPGA端基于嵌入式三態(tài)以太網(wǎng)MACIPCore，設(shè)計(jì)了發(fā)送接收引擎模塊、FIFO讀寫(xiě)控制模塊和物理接口模塊。定義了相應(yīng)模塊的接口，并分析了數(shù)據(jù)傳輸經(jīng)過(guò)Locallink接口和Client用戶(hù)接口上的傳輸時(shí)序。PC端采用Winpcap提供的網(wǎng)絡(luò)編程完成了C應(yīng)用程序的設(shè)計(jì)，實(shí)現(xiàn)了捕獲FPGA端發(fā)送的數(shù)據(jù)包以及發(fā)送原始數(shù)據(jù)包至FPGA端的功能。4.PCIe DMA數(shù)據(jù)傳輸系統(tǒng)和千兆以太網(wǎng)數(shù)據(jù)傳輸系統(tǒng)在Xilinx ML507開(kāi)發(fā)板上進(jìn)行了性能測(cè)試。記錄FPGA與PC間進(jìn)行讀寫(xiě)測(cè)試的結(jié)果，驗(yàn)證這兩個(gè)系統(tǒng)的可用性和穩(wěn)定性，最后分析了影響系統(tǒng)傳輸速率的原因以及系統(tǒng)目前仍存在的不足。
標(biāo)簽： fpga pc pcie 以太網(wǎng) 通信
上傳時(shí)間： 2022-07-11
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上傳時(shí)間： 2013-06-03
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標(biāo)簽： 調(diào)制解調(diào)器
上傳時(shí)間： 2013-05-29
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標(biāo)簽： 工業(yè)
上傳時(shí)間： 2013-06-30
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