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  • 基于FPGA的8PSK調(diào)制解調(diào)技術(shù)研究.rar

    軟件無線電是近年提出的新的通信體系,由于其具有靈活性和可重配置性并且符合通信的發(fā)展趨勢(shì),已成為通信系統(tǒng)設(shè)計(jì)的研究熱點(diǎn)。因此對(duì)基于軟件無線電的調(diào)制解調(diào)技術(shù)進(jìn)行深入細(xì)致的研究非常有意義。 本文首先從闡述軟件無線電的理論基礎(chǔ)入手,對(duì)多速率信號(hào)處理中的內(nèi)插和抽取、帶通采樣、數(shù)字變頻等技術(shù)進(jìn)行了分析與探討,為設(shè)計(jì)和實(shí)現(xiàn)8PSK調(diào)制解調(diào)器提供了非常重要的理論依據(jù)。然后,研究了8PSK調(diào)制解調(diào)技術(shù),詳細(xì)論述了它們的基本概念和原理,提出了系統(tǒng)實(shí)現(xiàn)方案,在DSP+FPGA平臺(tái)上實(shí)現(xiàn)了8PSK信號(hào)的正確調(diào)制解調(diào)。文中著重研究了突發(fā)通信的同步和頻偏糾正算法,針對(duì)同步算法選取了一種基于能量檢測(cè)法的快速位同步算法,采用相關(guān)器實(shí)現(xiàn),同時(shí)實(shí)現(xiàn)位同步和幀同步。并且對(duì)于突發(fā)通信的多普勒頻偏糾正,設(shè)計(jì)了一個(gè)基于自動(dòng)頻率控制(AFC)環(huán)的頻偏檢測(cè)器,通過修改數(shù)控振蕩器(NCO)的頻率控制字方法來校正本地載波頻率,整個(gè)算法結(jié)構(gòu)簡(jiǎn)單,運(yùn)算量小,頻偏校正速度快,具有較好的實(shí)用性。其次,對(duì)相干解調(diào)的初始相位進(jìn)行糾正時(shí),提出了一種簡(jiǎn)單易行的CORDIC方法,同時(shí)對(duì)FPGA編程當(dāng)中的一些關(guān)鍵問題進(jìn)行了介紹。最后,設(shè)計(jì)了自適應(yīng)調(diào)制解調(diào)器,根據(jù)信噪比和誤碼率來自適應(yīng)的改變調(diào)制方式,以達(dá)到最佳的傳輸性能。

    標(biāo)簽: FPGA 8PSK 調(diào)制解調(diào)

    上傳時(shí)間: 2013-04-24

    上傳用戶:mingaili888

  • 基于FPGA的調(diào)制解調(diào)器的研究和設(shè)計(jì).rar

    當(dāng)今電子系統(tǒng)的設(shè)計(jì)是以大規(guī)模FPGA為物理載體的系統(tǒng)芯片的設(shè)計(jì),基于FPGA的片上系統(tǒng)可稱為可編程片上系統(tǒng)(SOPC)。SOPC的設(shè)計(jì)是以知識(shí)產(chǎn)權(quán)核(IPCore)為基礎(chǔ),以硬件描述語言為主要設(shè)計(jì)手段,借助以計(jì)算機(jī)為平臺(tái)的EDA工具進(jìn)行的。 本文在介紹了FPGA與SOPC相關(guān)技術(shù)的基礎(chǔ)上,給出了SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的方案。在分析設(shè)計(jì)軟件Matlab/DSP(Digital Signal Processing)。builder以及Quartus Ⅱ開發(fā)軟件進(jìn)行SOPC(System On a Programmable Chip)設(shè)計(jì)流程后,依據(jù)調(diào)制解調(diào)算法提出了一種基于DSP Builder調(diào)制解調(diào)器的SOPC實(shí)現(xiàn)方案,模塊化的設(shè)計(jì)方法大大縮短了調(diào)制解調(diào)器的開發(fā)周期。 在SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的過程中,用MATLAB/Simulink的圖形方式調(diào)用Altera DSP Builder和其他Simulink庫(kù)中的圖形模塊(Block)進(jìn)行系統(tǒng)建模,在Simulink中仿真通過后,利用DSP Builder將Simulink的模型文件(.mdl)轉(zhuǎn)化成通用的硬件描述語言VHDL文件,從而避免了VHDL語言手動(dòng)編寫系統(tǒng)的煩瑣過程,將精力集中于算法的優(yōu)化上。 基于DSP Builder的開發(fā)功能,調(diào)制解調(diào)器電路中的低通濾波器可直接調(diào)用FIRIP Core,進(jìn)一步提高了開發(fā)效率。 在進(jìn)行編譯、仿真調(diào)試成功后,經(jīng)過QuartusⅡ?qū)⒕幾g生成的編程文件下載到ALTERA公司Cyclone Ⅱ系列的FPGA芯片EP2C5F256C6,完成器件編程,從而給出了一種調(diào)制解調(diào)器的SOPC系統(tǒng)實(shí)現(xiàn)方案。

    標(biāo)簽: FPGA 調(diào)制解調(diào)器

    上傳時(shí)間: 2013-06-24

    上傳用戶:liuchee

  • 基于FPGA的直擴(kuò)調(diào)制解調(diào)器的設(shè)計(jì)與實(shí)現(xiàn).rar

    擴(kuò)頻通信系統(tǒng)與常規(guī)的通信系統(tǒng)相比,具有很強(qiáng)的抗窄帶干擾,抗多徑干擾,抗人為干擾的能力,并具有信息隱蔽、多址保密通信等優(yōu)點(diǎn)。在近年來得到了迅速的發(fā)展。本論文主要討論和實(shí)現(xiàn)了基于FPGA的直接序列擴(kuò)頻信號(hào)的解擴(kuò)解調(diào)處理。論文對(duì)該直擴(kuò)通信系統(tǒng)和FPGA設(shè)計(jì)方法進(jìn)行了相關(guān)研究,最后用Altera公司的最新的FPGA開發(fā)平臺(tái)Quarus Ⅱ5.0實(shí)現(xiàn)了相關(guān)設(shè)計(jì)。 整個(gè)系統(tǒng)分為兩個(gè)部分,發(fā)送部分和接收部分。發(fā)送部分主要有串并轉(zhuǎn)換、差分卷積編碼、PN碼擴(kuò)頻、QPSK調(diào)制、成型濾波等模塊。接收部分主要有前端抗干擾、數(shù)字下變頻、解擴(kuò)解調(diào)等模塊。 論文首先介紹了擴(kuò)頻通信系統(tǒng)的特點(diǎn)以及相關(guān)技術(shù)的國(guó)內(nèi)外發(fā)展現(xiàn)狀,并介紹了本論文的研究思路和內(nèi)容。 然后,論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法,結(jié)合實(shí)際需要,設(shè)計(jì)了一種零中頻DSSS解調(diào)解擴(kuò)方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析,采用了基于數(shù)字外差調(diào)制的自適應(yīng)陷波器來進(jìn)行前端窄帶干擾抑制處理,用基于自適應(yīng)門限技術(shù)的滑動(dòng)相關(guān)捕獲和分時(shí)復(fù)用單相關(guān)器跟蹤來改善PN碼同步的性能,用基于硬判決的COSTAS(科斯塔斯)環(huán)來減少載波提取的算法復(fù)雜度,用改進(jìn)型CORDIC算法實(shí)現(xiàn)NCO來方便的進(jìn)行擴(kuò)展。 接著,論文給出了系統(tǒng)總體設(shè)計(jì)和發(fā)送及接受子系統(tǒng)的各個(gè)功能模塊的實(shí)現(xiàn)分析以及在Quartus Ⅱ5.0上的實(shí)現(xiàn)細(xì)節(jié),給出了仿真結(jié)果。 然后論文介紹了整個(gè)系統(tǒng)的硬件電路設(shè)計(jì)和它在真實(shí)系統(tǒng)中連機(jī)調(diào)試所得到的測(cè)試結(jié)果,結(jié)果表明該系統(tǒng)具有性能穩(wěn)定,靈活性好,生產(chǎn)調(diào)試容易,體積小,便于升級(jí)等特點(diǎn)并且達(dá)到課題各項(xiàng)指標(biāo)的要求。 最后是對(duì)論文工作的一些總結(jié)和對(duì)今后工作的展望。

    標(biāo)簽: FPGA 調(diào)制解調(diào)器

    上傳時(shí)間: 2013-05-23

    上傳用戶:磊子226

  • 基于FPGA嵌入式指紋識(shí)別系統(tǒng)研究.rar

    隨著科學(xué)技術(shù)的發(fā)展,指紋識(shí)別技術(shù)被廣泛應(yīng)用到各種不同的領(lǐng)域。對(duì)于一般的指紋識(shí)別系統(tǒng),其設(shè)計(jì)要求具有很高的實(shí)時(shí)性和易用性,因此識(shí)別算法應(yīng)該具有較低的復(fù)雜度,較快的運(yùn)算速度,從而滿足實(shí)時(shí)性的要求。所以有必要根據(jù)不同的識(shí)別算法采用不同的實(shí)現(xiàn)平臺(tái),使得指紋識(shí)別系統(tǒng)具有較高的可靠性、實(shí)時(shí)性、有效性等性能要求。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計(jì)領(lǐng)域中最熱門的概念。NiosⅡ是Altera.公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入到FPGA內(nèi)部,與用戶自定義邏輯組建成一個(gè)基于FPGA的片上專用系統(tǒng)。 本文在綜合考慮各種應(yīng)用情況的基礎(chǔ)上,以網(wǎng)絡(luò)技術(shù)、數(shù)據(jù)庫(kù)技術(shù)、指紋識(shí)別技術(shù)和嵌入式系統(tǒng)技術(shù)為理論基礎(chǔ),提出了一種有效可行的系統(tǒng)架構(gòu)方案。對(duì)指紋識(shí)別技術(shù)中各個(gè)環(huán)節(jié)的算法和原理進(jìn)行了深入研究,合理的改進(jìn)了部分指紋識(shí)別算法;同時(shí)為了提高系統(tǒng)的實(shí)時(shí)性,采用NiosⅡ嵌入式處理器和FPGA硬件模塊實(shí)現(xiàn)指紋圖像處理主要算法。論文主要包括以下幾個(gè)方面: 1、對(duì)指紋圖像預(yù)處理、特征提取和特征匹配算法原理進(jìn)行闡述,同時(shí)改進(jìn)了指紋圖像的細(xì)化算法,提高了算法的性能,并設(shè)計(jì)了一套實(shí)用的指紋特征數(shù)據(jù)結(jié)構(gòu); 2、針對(duì)指紋圖像預(yù)處理模塊,包括圖像的歸一化、頻率提取、方向提取以及方向?yàn)V波,采用基于FPGA的硬件電路的方式實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明,在保證系統(tǒng)誤識(shí)率較低、可靠性高的基礎(chǔ)上,大大提高了系統(tǒng)的執(zhí)行速度; 3、改變了傳統(tǒng)的單枚指紋識(shí)別方法,提出采用多枚指紋唯一標(biāo)識(shí)身份,大大降低了識(shí)別系統(tǒng)的誤識(shí)率; 4、改進(jìn)了傳統(tǒng)的基于三角形匹配中獲取基準(zhǔn)點(diǎn)的方法,同時(shí)結(jié)合可變界限盒思想進(jìn)行指紋特征匹配。 5、結(jié)合COM+技術(shù)、數(shù)據(jù)庫(kù)技術(shù)和網(wǎng)絡(luò)技術(shù),開發(fā)了后臺(tái)指紋特征匹配服務(wù)系統(tǒng),實(shí)現(xiàn)了嵌入式指紋識(shí)別系統(tǒng)同數(shù)據(jù)庫(kù)的實(shí)時(shí)信息交換。 實(shí)驗(yàn)結(jié)果表明,本文所提出的系統(tǒng)構(gòu)架方案有效可行,基于FPGA的自動(dòng)指紋識(shí)別系統(tǒng)在速度、功耗、擴(kuò)展性等方面具有獨(dú)特的優(yōu)勢(shì),擁有廣闊的發(fā)展前景。

    標(biāo)簽: FPGA 嵌入式 指紋識(shí)別

    上傳時(shí)間: 2013-08-04

    上傳用戶:laozhanshi111

  • 雙信號(hào)快速測(cè)頻技術(shù)及FPGA實(shí)現(xiàn)

    建立在數(shù)據(jù)率轉(zhuǎn)換技術(shù)之上的寬帶數(shù)字偵察接收機(jī)要求能夠?qū)崿F(xiàn)高截獲概率、高靈敏度、近乎實(shí)時(shí)的信號(hào)處理能力。雙信號(hào)數(shù)據(jù)率轉(zhuǎn)換技術(shù)是寬帶數(shù)字偵察接收機(jī)關(guān)鍵技術(shù)之一,是解決寬帶數(shù)字接收機(jī)中前端高速ADC采樣的高速數(shù)據(jù)流與后端DSP處理速度之間瓶頸問題的可行方案。測(cè)頻技術(shù)以及帶通濾波,即寬帶數(shù)字下變頻技術(shù),是實(shí)現(xiàn)數(shù)據(jù)率轉(zhuǎn)換系統(tǒng)的關(guān)鍵技術(shù)。本文首先介紹了寬帶數(shù)字偵察接收關(guān)鍵技術(shù)之一的數(shù)據(jù)率轉(zhuǎn)換技術(shù),著重研究了快速、高精度雙信號(hào)測(cè)頻算法以及實(shí)驗(yàn)系統(tǒng)硬件實(shí)現(xiàn)。論文主要工作如下: (1)分析了現(xiàn)代電子偵察環(huán)境下的信號(hào)特征,指出寬帶數(shù)字接收機(jī)必須滿足寬監(jiān)視帶寬、流水作業(yè)以及近實(shí)時(shí)的響應(yīng)時(shí)間。給出了一種頻率引導(dǎo)式的數(shù)字接收機(jī)方案,簡(jiǎn)要介紹這種接收機(jī)的關(guān)鍵技術(shù)——快速、高精度頻率估計(jì)以及高效的數(shù)據(jù)率轉(zhuǎn)換。 (2)介紹了FFT技術(shù)在測(cè)頻算法中的應(yīng)用,比較了FFT專用芯片及其優(yōu)點(diǎn)和缺點(diǎn),指出為了滿足實(shí)時(shí)處理要求,必須選用FPGA設(shè)計(jì)FFT模塊。 (3)在分析常規(guī)的插值算法基礎(chǔ)上,提出了一種單信號(hào)的快速插值頻率估計(jì)方法,只需三個(gè)FFT變換系數(shù)的實(shí)部構(gòu)造頻率修正項(xiàng),計(jì)算量低。該方法具有精度高、測(cè)頻速率快的特點(diǎn)。 (4)基于DFT理論和自相關(guān)理論,提出了結(jié)合FFT和自相關(guān)的雙信號(hào)頻率估計(jì)算法。該方法先用DFT估計(jì)其中一個(gè)信號(hào)的頻率和幅度,以此頻率對(duì)信號(hào)解調(diào)并對(duì)消該頻率成分,最后利用自相關(guān)理論估計(jì)出另一個(gè)信號(hào)的頻率。 (5)基于DFT理論和FFT技術(shù),研究了信號(hào)平方與FFT結(jié)合的雙信號(hào)頻率估計(jì)算法。根據(jù)信號(hào)中兩頻率分量的幅度比,只需一次一維平方信號(hào)譜峰搜索,就可以得到雙信號(hào)的和頻與差頻分量的估計(jì)值,并利用插值技術(shù)提高測(cè)頻精度。該算法能夠精確地估計(jì)頻率間隔小的雙信號(hào)頻率,且容易地?cái)U(kuò)展到復(fù)信號(hào),F(xiàn)PGA硬件實(shí)現(xiàn)容易。 (6)基于現(xiàn)代譜分析理論,研究了基于AR(2)模型的雙信號(hào)頻率估計(jì)算法。方法在利用AR(2)模型系數(shù)估計(jì)雙正弦信號(hào)頻率之和的同時(shí),利用FFT快速測(cè)頻算法估計(jì)其中強(qiáng)信號(hào)分量的頻率值。算法仿真驗(yàn)證和性能分析表明了提出的算法能快速高精度地估計(jì)雙信號(hào)頻率。 (7)給出了基于頻譜重心算法的雷達(dá)雙信號(hào)頻率估計(jì)的FPGA硬件實(shí)現(xiàn)架構(gòu),并進(jìn)行了時(shí)序仿真。 (8)討論了雙信號(hào)帶寬匹配接收系統(tǒng)的硬件設(shè)計(jì)方案,給出了快速測(cè)頻及帶寬估計(jì)模塊設(shè)計(jì)。

    標(biāo)簽: FPGA 信號(hào) 測(cè)頻

    上傳時(shí)間: 2013-06-02

    上傳用戶:youke111

  • 圖象壓縮系統(tǒng)中熵編解碼器的FPGA設(shè)計(jì)及實(shí)現(xiàn)

    隨著移動(dòng)終端、多媒體、Internet網(wǎng)絡(luò)、通信,圖像掃描技術(shù)的發(fā)展,以及人們對(duì)圖象分辨率,質(zhì)量要求的不斷提高,用軟件壓縮難以達(dá)到實(shí)時(shí)性要求,而且會(huì)帶來因傳輸大量原始圖象數(shù)據(jù)帶來的帶寬要求,因此采用硬件實(shí)現(xiàn)圖象壓縮已成為一種必然趨勢(shì)。而熵編碼單元作為圖像變換,量化后的處理環(huán)節(jié),是圖像壓縮中必不可少的部分。研究熵編解碼器的硬件實(shí)現(xiàn),具有廣闊的應(yīng)用背景。本文以星載視頻圖像壓縮的硬件實(shí)現(xiàn)項(xiàng)目為背景,對(duì)熵編碼器和解碼器的硬件實(shí)現(xiàn)進(jìn)行探討,給出了并行熵編碼和解碼器的實(shí)現(xiàn)方案。熵編解碼器中的難點(diǎn)是huffman編解碼器的實(shí)現(xiàn)。在設(shè)計(jì)并行huffman編碼方案時(shí)通過改善Huffman編碼器中變長(zhǎng)碼流向定長(zhǎng)碼流轉(zhuǎn)換時(shí)的控制邏輯,避免了因數(shù)據(jù)處理不及時(shí)造成數(shù)據(jù)丟失的可能性,從而保證了編碼的正確性。而在實(shí)現(xiàn)并行的huffman解碼器時(shí),解碼算法充分利用了規(guī)則化碼書帶來的碼字的單調(diào)性,及在特定長(zhǎng)度碼字集內(nèi)碼字變化的連續(xù)性,將并行解碼由模式匹配轉(zhuǎn)換為算術(shù)運(yùn)算,提高了存儲(chǔ)器的利用率、系統(tǒng)的解碼效率和速度。在實(shí)現(xiàn)并行huffman編碼的基礎(chǔ)上,結(jié)合針對(duì)DC子帶的預(yù)測(cè)編碼,針對(duì)直流子帶的游程編碼,能夠?qū)D像壓縮系統(tǒng)中經(jīng)過DWT變換,量化,掃描后的數(shù)據(jù)進(jìn)行正確的編碼。同時(shí),在并行huffman解碼基礎(chǔ)上的熵解碼器也可以解碼出正確的數(shù)據(jù)提供給解碼系統(tǒng)的后續(xù)反量化模塊,進(jìn)一步處理。在本文介紹的設(shè)計(jì)方案中,按照自頂向下的設(shè)計(jì)方法,對(duì)星載圖像壓縮系統(tǒng)中的熵編解碼器進(jìn)行分析,進(jìn)而進(jìn)行邏輯功能分割及模塊劃分,然后分別實(shí)現(xiàn)各子模塊,并最終完成整個(gè)系統(tǒng)。在設(shè)計(jì)過程中,用高級(jí)硬件描述語言verilogHDL進(jìn)行RTL級(jí)描述。利用了Altera公司的QuartusII開發(fā)平臺(tái)進(jìn)行設(shè)計(jì)輸入、編譯、仿真,同時(shí)還采用modelsim仿真工具和symplicity的綜合工具,驗(yàn)證了設(shè)計(jì)的正確性。通過系統(tǒng)波形仿真和下板驗(yàn)證熵編碼器最高頻率可以達(dá)到127M,在62.5M的情況下工作正常。而熵解碼器也可正常工作在62.5M,吞吐量可達(dá)到2500Mbps,也能滿足性能要求。仿真驗(yàn)證的結(jié)果表明:設(shè)計(jì)能夠滿足性能要求,并具有一定的使用價(jià)值。

    標(biāo)簽: FPGA 圖象壓縮

    上傳時(shí)間: 2013-05-19

    上傳用戶:吳之波123

  • 指紋識(shí)別算法的研究及基于FPGA的硬件實(shí)現(xiàn)

    隨著圖像處理和模式識(shí)別技術(shù)的進(jìn)步,基于生物特征的識(shí)別技術(shù)成為蓬勃發(fā)展的高技術(shù)之一,根據(jù)IBG(InternationalBiometricGroup)組織對(duì)生物特征市場(chǎng)的統(tǒng)計(jì)和預(yù)測(cè),該領(lǐng)域的收入的年增長(zhǎng)率30-50%,到2008年,全球總收入將達(dá)到46.39億美元。而基于指紋特征的識(shí)別技術(shù)由于其獨(dú)特的可靠性,穩(wěn)定性,方便快捷的特點(diǎn),恰好符合了市場(chǎng)的需求。目前指紋識(shí)別技術(shù)是生物識(shí)別領(lǐng)域中應(yīng)用最廣泛的識(shí)別技術(shù),也是研究與應(yīng)用的一個(gè)熱點(diǎn)。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計(jì)領(lǐng)域中最熱門的概念。NiosⅡ是Altera公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入FPGA內(nèi)部,與用戶自定義邏輯結(jié)合構(gòu)成一個(gè)基于FPGA的片上系統(tǒng)。與嵌入式硬核相比較,嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識(shí)別系統(tǒng)對(duì)速度的要求。 本文對(duì)指紋識(shí)別技術(shù)中各個(gè)環(huán)節(jié)的算法進(jìn)行了較為深入的研究,結(jié)合NiosⅡ嵌入式處理器的特點(diǎn),對(duì)算法進(jìn)行了合理的選擇與優(yōu)化,形成了一套完整的指紋識(shí)別算法,并提出了一種基于FPGA的指紋識(shí)別系統(tǒng)硬件設(shè)計(jì)方案。 論文的內(nèi)容主要包括以下幾個(gè)方面: 1、對(duì)指紋圖像預(yù)處理、后處理和匹配算法進(jìn)行了改進(jìn),提高了算法的性能;設(shè)計(jì)了一種適用于快速匹配的指紋特征數(shù)據(jù)結(jié)構(gòu);提出了一套基于特征點(diǎn)匹配的指紋識(shí)別算法。實(shí)驗(yàn)結(jié)果表明該算法速度快、誤識(shí)率較低、可靠性較高,可以滿足實(shí)用的要求。 2、本著增加系統(tǒng)集成度、減小系統(tǒng)體積、提高便攜性、降低功耗和成本,同時(shí)提升系統(tǒng)的性能的原則,使用Altera公司提供的外圍設(shè)備IP核配合NiosⅡ處理器軟核搭建了一個(gè)單片嵌入式系統(tǒng),然后以內(nèi)嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片,外配片外RAM和Flash存儲(chǔ)器以及小鍵盤和LCD顯示屏等器件,設(shè)計(jì)了一個(gè)便攜式指紋識(shí)別系統(tǒng),提出了一套基于FPGA的硬件設(shè)計(jì)方案。 3、利用NiosⅡ開發(fā)板對(duì)硬件設(shè)計(jì)方案進(jìn)行了初步的驗(yàn)證,實(shí)現(xiàn)了指紋采集芯片F(xiàn)PS200與FPGA的接口,并進(jìn)行了算法的移植。 實(shí)驗(yàn)結(jié)果表明本文所提出的系統(tǒng)設(shè)計(jì)方案是可行的。基于FPGA的自動(dòng)指紋識(shí)別系統(tǒng)在速度、功耗、體積、擴(kuò)展性方面有著獨(dú)特的優(yōu)勢(shì),具有廣闊的發(fā)展空間。最后提出了對(duì)這一設(shè)計(jì)繼續(xù)改進(jìn)的思路和下一步研究的內(nèi)容。

    標(biāo)簽: FPGA 指紋識(shí)別 法的研究 硬件實(shí)現(xiàn)

    上傳時(shí)間: 2013-06-07

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  • 利用FPGA設(shè)計(jì)和實(shí)現(xiàn)點(diǎn)對(duì)點(diǎn)EoS的成幀

    通信領(lǐng)域的主導(dǎo)技術(shù)有兩種:用于內(nèi)部商業(yè)通信的局域網(wǎng)(LAN)中的以太網(wǎng)(Ethernet)和廣域網(wǎng)(WAN)中的SDH(SynchronousDigitalHierarchy)。因?yàn)樵赟DH網(wǎng)絡(luò)上不直接支持以太網(wǎng),當(dāng)企業(yè)(客戶)間需要彼此通信或企業(yè)(客戶)內(nèi)需要將其總部與分部連至同一LAN網(wǎng)時(shí)互連問題便應(yīng)運(yùn)而生。 該研究課題的目的是研究在EoS(EthernetoverSDH)實(shí)現(xiàn)過程中存在的技術(shù)難題和協(xié)議實(shí)現(xiàn)的復(fù)雜性,提出一種簡(jiǎn)單、快速、高效的協(xié)議實(shí)現(xiàn)方法。主要關(guān)注的是EoS系統(tǒng)中與協(xié)議幀映射相關(guān)的關(guān)鍵技術(shù),例如:自定義幀結(jié)構(gòu)、幀定位、全數(shù)字鎖相技術(shù)、流量控制技術(shù)等,最終完成EoS中這些關(guān)鍵技術(shù)模塊的設(shè)計(jì)。 該課題簡(jiǎn)單分析EoS系統(tǒng)相關(guān)協(xié)議幀結(jié)構(gòu)及EoS系統(tǒng)的原理,闡述了FPGA技術(shù)的實(shí)現(xiàn)方法,重點(diǎn)在于利用業(yè)界最先進(jìn)的EDA工具實(shí)現(xiàn)EoS系統(tǒng)中幀映射技術(shù)。系統(tǒng)中采用一種簡(jiǎn)化了的點(diǎn)對(duì)點(diǎn)實(shí)現(xiàn)方案,對(duì)以太網(wǎng)的數(shù)據(jù)幀直接進(jìn)行HDLC幀格式封裝,采用多通道的E1信道承載完整的HIDLC幀方式將HDLC幀映射到E1信道中,然后采用單通道承載多個(gè)完整的E1幀方式將E1映射到SDH信道中,從而把以太網(wǎng)幀有效地映射到SDH的負(fù)荷中,實(shí)現(xiàn)“透明的局域網(wǎng)服務(wù)”。這對(duì)在現(xiàn)有的SDH傳輸設(shè)備上承載以太網(wǎng),開發(fā)實(shí)現(xiàn)以太網(wǎng)的廣域連接設(shè)備,將會(huì)具有重要的意義。

    標(biāo)簽: FPGA EoS 點(diǎn)對(duì)點(diǎn)

    上傳時(shí)間: 2013-04-24

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  • 51單片機(jī)開發(fā)板原理圖

    51單片機(jī)開發(fā)板的原理圖,PDF版,并且附帶sch原理圖,可以導(dǎo)入protel99直接生成PCB,來自買的開發(fā)板資料

    標(biāo)簽: 51單片機(jī) 開發(fā)板原理圖

    上傳時(shí)間: 2013-04-24

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  • 單片機(jī)c語言教程全集

    單片機(jī)C語言,word版,keil軟件應(yīng)用

    標(biāo)簽: 單片機(jī)c語言 教程

    上傳時(shí)間: 2013-07-13

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