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Mentor公司的
ModelSim
是業(yè)界最優(yōu)秀的HDL語言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺無關(guān)，便于保護(hù)IP核，個性化的圖形界面和用戶接口，為用戶加快調(diào)錯提供強(qiáng)有力的手段，是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。
ModelSim
的詳細(xì)開發(fā)和使用過程 適合初級
ModelSim
學(xué)員
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使用教程,verilog或vhdl仿真
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公司的使用手冊
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介紹了FPGA設(shè)計(jì)全流程：
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>>Synplify.Pro>>ISE
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Matlab 與
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協(xié)同仿真的例程設(shè)置好
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運(yùn)行環(huán)境后
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的使用方法,
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是VHDL的仿真工具
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仿真流程
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夏宇聞8位RISC_CPU的完整代碼+TESTBENCH（已調(diào)試）
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