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MoDELSim

Mentor公司的MoDELSim是業(yè)界最優(yōu)秀的HDL語(yǔ)言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺(tái)無關(guān)，便于保護(hù)IP核，個(gè)性化的圖形界面和用戶接口，為用戶加快調(diào)錯(cuò)提供強(qiáng)有力的手段，是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。

  • MoDELSim教程（中文）.rar

    fpga仿真工具MoDELSim的中文詳細(xì)教程，希望對(duì)FPGA學(xué)習(xí)有用

    標(biāo)簽： MoDELSim 教程

    上傳時(shí)間： 2013-05-31

    上傳用戶：不挑食的老鼠

  • MoDELSim仿真學(xué)習(xí)

    學(xué)習(xí)使用MoDELSim，為自己的設(shè)計(jì)做前仿真和后仿真。是自己的設(shè)計(jì)更加的方便

    標(biāo)簽： MoDELSim 仿真

    上傳時(shí)間： 2013-06-27

    上傳用戶：1406054127

  • MoDELSim教程(中文)

    MoDELSim仿真工具是Model公司開發(fā)的。它支持Verilog、VHDL以及他們的混合仿真，它可以將整個(gè)程序分步執(zhí)行，使設(shè)計(jì)者直接看到他的程序下一步要執(zhí)行的語(yǔ)句，而且在程序執(zhí)行的任何步驟任何時(shí)刻都可以查看任意變量的當(dāng)前值，可以在Dataflow窗口查看某一單元或模塊的輸入輸出的連續(xù)變化等，比Quartus自帶的仿真器功能強(qiáng)大的多，是目前業(yè)界最通用的仿真器之一。 MoDELSim分幾種不同的版本：SE、PE和OEM，其中 集成在 Actel、Atmel、Altera、Xilinx以及Lattice等FPGA廠商設(shè)計(jì)工具中的均是其OEM版本。比如為Altera提供的OEM版本是MoDELSim-Altera,為Xilinx提供的版本為MoDELSim XE. SE版本為最高級(jí)版本,在功能和性能方面比OEM版本強(qiáng)很多,比如仿真速度方面,還支持PC 、 UNIX 、 LIUNX混合平臺(tái).

    標(biāo)簽： MoDELSim 教程

    上傳時(shí)間： 2013-06-25

    上傳用戶：2814413580

  • SDRAM讀寫控制的實(shí)現(xiàn)與MoDELSim仿真

    軟件開發(fā)環(huán)境：ISE 7.1i 硬件開發(fā)環(huán)境：紅色颶風(fēng)II代－Xilinx版 1. 本實(shí)例用于控制開發(fā)板上面的SDRAM完成讀寫功能； 先向SDRAM里面寫數(shù)據(jù)，然后再將數(shù)據(jù)讀出來做比較，如果不匹配就通過LED變亮顯示出來，如果一致，LED就不亮。 2. part1目錄是使用MoDELSim仿真的工程； 3. part2目錄是在開發(fā)版上面驗(yàn)證的工程； 2.1. part1_32目錄是4m32SDRAM的仿真工程； 2.2. part1_16目錄是4m16SDRAM的仿真工程； \model文件夾里面是仿真模型； \rtl文件夾里面是源文件； \sim文件夾里面是仿真工程； \test_bench文件夾里面是測(cè)試文件； \wave文件夾里面是仿真波形。 3.1. 工程在\project文件夾里面; 3.2. 源文件和管腳分配在\rtl文件夾里面; 3.3. 下載文件在\download文件夾里面,.mcs為PROM模式下載文件,.bit為JTAG調(diào)試下載文件。

    標(biāo)簽： MoDELSim SDRAM 讀寫 控制

    上傳時(shí)間： 2013-04-24

    上傳用戶：ZJX5201314

  • MoDELSim 6.5se 破解文件

    MoDELSim 6.5se 破解文件

    標(biāo)簽： MoDELSim 6.5 se 破解文件

    上傳時(shí)間： 2013-08-02

    上傳用戶：bugtamor

  • MoDELSim-Altera使用方法

    MoDELSim-Altera使用方法 MoDELSim-Altera使用方法

    標(biāo)簽： MoDELSim-Altera

    上傳時(shí)間： 2013-04-24

    上傳用戶：doudouzdz

  • MoDELSim教程(中文)

    PPT文檔，24頁(yè)，圖文結(jié)合 MoDELSim仿真工具是Model公司開發(fā)的。它支持Verilog、VHDL以及他們的混合仿真，它可以將整個(gè)程序分步執(zhí)行，使設(shè)計(jì)者直接看到他的程序下一步要執(zhí)行的語(yǔ)句，而且在程序執(zhí)行的任何步驟任何時(shí)刻都可以查看任意變量的當(dāng)前值，可以在Dataflow窗口查看某一單元或模塊的輸入輸出的連續(xù)變化等，比Quartus自帶的仿真器功能強(qiáng)大的多，是目前業(yè)界最通用的仿真器之一。 MoDELSim分幾種不同的版本：SE、PE和OEM，其中 集成在 Actel、Atmel、Altera、Xilinx以及Lattice等FPGA廠商設(shè)計(jì)工具中的均是其OEM版本。比如為Altera提供的OEM版本是MoDELSim-Altera,為Xilinx提供的版本為MoDELSim XE. SE版本為最高級(jí)版本,在功能和性能方面比OEM版本強(qiáng)很多,比如仿真速度方面,還支持PC 、 UNIX 、 LIUNX混合平臺(tái).

    標(biāo)簽： MoDELSim 教程

    上傳時(shí)間： 2013-05-25

    上傳用戶：zhangzhenyu

  • MoDELSim各版本破解軟件

    MoDELSim各版本下載方法（6.4~6.6e）以及破解方法（經(jīng)驗(yàn)證），我已經(jīng)成功破解MoDELSim6.6e,絕對(duì)可用。

    標(biāo)簽： MoDELSim 版本 破解軟件

    上傳時(shí)間： 2013-04-24

    上傳用戶：hn891122

  • FPGA設(shè)計(jì)全流程MoDELSim>>Synplify.Pro>>ISE

    詳細(xì)的說明了FPGA設(shè)計(jì)的整個(gè)流程\r\nFPGA設(shè)計(jì)全流程MoDELSim>>Synplify.Pro>>ISE

    標(biāo)簽： MoDELSim Synplify FPGA ISE

    上傳時(shí)間： 2013-08-09

    上傳用戶：hzakao

  • 介紹了FPGA設(shè)計(jì)全流程：MoDELSim>>Synplify.Pro>>ISE

    介紹了FPGA設(shè)計(jì)全流程：MoDELSim>>Synplify.Pro>>ISE

    標(biāo)簽： MoDELSim Synplify FPGA ISE

    上傳時(shí)間： 2013-08-15

    上傳用戶：稀世之寶039

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