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譯碼器的邏輯功能是將已賦予特定含義的一組二進制輸入代碼的原意"翻譯"出來,變成對應的輸出高低電平信號.該程序為3-8譯碼器.基于VHDL,其開發環境是
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一個初學者寫的時鐘程序
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2!!!!!!!!!!!!!!! 自動售貨機 vhdl
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CPLD/FPGA實用手冊
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高級FPGA教學實驗指導書-邏輯設計部分.pdf QuatusII5.0 是Altera 公司的最新產品。
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II 是一套非常成功的PLD 開發軟件
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本文為用vhdl語言編寫的38譯碼器
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本文為用vhdl語言編寫的2進制到10進制轉換的程序
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_環境下的頻率計設計及其完善
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3階FIR
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