使用Verilog HDL 實(shí)現(xiàn)AES硬體加解密
標(biāo)簽： Verilog HDL AES 加解密
上傳時(shí)間： 2016-08-25
上傳用戶：gdgzhym
基于分布式算法的FPGA實(shí)現(xiàn)的FIR濾波器源碼，VHDL語(yǔ)言編寫的，下載工程文件后可直接在QuartusII7.0上運(yùn)行。
標(biāo)簽： FPGA FIR 分布式算法 濾波器
上傳時(shí)間： 2014-01-03
上傳用戶：葉山豪
基于Xilinx XC3S500E的FPGA最小開發(fā)板制作的文章。
標(biāo)簽： Xilinx S500 500E FPGA
上傳時(shí)間： 2016-09-01
上傳用戶：13517191407
交通燈控制系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)，紅燈亮55s，黃燈亮5s，綠燈亮50s
標(biāo)簽： FPGA 交通燈控制系統(tǒng)
上傳時(shí)間： 2016-09-02
上傳用戶：王慶才
步進(jìn)電機(jī)位置控制系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)。
標(biāo)簽： FPGA 步進(jìn)電機(jī) 位置控制系統(tǒng)
上傳用戶：xhz1993
直流電動(dòng)機(jī)控制系統(tǒng)的FPGA的設(shè)計(jì)與實(shí)現(xiàn)。
標(biāo)簽： FPGA 直流電動(dòng)機(jī) 控制系統(tǒng)
上傳用戶：lijinchuan
CRC校驗(yàn)碼并行計(jì)算的FPGA實(shí)現(xiàn),PDF打開
標(biāo)簽： FPGA CRC 校驗(yàn)碼
上傳時(shí)間： 2016-09-03
上傳用戶：水中浮云
sopc sdram 硬核的verilog 源碼
標(biāo)簽： verilog sdram sopc 源碼
上傳時(shí)間： 2014-01-26
上傳用戶：shus521
大唐電信的FPGA設(shè)計(jì)經(jīng)驗(yàn)，內(nèi)部資料，詳細(xì)完整，很有參考價(jià)值
標(biāo)簽： FPGA 大唐電信 設(shè)計(jì)經(jīng)驗(yàn)
上傳時(shí)間： 2014-01-11
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不同特點(diǎn)的FPGA是從工藝的角度來(lái)理解的，主要可以分為基于SRAM的FPGA，基于FLASH的FPGA和基于反熔絲的FPGA
標(biāo)簽： FPGA 工藝 角度
上傳時(shí)間： 2013-12-17
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