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LCD1602 Verlog

用verlog語言編的一些基礎(chǔ)實驗,適合于FPGA/CPLD的初學(xué)者。內(nèi)容包括8位優(yōu)先編碼器

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spi協(xié)議的FPGA實現(xiàn)(Verlog).

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此程序為用VERLOG HDL編寫的一個完整的3位加法器。

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用verlog hdl開發(fā)的SPI 的源碼

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非常經(jīng)典的verlog hdl 語言學(xué)習(xí)教程及開發(fā)程序開發(fā)事例

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verlog hdl無刷電機(jī)控制程序,已在modelsim仿真

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verlog編程135例

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Verlog HDL 寫得一款32路方波發(fā)生器

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verlog語言的試驗上機(jī)

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這是當(dāng)初買FPGA板子附帶的verlog教程

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