uc/os-ii 2.52的源代碼中文註釋版本.PDF格式,最後還介紹了在BC4.5編譯環(huán)境下成功編譯了UC/OS-II系統(tǒng),是學(xué)習(xí)UC/OS-II一份不錯(cuò)的參考資料.
上傳時(shí)間： 2017-05-05
上傳用戶：GavinNeko
針對(duì)一級(jí)非線性倒力擺的模糊監(jiān)督控制應(yīng)用在系統(tǒng)含有不確定性
標(biāo)簽： 模糊 控制應(yīng)用 系統(tǒng)
上傳時(shí)間： 2013-12-23
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鍵盤位序更改程序請(qǐng)認(rèn)真閱讀您的文件包然后寫出其具體功能(至少要20個(gè)字)。盡量不要讓站長把時(shí)間都花費(fèi)在為您修正說明上。壓縮包解壓時(shí)不能有密碼。
上傳時(shí)間： 2017-08-09
上傳用戶：稀世之寶039
本書在高階技術(shù)(尤涉作業(yè)系統(tǒng)核心)方面居崇高位,不少名書也常推薦此書以補(bǔ)不足。本書基本以作業(yè)系統(tǒng)觀念為主，輔以範(fàn)例驗(yàn)證之。讀者群設(shè)定在具備32位元Windows程式經(jīng)驗(yàn)者。"Richter在實(shí)作技巧是位高手。諸君，試安裝本書所附光碟片你就知道了，我只能用華麗兩字來形容。"
上傳時(shí)間： 2014-01-25
上傳用戶：zjf3110
本書在高階技術(shù)(尤涉作業(yè)系統(tǒng)核心)方面居崇高位,不少名書也常推薦此書以補(bǔ)不足。本書基本以作業(yè)系統(tǒng)觀念為主，輔以範(fàn)例驗(yàn)證之。讀者群設(shè)定在具備32位元Windows程式經(jīng)驗(yàn)者。"Richter在實(shí)作技巧是位高手。諸君，試安裝本書所附光碟片你就知道了，我只能用華麗兩字來形容。"引自臺(tái)灣候杰先生語。
上傳時(shí)間： 2014-12-03
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上傳時(shí)間： 2016-03-04
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實(shí)習(xí)目的 本實(shí)驗(yàn)將練習(xí)如何運(yùn)用 DSP EVM 產(chǎn)生弦波。使學(xué)生能夠加深瞭解 TMS320C6701 EVM 發(fā)展系統(tǒng)的基本操作，及一些周邊的運(yùn)作。 藉由產(chǎn)生弦波的實(shí)驗(yàn)，學(xué)習(xí)如何使用硬體及軟體。在軟體部份，使 用 Code Composer Studio（CCS） ，包含 C 編輯器、連接器（linker）和 TI 所提供的C源始碼偵錯(cuò)器（debugger） 。在硬體部份包括TMS320C67 的 浮點(diǎn) DSP 和在 EVM 板子上的類比晶片。
上傳時(shí)間： 2016-05-05
上傳用戶：sclyutian
windows核心編程chm附源代碼 本書在高階技術(shù)(尤涉作業(yè)系統(tǒng)核心)方面居崇高位,不少名書也常推薦此書以補(bǔ)不足。本書基本以作業(yè)系統(tǒng)觀念為主，輔以範(fàn)例驗(yàn)證之。讀者群設(shè)定在具備32位元Windows程式經(jīng)驗(yàn)者。"Richter在實(shí)作技巧是位高手。諸君，試安裝本書所附光碟片你就知道了，我只能用華麗兩字來形容。"引自臺(tái)灣候杰先生語。
標(biāo)簽： windows chm 核心 系統(tǒng)
上傳時(shí)間： 2014-07-06
上傳用戶：水口鴻勝電器
本書在高階技術(shù)(尤涉作業(yè)系統(tǒng)核心)方面居崇高位,不少名書也常推薦此書以補(bǔ)不足。本書基本以作業(yè)系統(tǒng)觀念為主，輔以範(fàn)例驗(yàn)證之。讀者群設(shè)定在具備32位元Windows程式經(jīng)驗(yàn)者。
上傳時(shí)間： 2017-04-02
上傳用戶：xaijhqx
作為嵌入式系統(tǒng)核心的微處理器，是SOC不可或缺的“心臟”，微處理器的性能直接影響著整個(gè)SOC的性能。 與國際先進(jìn)技術(shù)相比，我國在這一領(lǐng)域的研究和開發(fā)工作還相當(dāng)落后，這直接影響到我國信息產(chǎn)業(yè)的發(fā)展。本著趕超國外先進(jìn)技術(shù)，填補(bǔ)我國在該領(lǐng)域的空白以擺脫受制于國外的目的，我國很多科研單位和公司進(jìn)行了自己的努力和嘗試。經(jīng)過幾年的探索，已經(jīng)有多種自主知識(shí)產(chǎn)權(quán)的處理器芯片完成了設(shè)計(jì)驗(yàn)證并逐漸進(jìn)入市場(chǎng)化階段。我國已結(jié)束無“芯”的歷史，并向設(shè)計(jì)出更高性能處理器的目標(biāo)邁進(jìn)。 艾科創(chuàng)新微電子公司的VEGA處理器，是公司憑借自己的技術(shù)力量和科研水平設(shè)計(jì)出的一款64位高性能RSIC微處理器。該處理器基于MIPSISA構(gòu)架，采用五級(jí)流水線的設(shè)計(jì)，并且使用了高性能處理器所廣泛采用的虛擬內(nèi)存管理技術(shù)。設(shè)計(jì)過程中采用自上而下的方法，根據(jù)其功能將其劃分為取指、譯碼、算術(shù)邏輯運(yùn)算、內(nèi)存管理、流水線控制和cache控制等幾個(gè)功能塊，使得我們?cè)谠O(shè)計(jì)中能夠按照其功能和時(shí)序要求進(jìn)行。 本文的首先介紹了MIPS微處理器的特點(diǎn)，通過對(duì)MIPS指令集和其五級(jí)流水線結(jié)構(gòu)的介紹使得對(duì)VEGA的設(shè)計(jì)有了一個(gè)直觀的認(rèn)識(shí)。在此基礎(chǔ)上提出了VEGA的結(jié)構(gòu)劃分以及主要模塊的功能。作為采用虛擬內(nèi)存管理技術(shù)的處理器，文章的主要部分介紹了VEGA的虛擬內(nèi)存管理技術(shù)，將VEGA的內(nèi)存管理單元(MMU)尤其是內(nèi)部兩個(gè)翻譯后援緩沖(TLB)的設(shè)計(jì)作為重點(diǎn)給出了流水線處理器設(shè)計(jì)的方法。結(jié)束總體設(shè)計(jì)并完成仿真后，并不能代表設(shè)計(jì)的正確性，它還需要我們?cè)趯?shí)際的硬件平臺(tái)上進(jìn)行驗(yàn)證。作為論文的又一重點(diǎn)內(nèi)容，介紹了我們?cè)赩EGA驗(yàn)證過程中使用到的FPGA的主要配置單元，F(xiàn)PGA的設(shè)計(jì)流程。VEGA的FPGA平臺(tái)是一完整的計(jì)算機(jī)系統(tǒng)，我們利用在線調(diào)試軟件XilinxChipscope對(duì)其進(jìn)行了在線調(diào)試，修正其錯(cuò)誤。 經(jīng)過模塊設(shè)計(jì)到最后的FPGA驗(yàn)證，VEGA完成了其邏輯設(shè)計(jì)，經(jīng)過綜合和布局布線等后端流程，VEGA采用0.18工藝流片后達(dá)到120MHz的工作頻率，可在其平臺(tái)上運(yùn)行Windows-CE和Linux嵌入式操作系統(tǒng)，達(dá)到了預(yù)計(jì)的設(shè)計(jì)要求。
標(biāo)簽： MIPS FPGA 微處理器 模塊設(shè)計(jì)
上傳時(shí)間： 2013-07-07
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