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IP核

IP核就是知識產權核或知識產權模塊的意思，在EDA技術開發中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產業的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。IP主要分為軟IP、固IP和硬IP。軟IP是用Verilog/VHDL等硬件描述語言描述的功能塊，但是并不涉及用什么具體電路元件實現這些功能。固IP是完成了綜合的功能塊。硬IP提供設計的最終階段產品——掩膜。[1]

這是一個I2C串行數據通信協議以VHDL硬件描述語言實現的IP核

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A率/u率壓縮與解壓縮的IP核

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DMA的控制器的IP核,和ATA控制器配合,可以實現DMA方式高速傳輸數據.

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關于FPGA的一些常識及含IP核的VHDL設計源代碼。

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VHDL中IP核之參數化觸發器中文使用介紹

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VHDL中IP核之參數化加減法器中文使用介紹

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完整的用VERILOG語言開發的USB2.0 IP核源代碼

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IP核生成器生成 ip 后有兩個文件對我們比較有用

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Xilinx FPGA 的IP核

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數字預失真在通信領域內IP核的開發文檔

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這是一個I2C串行數據通信協議以VHDL硬件描述語言實現的IP核

A率/u率壓縮與解壓縮的IP核

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