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IP核

IP核就是知識產權核或知識產權模塊的意思，在EDA技術開發中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產業的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。IP主要分為軟IP、固IP和硬IP。軟IP是用Verilog/VHDL等硬件描述語言描述的功能塊，但是并不涉及用什么具體電路元件實現這些功能。固IP是完成了綜合的功能塊。硬IP提供設計的最終階段產品——掩膜。[1]

IP核的FFTverilog源代碼

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主要是說明can總線協議使用fpga的IP核實現

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串行通訊IP核

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基于EDA技術的兼容MCS_51單片機IP核設計,供參考設計

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詳細描述了I2C的技術規范版本號為2.1 是采用VHDL編寫I2C的IP核的一本不錯的參考資料

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MP3 for XPLA3 XILINX.CPLD,必須在XILINX的FPGA芯片下使用,因為IP核是xilinx

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基于sopc的vga IP核設計參考文檔

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usb1.1 IP核

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實現fft的IP核

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VERILOG VERSION PIC16C57 是一個用于FPGA模擬PIC16C57的IP核

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IP核

IP核的FFTverilog源代碼

主要是說明can總線協議使用fpga的IP核實現

串行通訊IP核

基于EDA技術的兼容MCS_51單片機IP核設計,供參考設計

詳細描述了I2C的技術規范版本號為2.1 是采用VHDL編寫I2C的IP核的一本不錯的參考資料

MP3 for XPLA3 XILINX.CPLD,必須在XILINX的FPGA芯片下使用,因為IP核是xilinx

基于sopc的vga IP核設計參考文檔

usb1.1 IP核

實現fft的IP核

VERILOG VERSION PIC16C57 是一個用于FPGA模擬PIC16C57的IP核