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Free-FIFO

FIFO先入先出堆棧

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編了個8*8位的fifo數據緩沖器的vhdl源程序

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課程實驗,自己做的一個關于請求分布的程序, 采用先進先出算法(FIFO)和最近最久未使用算法(LRU)進行頁面的置換

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用verilog語言在fpga中實現fifo功能！

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異步FIFO控制器的設計主要用于異步先進先出控制器的設計。所用語言Verilog HDL.

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systemverilog編寫的fifo例子

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89S52上實現51單片機的串口FIFO功能。即串口的收和發均采用了FIFO作為緩沖。相信這個程序有助于單片機的新手編寫串口操作

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用HDL語言編寫的通用fifo源碼

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該文件是先入先出fifo的源代碼和測試文件

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·Free Chat beta release 2 fot linux,采用C語言寫的運行在linux下的聊天室程序

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