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  • ISO 7176-21 標準文件

    此為ISO 7176-21的標準,Requirements and test methods forelectromagnetic compatibility ofelectrically powered wheelchairs andscooters, and battery chargers

    標簽: iso

    上傳時間: 2021-12-17

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  • 設計符合 ISO 26262 的 PCB

    設計符合 ISO 26262 的 PCB,設計符合 ISO 26262 的 PCB

    標簽: iso pcb

    上傳時間: 2022-01-14

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  • 野火 ISO STM32 官方資料合集,程序、教程、原理圖等

    00-野火ISO 視頻教程-1-基礎入門篇.zip 00-野火ISO 視頻教程-2-項目提高篇.zip 01-野火ISO PDF教程.zip 02-野火ISO 程序 02-野火ISO 程序.zip 03-原理圖 04-數據手冊.zip 05-開發軟件.zip 06-配套書籍《STM32庫開發實戰指南》圖片.zip ISO_ISO-MINI對比.xlsx

    標簽: 圖像處理 圖像分析 機器視覺

    上傳時間: 2013-07-09

    上傳用戶:eeworm

  • ISO14443.rar

    ISO/IEC 14443 標準時每一個從事rfid 13.56Mhz開發工作的人員需要了解的關鍵技術。

    標簽: 14443 ISO

    上傳時間: 2013-07-02

    上傳用戶:shiny3333

  • 基于H264的視頻壓縮算法在DM642上的實現.rar

    H.264/AVC規范是由國際電聯(ITU-T)和國際標準化組織(ISO)聯合制定的新一代視頻編解碼標準。它具有如下四個特點:低碼流,和MPEG2等壓縮技術相比,在同等圖像質量下,采用H.264技術壓縮后的數據量只有MPEG2的1/8;高圖象質量,復雜的算法保證了低碼流條件下圖像仍能保留豐富的細節;容錯能力強,提供了解決在不穩定網絡環境下容易發生的丟包等錯誤的必要工具;網絡適應性強,提供了網絡適應層,數據能在不同網絡上傳輸。但由此帶來的代價是復雜度極高的編碼過程,尤其是在嵌入式系統中實現具有很大的挑戰性。 本文主要介紹了基于H.264標準的開源代碼T264向DM642平臺的移植和優化。優化綜合運用了上層和底層的實現方法實現。上層的方法例如使用CCS提供的條件優化代碼優化功能,使用IMGLIB中高度優化的函數等,其特點是簡便易行,效果良好;底層的實現方法例如使用DM642特有的內聯函數,用線性匯編的方式實現算法等,特點是提高了代碼運行的并行性,但需要對DM642和H.264有很深刻的理解。 目前本設計已成功完成H.264.算法在DM642開發板上的運行,壓縮QCIF格式視頻的速度隨圖像復雜度的不同達到了35-50幀每秒。此后本設計還繼續使用優化后的編碼器實現了監控用視頻服務器的原型,使得攝像頭采集的視頻數據在DM642開發板上壓縮后傳輸至PC機,且能夠在PC端用配套的程序成功解碼并播放。

    標簽: H264 642 DM

    上傳時間: 2013-06-23

    上傳用戶:qqiang2006

  • mpeg2編解碼(VC源碼).rar

    ISO-ICE-13818-MPEG-2-協議標準詳解-440頁

    標簽: mpeg2 編解碼 源碼

    上傳時間: 2013-08-03

    上傳用戶:michael52

  • JPEG編解碼的FPGA仿真研究.rar

    隨著圖像聲納技術的發展,對于大數據量圖像數據的壓縮成為必須要解決的一個課題。本文結合水聲圖像特點,應用VerilogHDL 語言在Quartus Ⅱ軟件環境下設計實現了JPEG基本模式編解碼器。 JPEG是國際標準化組織(ISO)和CCITT 聯合制定的靜態圖像的壓縮標準,是目前最常使用的圖像存儲格式。 論文首先介紹了JPEG編碼的基本原理,然后根據編碼的流程從總體結構上對JPEG編碼器進行了模塊劃分。對于2D—DCT變換采用了行列分離的快速算法;針對水聲圖像特點采用了DC系數直接編碼。以一幅真實的水聲圖像作為JPEG編碼器的測試輸入,對編碼器輸出的碼流經過軟件編程后正確顯示出了JPEG圖片,并分析了壓縮圖像效果和質量。 JPEG解碼器采用了和JPEG編碼器對稱的模塊劃分,2D—IDCT變換同樣采用了行列分離的快速算法;根據JPEG標準中哈夫曼編碼的特點,哈夫曼解碼采用了濃縮哈夫曼表法,降低了存儲資源,提高了解碼速度。對經本文設計的JPEG解碼器解碼后的圖片和原圖片進行了比較分析,結果表明本設計滿足要求。

    標簽: JPEG FPGA 編解碼

    上傳時間: 2013-05-25

    上傳用戶:sn2080395

  • 基于H.264編解碼的算法優化研究及FPGA的硬件實現.rar

    H.264/AVC是由ITU和ISO兩大組織聯合組成的JVT共同制定的一項新的視頻壓縮技術標準,在較低帶寬上提供高質量的圖像傳輸是H.264/AVC的應用亮點。在同樣的視覺質量前提下,H.264/AVC比H.263和MPEG-4節約了50%的碼率。但H.264獲得優越性能的代價是計算復雜度的增加,據估計其編碼的計算復雜度大約為H.263的3倍,因此很難應用于實時視頻處理領域。針對這一現狀,業內做了大量的研究工作,力圖降低其計算復雜度和提高運行效率。比如在運動估計方面,國內外在這方面的研究已經很成熟。而針對幀內/幀間預測編碼的研究卻較少。因此研究預測模式的快速算法具有理論意義和應用價值。 本文在詳細研究H.264標準視頻壓縮編碼特點基礎上,分析了H.264幀內編碼, 幀間編碼及變換,量化技術的原理及特點,提出了一種基于局部邊緣方向信息的快速幀內模式判決算法,通過結合SAD的模式選擇方法來減少模式選擇數目。它采用了Sobel梯度算子計算當前塊的邊緣信息,累加當前塊中屬于同一方向像素點的邊緣矢量構造不同模式下的邊緣方向直方圖,以便確定最可能的預測模式。該算法有效降低了編碼器的運算復雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸的質量。 另外在幀間預測模式選擇算法方面進行了改進研究:按順序對不同類型進行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數量的同時,結合小塊模式搜索中途停止準則來確定最優模式。仿真表明:改進算法相對與原來算法能夠節省很多的編碼時間(平均下降了49.3%),但帶來的圖像質星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時在整數DCT變換模塊中,提出了一種快速蝶形算法,使得對4×4點數據做一次變換,只需通過8×8次加法和2×8次移位運算便可完成,與原來12×8次加法和4×8次移位相比,新算法大大降低了運算復雜度。 最后介紹FPGA的特點及設計流程,并實現了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實現的H.264編碼視頻處理模塊設計具備了成本低,周期短,設計方法靈活等優點,具有廣闊的市場應用前景。 仿真表明,通過使用本文提出的幀內/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺上實現實時編碼。

    標簽: FPGA 264 編解碼

    上傳時間: 2013-07-18

    上傳用戶:zukfu

  • 基于ARM的915MHz射頻識別讀卡器研究

    射頻識別(RFID,Radio Frequency Identification)是一種利用電磁波雙向傳輸實現自動識別的技術。近年來,射頻識別技術在物流、交通、身份識別等生產生活領域的應用日益擴大。相比于13.56MHz射頻識別系統,915MHz射頻識別系統在識別距離,閱讀速度方面有更大的優勢,是目前射頻識別產品研究的熱點。 本文在理解ISO/IEC18000-6C協議的基礎上,首先研究用于本系統的基本理論,包括射頻識別技術和嵌入式技術,提出一款基于ISO/IEC18000-6C協議的915MHz射頻識別讀卡器的解決方案。在硬件部分,以Intel公司開發的R1000作為射頻收發模塊的核心;選用ATMEL公司的ARM處理器AT91SAM7S256作為控制單元的主控制器,在ARM處理器上運行μC/OS-II嵌入式實時操作系統,采用多任務實現和其他功能模塊的通信。軟件部分為系統移植了μC/OS-II操作系統,使用C與匯編語言的混合編程編寫Bootloader,編寫了各種硬件設備的驅動程序,使用C語言實現了串行通信程序,實現與上位機通信并實現對程序的更新。本文所設計的射頻識別系統具有模塊化設計、高可靠性等特點。實驗表明,這種設計方案能夠達到ISO/IEC18000-6C協議要求。

    標簽: ARM 915 MHz 射頻識別

    上傳時間: 2013-07-18

    上傳用戶:zklh8989

  • 基于ARM的高級數據鏈路控制規程研究

    高級數據鏈路控制規程,是由ISO開發,面向比特的數據鏈路層協議,具有差錯檢測功能強大、高效和同步傳輸的等特點,是通信領域中應用最廣泛的協議之一。隨著大規模電路的集成度和工藝水平不斷提高,ARM處理器上的高級數據鏈路控制器外設,幾乎涵蓋了HDLC規程常用的大部分子集。利用ARM芯片對HDLC通信過程進行控制,將具有成本低廉、靈活性好、便于擴展為操作系統下的應用程序等優點。本文在這一背景下,提出了在ARM下實現鏈路層傳輸的方案,在方案中實現了基于HDLC協議子集的簡單協議。 本文以嵌入式的高速發展為背景,對基于ARM核微處理器的鏈路層通信規程進行研究,闡述了HDLC幀的結構、特點和工作原理,提出了在ARM芯片上實現HDLC規程的兩種方法,同時給出其設計方案、關鍵代碼和調試方法。其中,重點對無操作系統時中斷模式下,以及基于操作系統時ARM芯片上實現HDLC規程的方法進行了探討設計。

    標簽: ARM 高級數據鏈路控制規程

    上傳時間: 2013-08-04

    上傳用戶:時代將軍

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