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FIFO

FirstInputFirstOutput的縮寫，先入先出隊列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進入的指令先完成并引退，跟著才執(zhí)行第二條指令。

Generic FIFO, writen in verilog hdl

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該文檔是有關利用XINLIX的FPGA如何實現(xiàn)FIFO的生成及如何應用的文章。

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FIFO 與 lru 算法的實現(xiàn) FIFO 與 lru 算法的實現(xiàn)

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FIFO的部分verilog代碼

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自己編譯和注解的2812的SCI的FIFO收發(fā)程序

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本文介紹了USB設備Bulk模式驅動程序的設計。該設計使用FIFO消息隊列、信號量機制和定時器中斷機制

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同步FIFO( Verilog HDL )

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操作系統(tǒng)實驗（LINUX）：設計一個虛擬存儲區(qū)和內存工作區(qū),并使用下列算法計算訪問命中率. （1）進先出的算法（FIFO）（2）最近最少使用的算法（LRU）（3）最佳淘汰算法(OP

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介紹異步FIFO結構的

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此項是針對設計異步FIFO的比較好的一個文檔

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