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DeepLearnToolbox-master

  • FPGA Ethercat master

    FPGA HArd Ethercat Master

    標簽: Ethercat master FPGA

    上傳時間: 2020-05-30

    上傳用戶:q8360428

  • magnify-master.zip

    magnify-master.zip

    標簽: magnify-master zip

    上傳時間: 2020-09-14

    上傳用戶:test012

  • ASIO2WASAPI-master源碼

    ASIO2WASAPI-master源碼

    標簽: ASIO2WASAPI-master 源碼

    上傳時間: 2021-10-19

    上傳用戶:nqwang

  • spi 通信的master部分使用的verilog語言實現

    spi 通信的master部分使用的verilog語言實現,可以做為你的設計參考。module spi_master(rstb,clk,mlb,start,tdat,cdiv,din, ss,sck,dout,done,rdata);    input rstb,clk,mlb,start;    input [7:0] tdat;  //transmit data    input [1:0] cdiv;  //clock divider input din; output reg ss;  output reg sck;  output reg dout;     output reg done; output reg [7:0] rdata; //received dataparameter idle=2'b00; parameter send=2'b10; parameter finish=2'b11; reg [1:0] cur,nxt; reg [7:0] treg,rreg; reg [3:0] nbit; reg [4:0] mid,cnt; reg shift,clr;

    標簽: spi 通信 master verilog

    上傳時間: 2022-02-03

    上傳用戶:

  • 完整的經過驗證的IIC MASTER(verilog )

    完整的經過驗證的IIC MASTER(verilog ),完整的經過驗證的IIC MASTER(verilog )

    標簽: iic verilog

    上傳時間: 2022-05-18

    上傳用戶:

  • Chrome-Setup-Lifetime-Free-3.7.0-master

    Chrome-Setup-Lifetime-Free-3.7.0-master.zip

    標簽: chrome

    上傳時間: 2022-06-26

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  • 電動汽車TTCAN總線技術研究.rar

    TTCAN協議在CAN協議基礎之上,將事件觸發機制與實時性更高的時間觸發機制相結合,提高了網絡實時性,滿足對安全性要求苛刻的實時系統以及總線日益增長的信息負載的需求;同時,CAN總線技術的基礎為TTCAN總線技術研究奠定了很好的軟硬件支持條件。 論文首先介紹了TTCAN協議的通訊原理、軟硬件環境的建立和總線網絡性能的測試方法。 按照ISO11898-4標準的要求,在自主研發的CAN總線實時仿真系統上結合軟件編程能夠實現TTCAN協議的時間觸發通訊功能,使整個系統成為具有時間觸發功能的TTCAN總線通訊網絡,得到網絡要采用TTCAN協議通訊時各ECU必須具備穩定可靠的本地時鐘和相應的時鐘同步和計數機制的結論。 結合混合動力電動汽車動力系統對采用TTCAN協議通訊時的網絡性能進行了測試和分析,結果表明,TTCAN網絡中周期型消息的實時性不受網絡中其他消息的影響,時間觸發通訊方式和系統矩陣的調度安排在一定程度上減少了總線上消息間的沖突,提高了網絡實時性和總線帶寬利用率。 對比分析同等條件下TTCAN總線網絡和CAN總線網絡的性能,TTCAN協議能夠保證網絡總線在高峰值負載的情況下網絡的實時性。 研究了對TTCAN總線網絡中time master(時間主節點)和reference message(參考消息)進行故障診斷和容錯的方法,通過實驗驗證了采用冗余的方式能夠保證當前時間意義上的主節點和參考消息故障情況下整個網絡的性能不受影響,提高故障情況下網絡的可靠性。

    標簽: TTCAN 電動汽車 總線

    上傳時間: 2013-04-24

    上傳用戶:refent

  • serial_COM

    串口通訊大師源代碼,相互學習嘛,蠻不錯的rs232調試程序-Serial communication master source code and learn from each other do

    標簽: serial_COM

    上傳時間: 2013-07-06

    上傳用戶:zhangjt

  • 74LS73.pdf

    英文描述: Dual Negative-Edge-Triggered Master-Slave J-K Flip-Flops with Clear and Complementary Outputs 中文描述: 雙下降沿觸發主從JK觸發器明確和互補輸出

    標簽: 74 73 LS

    上傳時間: 2013-04-24

    上傳用戶:黃華強

  • mcu與cpld之間spi接口程序

    mcu與cpld之間spi接口程序,mcu為master,cpld用verilog寫成slave模塊

    標簽: cpld mcu spi 接口程序

    上傳時間: 2013-08-14

    上傳用戶:1039312764

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