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這是一個信號發生器，相信對經常從事測試信號處理的人士來說應該不陌生，該信號發生器采用先進的DSPBUILDER進行建模，既簡潔又實用。
標簽： 信號發生器
上傳時間： 2014-08-31
上傳用戶：gxf2016
在信息信號處理過程中，如對信號的過濾、檢測、預測等，都要使用濾波器，數字濾波器是數字信號處理（DSP，DigitalSignalProcessing）中使用最廣泛的一種器件。常用的濾波器有無限長單位脈沖響應（ⅡR）濾波器和有限長單位脈沖響應（FIR）濾波器兩種[1]，其中，FIR濾波器能提供理想的線性相位響應，在整個頻帶上獲得常數群時延從而得到零失真輸出信號，同時它可以采用十分簡單的算法實現，這兩個優點使FIR濾波器成為明智的設計工程師的首選，在采用VHDL或verilogHDL等硬件描述語言設計數字濾波器時，由于程序的編寫往往不能達到良好優化而使濾波器性能表現一般。而采用調試好的IPCore需要向Altera公司購買。筆者采用了一種基于DSPBUILDER的FPGA設計方法，使FIR濾波器設計較為簡單易行，并能滿足設計要求
標簽： 信號處理 過程
上傳時間： 2016-04-15
上傳用戶：gut1234567
借助于altera公司的IP核，在FPGA中使用DSPBUILDER實現32位低通FIR濾波器功能，
標簽： altera IP核
上傳時間： 2017-02-12
上傳用戶：xiaodu1124
matlab下，用DSPBUILDER實現dds模塊產生正弦波的源碼
標簽： matlab
上傳時間： 2017-07-17
上傳用戶：李夢晗
摘要：論述了利用FPGA的系統級設計工具DSP Builder開發DDS函數發生器的總體設計思路，討論了改變輸出信號頻率、幅度、相位的設計方法。系統基于Ahera公司的Cyclone系列FPGA，配合Silicon Labs公司高性能C8051F340單片機實現，給出了系統的軟件仿真結果并完成了整個系統的硬件驗證。結果證明了設計的正確性，同時表明采用DSPBUILDER使DDS任意函數發生器的FPGA硬件實現更加簡單，速度更快。
標簽： fpga dds 函數發生器
上傳時間： 2022-07-11
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