本文對基于FPGA的CCSDS圖像壓縮和AES加密算法的實現(xiàn)進(jìn)行了研究。主要完成的工作有： (1)深入研究CCSDS圖像壓縮算法，并根據(jù)其編碼方案，設(shè)計并實現(xiàn)了相應(yīng)的編解碼器。從算法性能和硬件實現(xiàn)復(fù)雜度兩個方面，將該算法與具有類似算法結(jié)構(gòu)的JPEG2000和SPIHT圖像壓縮算法作比較分析； (2)利用硬件描述語言VerilogHDL實現(xiàn)CCSDS圖像壓縮算法和AES加密算法； (3)優(yōu)化算法復(fù)雜度較大的功能模塊，如小波變換模塊等。使用雙端口內(nèi)存模塊增加數(shù)據(jù)讀寫速度，利用DSP塊處理核心運算單元，從而很大程度上提高了模塊的運行速度，并降低了芯片的使用面積； (4)設(shè)計并實現(xiàn)系統(tǒng)的模塊級流水線，在幾乎不增加占用芯片面積的情況下，提高了系統(tǒng)的數(shù)據(jù)吞吐量； (5)在QuartusⅡ和ModelSim仿真環(huán)境下對該系統(tǒng)進(jìn)行模塊級和系統(tǒng)級的功能仿真、時序仿真和驗證。在硬件系統(tǒng)測試階段，設(shè)計并實現(xiàn)FPGA與PC機(jī)的串口通信模塊，提高了系統(tǒng)驗證的工作效率。
上傳時間： 2013-05-19
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在VTS(Vessel Tramc Services船舶交管系統(tǒng))系統(tǒng)中，雷達(dá)信號的處理器的能力己成為制約雷達(dá)目標(biāo)錄取、跟蹤處理能力和可靠性以及整個VTS系統(tǒng)工作的主要因素。隨著區(qū)域性VTS的建立，要求將雷達(dá)信號以最高的質(zhì)量和最低的代價遠(yuǎn)距離傳輸，而達(dá)到這一要求的關(guān)鍵技術(shù)環(huán)節(jié)一雷達(dá)信息的壓縮處理也將受到雷達(dá)信號預(yù)處理系統(tǒng)的影響。 因此，研究更有效的VTS雷達(dá)信號預(yù)處理系統(tǒng)是一項很有價值和實際意義的工作。本文是在前人研究成果的基礎(chǔ)上，面向?qū)嶋H應(yīng)用的需求，主要研究VTS雷達(dá)信號預(yù)處理算法的設(shè)計方法和實現(xiàn)手段，設(shè)計完成了一個數(shù)字化的雷達(dá)原始信號實時采集與處理系統(tǒng)。 本設(shè)計主要包括雷達(dá)信號的采集、雜波抑制處理以及與DSP芯片的信號傳輸。在硬件結(jié)構(gòu)上，本設(shè)計采用FPGA完成信號的采集、CFAR處理和雷達(dá)信號檢測器的設(shè)計，將大量的以前需要由DSP芯片來完成的算法移植到FPGA中實現(xiàn)，大大減輕了DSP芯片的工作壓力，也減小了系統(tǒng)的體積。 在算法研究中，設(shè)計中重點討論了雜波的抑制方法和目標(biāo)的檢測方法。本文在研究了大量現(xiàn)有的雷達(dá)信號雜波抑制及信號檢測的算法的基礎(chǔ)上，比較了各種算法的優(yōu)劣，最終選擇了一種適合本次設(shè)計要求的CFAR算法和雙極點濾波雷達(dá)信號檢測器在FPGA中實現(xiàn)。 論文中對設(shè)計中所采用的方法給出了理論分析、試驗仿真結(jié)果和試驗實際調(diào)試結(jié)果。通過本文所述的設(shè)計和實驗，本文設(shè)計的雷達(dá)信號預(yù)處理系統(tǒng)對雷達(dá)視頻信號的采集與傳輸都有很好的效果，所選用的雜波處理算法對雷達(dá)雜波、雨雪雜波和陸地回波都具有較好的抑制作用，能有效地處理雷達(dá)雜波中的尖峰成分，使信噪比得到較大改善。
標(biāo)簽： 雷達(dá)信號 法的研究 預(yù)處理
上傳時間： 2013-04-24
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軟件無線電技術(shù)自20世紀(jì)90年代提出以后，在許多通信系統(tǒng)中得到了廣泛應(yīng)用。本文研究了一種軟件無線電數(shù)字通信系統(tǒng)方案的設(shè)計，并著重研究了其中中頻處理單元的設(shè)計和實現(xiàn)。針對實際應(yīng)用，本文提出了一個基于FPGA和DSP的軟件無線電中頻/基帶數(shù)字化處理系統(tǒng)的設(shè)計方案。該系統(tǒng)的特點是所有的中頻信號處理算法全部由軟件實現(xiàn)，它主要包括高速A/D、超大規(guī)模FPGA芯片、高速DSP芯片和外部存儲器等，其中超大規(guī)模FPGA芯片和高速的DSP芯片是系統(tǒng)的核心。DSP芯片采用的是TI公司的C6416，F(xiàn)PGA芯片采用的是Xilinx公司的XC2V2000FG676，既兼顧速度和靈活性，又具有較強(qiáng)的通用性。 本文根據(jù)“基于FPGA的中頻數(shù)字化處理平臺的建立及若干關(guān)鍵算法的實現(xiàn)”研究課題，主要完成了軟件無線電通信系統(tǒng)中頻數(shù)字化若干關(guān)鍵算法實現(xiàn)的任務(wù)，具體包括通用數(shù)字中頻板的設(shè)計、中頻板上FPGA和DSP、D/A的接口設(shè)計、各種數(shù)字通信關(guān)鍵技術(shù)（數(shù)字上/下變頻、調(diào)制解調(diào)、信道編譯碼、交織解交織等）的FPGA實現(xiàn)。本文研究的系統(tǒng)分別在Matlab、ISE、Modelsim、Visual DSP++、ChipScope Pro等軟件中進(jìn)行了仿真和驗證，并已交付使用。結(jié)果表明，本文提出的方案正確可行，達(dá)到了預(yù)定要求。本文的工作對其它軟件無線電系統(tǒng)的實現(xiàn)也具有較大的參考價值。
標(biāo)簽： FPGA 中頻數(shù)字化 關(guān)鍵算法
上傳時間： 2013-04-24
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人郵出版社，DSP應(yīng)用開發(fā)實用子程序，汪安民程昱編著。本書從工程應(yīng)用的角度出發(fā)，介紹了數(shù)字信號處理算法在DSP上的實現(xiàn)，內(nèi)容涉及數(shù)學(xué)運算、DSP硬件接口程序、經(jīng)典數(shù)字信號處理算法和現(xiàn)代數(shù)字信號處理算法，以及DSP在語音、圖像、控制和無線通信中的應(yīng)用。
標(biāo)簽： DSP 86 應(yīng)用開發(fā) 程序
上傳時間： 2013-06-03
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人郵出版社，DSP應(yīng)用開發(fā)實用子程序，汪安民程昱編著。本書從工程應(yīng)用的角度出發(fā)，介紹了數(shù)字信號處理算法在DSP上的實現(xiàn)，內(nèi)容涉及數(shù)學(xué)運算、DSP硬件接口程序、經(jīng)典數(shù)字信號處理算法和現(xiàn)代數(shù)字信號處理算法，以及DSP在語音、圖像、控制和無線通信中的應(yīng)用。
標(biāo)簽： DSP 162 87 應(yīng)用開發(fā)
上傳時間： 2013-08-05
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人郵出版社，DSP應(yīng)用開發(fā)實用子程序，汪安民程昱編著。本書從工程應(yīng)用的角度出發(fā)，介紹了數(shù)字信號處理算法在DSP上的實現(xiàn)，內(nèi)容涉及數(shù)學(xué)運算、DSP硬件接口程序、經(jīng)典數(shù)字信號處理算法和現(xiàn)代數(shù)字信號處理算法，以及DSP在語音、圖像、控制和無線通信中的應(yīng)用。
標(biāo)簽： DSP 163 259 應(yīng)用開發(fā)
上傳時間： 2013-07-30
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人郵出版社，DSP應(yīng)用開發(fā)實用子程序，汪安民程昱編著。本書從工程應(yīng)用的角度出發(fā)，介紹了數(shù)字信號處理算法在DSP上的實現(xiàn)，內(nèi)容涉及數(shù)學(xué)運算、DSP硬件接口程序、經(jīng)典數(shù)字信號處理算法和現(xiàn)代數(shù)字信號處理算法，以及DSP在語音、圖像、控制和無線通信中的應(yīng)用。
標(biāo)簽： DSP 260 324 應(yīng)用開發(fā)
上傳時間： 2013-04-24
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人郵出版社，DSP應(yīng)用開發(fā)實用子程序，汪安民程昱編著。本書從工程應(yīng)用的角度出發(fā)，介紹了數(shù)字信號處理算法在DSP上的實現(xiàn)，內(nèi)容涉及數(shù)學(xué)運算、DSP硬件接口程序、經(jīng)典數(shù)字信號處理算法和現(xiàn)代數(shù)字信號處理算法，以及DSP在語音、圖像、控制和無線通信中的應(yīng)用。
標(biāo)簽： DSP 325 389 應(yīng)用開發(fā)
上傳時間： 2013-07-15
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人郵出版社，DSP應(yīng)用開發(fā)實用子程序，汪安民程昱編著。本書從工程應(yīng)用的角度出發(fā)，介紹了數(shù)字信號處理算法在DSP上的實現(xiàn)，內(nèi)容涉及數(shù)學(xué)運算、DSP硬件接口程序、經(jīng)典數(shù)字信號處理算法和現(xiàn)代數(shù)字信號處理算法，以及DSP在語音、圖像、控制和無線通信中的應(yīng)用。
標(biāo)簽： DSP 390 422 應(yīng)用開發(fā)
上傳時間： 2013-04-24
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· 摘要： 為了實現(xiàn)視頻圖像的實時處理,采用基于DSP+FPGA的線性流水陣列結(jié)構(gòu),用現(xiàn)場可編程門陣列FPGA對采集的視頻數(shù)字圖像做預(yù)處理,并結(jié)合大規(guī)模可編程邏輯陣列CPLD進(jìn)行邏輯控制,實現(xiàn)了視頻圖像的采集和目標(biāo)提取的視頻數(shù)字圖像處理系統(tǒng).介紹了該視頻圖像處理系統(tǒng)的硬件組成、工作原理和各種視頻跟蹤算法的應(yīng)用.該系統(tǒng)與計算機(jī)聯(lián)結(jié),配以適當(dāng)?shù)膱D像處理軟件和開發(fā)系統(tǒng),即可形成一個通
標(biāo)簽： FPGA DSP 圖像處理 系統(tǒng)設(shè)計
上傳時間： 2013-06-17
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