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DDS
DDS
信號發(fā)生器采用直接數(shù)字頻率合成(DirectDigitalSynthesis,簡稱
DDS
)技術(shù),把信號發(fā)生器的頻率穩(wěn)定度、準確度提高到與基準頻率相同的水平,并且可以在很寬的頻率范圍內(nèi)進行精細的頻率調(diào)節(jié)。采用這種方法設(shè)計的信號源可工作于調(diào)制狀態(tài),可對輸出電平進行調(diào)節(jié),也可輸出各種波形。
基于FPGA的
DDS
信號源的設(shè)計
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基于FPGA的
DDS
雙通道波形發(fā)生器
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基于
DDS
技術(shù)的智能信號發(fā)生器的設(shè)計
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DDS
短波信號發(fā)生器
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CPLD實現(xiàn)
DDS
信號源的設(shè)計
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本文介紹了如何用VHDL進行
DDS
的設(shè)計
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采用vhdl語言實現(xiàn)正弦波形的生成,主要使用的
DDS
技術(shù)
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能完全模擬
DDS
芯片的工作
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利用FPGA實現(xiàn)
DDS
經(jīng)過編譯沒有錯誤。編譯環(huán)境為QuartusII7.2
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利用FPGA實現(xiàn)的
DDS
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