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基于FPGA的視頻圖像分析.rar
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基于FPGA的DDS波形信號發(fā)生器的設(shè)計
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SOPC實驗--Hello World實驗:啟動Quartus II軟件
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通過IIC總線讀寫實時時鐘DS1307
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這是我用Verilog寫的DES加解密程序,準確的說這是一份實驗報告,里面不但有程序還有簡單的注釋[主要是針對仿真的波形的],我主要寫的是主控部分,密鑰生成部分參考了下版原康宏的程序.該程序即可加密也
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這個文件包含了我前一段寫的關(guān)于3~8電梯控制的4-5個程序!并且附有比較詳細的注釋.準確說這是一份課程設(shè)計報告.在最終版本的程序中對于FLEX10K系列器件只占用141個邏輯單元,頻率可達60多Mhz
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