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CPLD

CPLD采用CMOSEPROM、EEPROM、快閃存儲器和SRAM等編程技術(shù)，從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線

基于FPGA CPLD設(shè)計(jì)與實(shí)現(xiàn)UART

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FPGA&CPLD數(shù)字電路設(shè)計(jì) 數(shù)字濾波電路設(shè)計(jì)

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FPGA/CPLD的實(shí)體教程

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CPLD原始代碼程序

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這個(gè)文檔介紹了目前絕大部分的FPGA/CPLD設(shè)計(jì)軟件

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5分鐘學(xué)會CPLD 是CPLD/fpga入門的好材料

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FPGA/CPLD數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)分享

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基于AU1200的CPLD的wince下的驅(qū)動

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TMS320C6X EVM板CPLD-PCI接口控制部分TMS320C6X EVM板CPLD-PCI接口控制部分

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以CPLD 芯片進(jìn)行十字路口的交通燈的設(shè)計(jì)

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