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AVALON-fortress-container

  • 實(shí)現(xiàn)基于Avalon總線架構(gòu)的I2C控制器!可實(shí)現(xiàn)OV7620等數(shù)字?jǐn)z像頭的配置功能!

    實(shí)現(xiàn)基于Avalon總線架構(gòu)的I2C控制器!可實(shí)現(xiàn)OV7620等數(shù)字?jǐn)z像頭的配置功能!

    標(biāo)簽: Avalon 7620 I2C OV

    上傳時(shí)間: 2017-09-13

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  • 基于Avalon-ST接口幀讀取IP核的研究應(yīng)用

    基于Avalon-ST接口幀讀取IP核的研究應(yīng)用

    標(biāo)簽: FPGA

    上傳時(shí)間: 2016-04-08

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  • 基于FPGA的圖像采集處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn).rar

    隨著當(dāng)今科學(xué)技術(shù)的迅猛發(fā)展,數(shù)字圖像處理技術(shù)正在各個(gè)行業(yè)得到廣泛的應(yīng)用,而FPGA技術(shù)的不斷成熟改變了通常采用并行計(jì)算機(jī)或數(shù)字信號(hào)處理器(DSP)、專用集成電路(ASIC)等作為嵌入式處理器的慣例??删幊踢壿嬈骷?FPGA)憑借其較低的開(kāi)發(fā)成本、較高的并行處理速度、較大的靈活性及其較短的開(kāi)發(fā)周期等特點(diǎn),在圖像處理系統(tǒng)中有獨(dú)特的優(yōu)勢(shì)。 本文提出了一種基于FPGA的圖像采集處理系統(tǒng)解決方案,并選用低成本高性能的Altera公司的CycloneIII系列FPGA EP3C40F324為核心,設(shè)計(jì)開(kāi)發(fā)了圖像采集處理的軟硬件綜合系統(tǒng)。文章闡述了如何在FPGA中嵌入NiosII軟核處理器并完成圖像采集處理系統(tǒng)功能的設(shè)計(jì)方案。硬件電路上,系統(tǒng)設(shè)計(jì)了三塊電路板:FPGA核心處理板、圖像采集卡、圖像顯示卡,其中通過(guò)I2C總線對(duì)采集卡的工作模式進(jìn)行配置,在采集模塊控制下,將采集到的圖像數(shù)據(jù)存儲(chǔ)到SDRAM;根據(jù)VGA顯示原理及其時(shí)序關(guān)系,設(shè)計(jì)了VGA顯示輸出控制模塊,合成了VGA工作的控制信號(hào),又根據(jù)VGA顯示器的工業(yè)標(biāo)準(zhǔn),合成VGA接口的水平和幀同步信號(hào)。邏輯硬件上,應(yīng)用SOPCBuilder工具生成了FPGA內(nèi)部的邏輯硬件功能模塊,定制了NiosII IP core、CMOS圖像采集模塊、VGA Controller及其I2C總線接口,系統(tǒng)各模塊間通過(guò)Avalon總線連接起來(lái)。軟件部分,在NiosII內(nèi)核處理器上實(shí)現(xiàn)了彩色圖像顏色空間轉(zhuǎn)換、二值化、形態(tài)學(xué)腐蝕處理及其目標(biāo)定位等算法。實(shí)驗(yàn)結(jié)果證明了本文提出的方案及算法的正確性,可行性。

    標(biāo)簽: FPGA 圖像采集 處理系統(tǒng)

    上傳時(shí)間: 2013-08-05

    上傳用戶:woshiyaosi

  • 基于FPGA語(yǔ)音識(shí)別系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn).rar

    近年來(lái),語(yǔ)音識(shí)別研究大部分集中在算法設(shè)計(jì)和改進(jìn)等方面,而隨著半導(dǎo)體技術(shù)的高速發(fā)展,集成電路規(guī)模的不斷增大與各種研發(fā)技術(shù)水平的不斷提高,新的硬件平臺(tái)的推出,語(yǔ)音識(shí)別實(shí)現(xiàn)平臺(tái)有了更多的選擇。語(yǔ)音識(shí)別技術(shù)在與DSP、FPGA、ASIC等器件為平臺(tái)的嵌入式系統(tǒng)結(jié)合后,逐漸向?qū)嵱没⑿⌒突较虬l(fā)展。 本課題通過(guò)對(duì)現(xiàn)有各種語(yǔ)音特征參數(shù)與孤立詞語(yǔ)音識(shí)別模型進(jìn)行研究的基礎(chǔ)上,重點(diǎn)探索基于動(dòng)態(tài)時(shí)間規(guī)整算法的DTW模型在孤立詞語(yǔ)音識(shí)別領(lǐng)域的應(yīng)用,并結(jié)合基于FPGA的SOPC系統(tǒng),在嵌入式平臺(tái)上實(shí)現(xiàn)具有較好精度與速度的孤立詞語(yǔ)音識(shí)別系統(tǒng)。 本系統(tǒng)整體設(shè)計(jì)基于DE2開(kāi)發(fā)平臺(tái),采用基于Nios II的SOPC技術(shù)。采用這種解決方案的優(yōu)點(diǎn)是實(shí)現(xiàn)了片上系統(tǒng),減少了系統(tǒng)的物理體積和總體功耗;同時(shí)系統(tǒng)控制核心都在FPGA內(nèi)部實(shí)現(xiàn),可以極為方便地更新和升級(jí)系統(tǒng),大大地提高了系統(tǒng)的通用性和可維護(hù)性。 此外,由于本系統(tǒng)需要大量的高速數(shù)據(jù)運(yùn)算,在設(shè)計(jì)中作者充分利用了Cyclone II芯片的豐富的硬件乘法器,實(shí)現(xiàn)了語(yǔ)音信號(hào)的端點(diǎn)檢測(cè)模塊,F(xiàn)FT快速傅立葉變換模塊,DCT離散余弦變換模塊等硬件設(shè)計(jì)模塊。為了提高系統(tǒng)的整體性能,作者充分利用了FPGA的高速并行的優(yōu)勢(shì),以及配套開(kāi)發(fā)環(huán)境中的Avalon總線自定義硬件外設(shè),使系統(tǒng)處理數(shù)字信號(hào)的能力大大提高,其性能優(yōu)于傳統(tǒng)的微控制器和普通DSP芯片。 本論文主要包含了以下幾個(gè)方面: (1)結(jié)合ALTERA CYCLONE II芯片的特點(diǎn),確定了基于FPGA語(yǔ)音識(shí)別系統(tǒng)的總體設(shè)計(jì),在此基礎(chǔ)上進(jìn)行了系統(tǒng)的軟硬件的選擇和設(shè)計(jì)。 (2)自主設(shè)計(jì)了純硬件描述語(yǔ)言的驅(qū)動(dòng)電路設(shè)計(jì),完成了高速語(yǔ)音采集的工作,并且對(duì)存儲(chǔ)數(shù)據(jù)芯片SRAM中的原始語(yǔ)音數(shù)據(jù)進(jìn)行提取導(dǎo)入MATLAB平臺(tái)測(cè)試數(shù)據(jù)的正確性。整個(gè)程序測(cè)試的方式對(duì)系統(tǒng)的模塊測(cè)試起到重要的作用。 (3)完成高速定點(diǎn)256點(diǎn)的FFT模塊的設(shè)計(jì),此模塊是系統(tǒng)成敗的關(guān)鍵,實(shí)現(xiàn)高速實(shí)時(shí)的運(yùn)算。 (4)結(jié)合SOPC的特性,設(shè)計(jì)了人機(jī)友好接口,如LCD顯示屏的提示反饋信息等等,以及利用ALTERA提供的一些驅(qū)動(dòng)接口設(shè)計(jì)完成用戶定制的系統(tǒng)。 (5)進(jìn)行了整體系統(tǒng)測(cè)試,系統(tǒng)可以較穩(wěn)定地實(shí)現(xiàn)實(shí)時(shí)處理的目的,具有一定的市場(chǎng)潛在價(jià)值。

    標(biāo)簽: FPGA 語(yǔ)音識(shí)別 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-05-23

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  • 電磁無(wú)損檢測(cè)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    近年來(lái),在鋼鐵材質(zhì)質(zhì)量檢測(cè)的研究領(lǐng)域,電磁無(wú)損檢測(cè)方法以其非破壞性和簡(jiǎn)便快速的優(yōu)點(diǎn)取得了大量成果,然而對(duì)于鋼材及其制品的混料、硬度和裂紋質(zhì)量檢測(cè)還存在許多難題.如用傳統(tǒng)檢測(cè)平臺(tái)檢測(cè)鋼鐵件硬度的檢測(cè)精度和速度都不夠理想。 基于上述情況,論文將先進(jìn)的SOPC技術(shù)應(yīng)用到鋼鐵件的電磁無(wú)損檢測(cè)中。SOPC技術(shù)將處理器、存儲(chǔ)器、IO接口、各種外圍設(shè)備等系統(tǒng)設(shè)計(jì)需要的部件集成到一個(gè)可編程邏輯器件上,構(gòu)建成一個(gè)可編程的片上系統(tǒng)。 論文詳細(xì)論述了基于FPGA的電磁無(wú)損檢測(cè)試驗(yàn)裝置的理論基礎(chǔ),并在此基礎(chǔ)上給出了總體設(shè)計(jì)方案。全文著重?cái)⑹隽讼到y(tǒng)的模擬部分,系統(tǒng)配置以及軟件部分的整個(gè)設(shè)計(jì)過(guò)程。利用QuartusⅡ自定義外設(shè)和Avalon總線多主并行處理的特點(diǎn),采用Vefilog HDL,語(yǔ)言實(shí)現(xiàn)激勵(lì)信號(hào)發(fā)生器和高速數(shù)據(jù)采集器,使得信號(hào)激勵(lì)和信號(hào)采集在同一片芯片中實(shí)現(xiàn),從而提高了信號(hào)及信號(hào)處理的精確度。由于電磁檢測(cè)對(duì)多種參數(shù)的敏感反應(yīng),必須抑制由此引入的多種因素的干擾,利用FIR數(shù)字濾波和相關(guān)方法從眾多的干擾信號(hào)中提取出有效信號(hào)的幅度和相位,同時(shí)利用NiosⅡC2H功能對(duì)濾波模塊進(jìn)行硬件加速處理,大大提高了信號(hào)處理的速度。利用最小二乘法建立回歸方程模型進(jìn)行無(wú)損檢測(cè)。最后運(yùn)用此電磁無(wú)損檢測(cè)系統(tǒng)對(duì)軸承鋼的硬度進(jìn)行了定性測(cè)試,取得了較好的檢測(cè)結(jié)果。 試驗(yàn)結(jié)果表明,將SOPC技術(shù)應(yīng)用到電磁無(wú)損檢測(cè)系統(tǒng)中,系統(tǒng)的檢測(cè)速度和檢測(cè)精度都有所提高,并使得整個(gè)系統(tǒng)在規(guī)模、可靠性、性能指標(biāo)、開(kāi)發(fā)成本、產(chǎn)品維護(hù)及硬件升級(jí)等多方面實(shí)現(xiàn)了優(yōu)化。

    標(biāo)簽: 電磁 無(wú)損檢測(cè)

    上傳時(shí)間: 2013-06-04

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  • 基于FPGA的JPEG實(shí)時(shí)圖像編解碼系統(tǒng)

    JPEG是聯(lián)合圖像專家組(Joint Picture Expert Group)的英文縮寫(xiě),是國(guó)際標(biāo)準(zhǔn)化組織(ISO)和CCITT聯(lián)合制定的靜態(tài)圖像壓縮編碼標(biāo)準(zhǔn)。JPEG的基于DCT變換有損壓縮具有高壓縮比特點(diǎn),被廣泛應(yīng)用在數(shù)據(jù)量極大的多媒體以及帶寬資源寶貴的網(wǎng)絡(luò)程序中。 動(dòng)態(tài)圖像的JPEG編解碼處理要求圖像恢復(fù)質(zhì)量高、實(shí)時(shí)性強(qiáng),本課題就是針對(duì)這兩個(gè)方面的要求展開(kāi)的研究。該系統(tǒng)由圖像編碼服務(wù)器端和圖像解碼客戶端組成。其中,服務(wù)器端實(shí)時(shí)采集攝像頭傳送的動(dòng)態(tài)圖像,進(jìn)行JPEG編碼,通過(guò)網(wǎng)絡(luò)傳送碼流到客戶端;客戶端接收碼流,經(jīng)過(guò)JPEG解碼,恢復(fù)出原始圖像送VGA顯示。設(shè)計(jì)結(jié)果完全達(dá)到了實(shí)時(shí)性的要求。 本文從系統(tǒng)實(shí)現(xiàn)的角度出發(fā),首先分析了系統(tǒng)開(kāi)發(fā)平臺(tái),介紹FPGA的結(jié)構(gòu)特點(diǎn)以及它的設(shè)計(jì)流程和指導(dǎo)原則;然后從JPEG圖像壓縮技術(shù)發(fā)展的歷程出發(fā),分析JPEG標(biāo)準(zhǔn)實(shí)現(xiàn)高壓縮比高質(zhì)量圖像處理的原理;針對(duì)FPGA在算法實(shí)現(xiàn)上的特點(diǎn),以及JPEG算法處理的原理,按照編碼和解碼順序,研究設(shè)計(jì)了基于改進(jìn)的DA算法的FDCT和IDCT變換,以及按發(fā)生頻率進(jìn)行優(yōu)化的霍夫曼查找表結(jié)構(gòu),并且從系統(tǒng)整體上對(duì)JPEG編解碼進(jìn)行簡(jiǎn)化,以提高系統(tǒng)的處理性能。最后,通過(guò)分析Nios嵌入式微處理器可定制特性,根據(jù)SOPC Builder中Avalon總線的要求,把圖像采集,JPEG圖像壓縮和網(wǎng)絡(luò)傳輸轉(zhuǎn)變成用戶自定義模塊,在SOPC Builder下把用戶自定義模塊添加到系統(tǒng)中,由Nios嵌入式軟核的控制下運(yùn)行,在FPGA芯片上實(shí)現(xiàn)整個(gè)JPEG實(shí)時(shí)圖像編解碼系統(tǒng)(soc)。 在FPGA上實(shí)現(xiàn)硬件模塊化的JPEG算法,具有造價(jià)低功耗低,性能穩(wěn)定,圖像恢復(fù)后質(zhì)量高等優(yōu)點(diǎn),適用于精度要求高且需要對(duì)圖像進(jìn)行逐幀處理的遠(yuǎn)程微小目標(biāo)識(shí)別和跟蹤系統(tǒng)中以及廣電系統(tǒng)中前期的非線性編輯工作以及數(shù)字電影的動(dòng)畫(huà)特技制作,對(duì)降低成本和提高圖像處理速度兩方面都有非常重大的現(xiàn)實(shí)意義。通過(guò)在FPGA上實(shí)現(xiàn)JPEG編解碼,進(jìn)一步探索FPGA在數(shù)字圖像處理上的優(yōu)勢(shì)所在,深入了解進(jìn)行此類硬件模塊設(shè)計(jì)的技術(shù)特點(diǎn),是本課題的重要學(xué)術(shù)意義所在。

    標(biāo)簽: FPGA JPEG 實(shí)時(shí)圖像 編解碼

    上傳時(shí)間: 2013-04-24

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  • Avlon總線規(guī)范參考手冊(cè)

    Avlon總線規(guī)范參考手冊(cè) Avalon總線是一種將片上處理器和外設(shè)連接成片上可編程系統(tǒng) (SOPC) 的一種簡(jiǎn)單總線結(jié)構(gòu)。

    標(biāo)簽: Avlon 總線規(guī)范 參考手冊(cè)

    上傳時(shí)間: 2013-10-18

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  • 智能型動(dòng)態(tài)圖像追蹤自控車(chē)

    本作品使用兩顆嵌入式Nios軟核,通過(guò)快速設(shè)計(jì)且高集成性的Avalon總線,將復(fù)雜的外圍電路及數(shù)種內(nèi)存模塊集成為車(chē)控平臺(tái),通過(guò)Nios高性能的表現(xiàn),可以很輕易地實(shí)現(xiàn)實(shí)時(shí)圖像處理及高速自動(dòng)控制的產(chǎn)品。

    標(biāo)簽: 智能型 動(dòng)態(tài)圖像 追蹤 自控車(chē)

    上傳時(shí)間: 2013-11-12

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  • SOPC技術(shù)基礎(chǔ)教程(侯建軍著)

      SOPC技術(shù)基礎(chǔ)教程 [作者:侯建軍、郭勇編著;出版社:清華大學(xué)出版社;(注意:本書(shū)格式為pdz格式,需要用壓縮包中的超星軟件才可打開(kāi),建議打開(kāi)前先殺一下毒,以防萬(wàn)一!)   內(nèi)容簡(jiǎn)介:本書(shū)系統(tǒng)地介紹了基于FPGA的SOPC的軟硬件開(kāi)發(fā)技術(shù),以一個(gè)簡(jiǎn)單的設(shè)計(jì)實(shí)例為主線介紹軟硬件的開(kāi)發(fā)流程、開(kāi)發(fā)工具的使用及開(kāi)發(fā)的思想,使讀者對(duì) SOPC技術(shù)有一個(gè)基本的了解。將NiosⅡ體系結(jié)構(gòu)、Avalon總線規(guī)范、NiosⅡ處理器常用外部設(shè)備的更多底層細(xì)節(jié)提供給讀者,使讀者獲得進(jìn)行高級(jí)開(kāi)發(fā)的能力。另外還介紹了使用MATLAB和DSP Builder進(jìn)行基于FPGA的DSP開(kāi)發(fā)技術(shù),并提供了一些典型的實(shí)驗(yàn)。

    標(biāo)簽: SOPC 技術(shù)基礎(chǔ) 教程

    上傳時(shí)間: 2013-11-23

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  • 定時(shí)器開(kāi)源項(xiàng)目, 相對(duì)于 jcrontab, Quartz 算是更完整的一個(gè)項(xiàng)目, 隨著開(kāi)發(fā)的版本上來(lái), 他已經(jīng)脫離只是寫(xiě)在程序里面的計(jì)時(shí)器, 在指定的時(shí)間或區(qū)間, 處理所指定的事件. 也加入了 se

    定時(shí)器開(kāi)源項(xiàng)目, 相對(duì)于 jcrontab, Quartz 算是更完整的一個(gè)項(xiàng)目, 隨著開(kāi)發(fā)的版本上來(lái), 他已經(jīng)脫離只是寫(xiě)在程序里面的計(jì)時(shí)器, 在指定的時(shí)間或區(qū)間, 處理所指定的事件. 也加入了 servlet, 可以在 jsp/servlet container 執(zhí)行

    標(biāo)簽: jcrontab Quartz 項(xiàng)目 se

    上傳時(shí)間: 2015-03-18

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