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90度公針圖紙

2.54雙排90度排母規(guī)格書

2.54MM雙排90度排規(guī)格書圖紙,塑高分為8.5,7.1,6.8間距

標簽： 2.54雙排排母 2.54雙排90度排母 2.54母座圖紙 2.54母座規(guī)格圖 90度雙排母座 90度雙排排母 90度雙排彎排母雙排90度彎排母

上傳時間： 2016-01-08

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90度沉板式雙層USB規(guī)格書

90度沉板式雙層USB規(guī)格書圖紙,可分沉板式側插式

標簽： 雙層沉板式USB 沉板式雙排USB圖紙沉板式雙排USB USB沉板式沉板式雙層USB圖紙 90度雙層USB2.0

上傳時間： 2016-01-08

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90度雙排雙塑排針規(guī)格圖

2.54間距90度雙排雙塑排針規(guī)格書圖紙,可分為單排,雙排,三排

標簽： 90度雙塑排針 90度雙塑公針 90度雙塑排針圖紙 90度雙塑公針圖紙雙塑彎排針雙塑彎公針雙排雙塑公針

上傳時間： 2016-01-08

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四排90度排針規(guī)格書

2.0MM四排90度排針分為針長可以定做各種長度類型

標簽： 四拓排針四排彎針 4排彎針 4排排針四排90度彎針四排90度彎針 4排90度彎針圖紙 4排90度彎針規(guī)格書

上傳時間： 2016-01-13

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90度RJ45網口規(guī)格圖紙

90度RJ45網口,90度RJ45網口規(guī)格圖,90度RJ45網口圖紙,RJ45網口90度,RJ45 90度網口

標簽： 90度RJ45網口 90度RJ45網口規(guī)格圖 90度RJ45網口圖紙 RJ45網口90度 RJ45 90度網口

上傳時間： 2016-01-18

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SMD貼片90度排針

2.54mm單排針,單排雙塑,180度,H=1.5/2.0/2.5mm 2.54mm雙排針,雙排雙塑,180度,H=1.5/2.0/2.5mm 2.54mm單/雙排弱,90度,H=1.5/2.0/2.5mm 2.54mm單/雙排針,SMT,H=1.5/2.0/2.5mm 2.54mm單排雙塑,雙排雙塑,SMT,H=1.5/2.0/2.5mm 2.54mm三排針,90/180度,H=2.5mm 2.54mm單/雙排針,打K,H=1.5/2.0/2.5mm 2.54mm雙排針,90/180度,H=4.3mm 2.54mm雙排針,90/180度,H=7.4mm 2.54mm雙排針,雙塑,90度,塑寬=9.7mm,H=2.54mm 2.00mm排針系列： 2.00mm單排

標簽： SMD貼片排針 90度貼片排針 90度SMT排針 SMD PIN針 PH貼片排針 90度貼片排針 SMD針座

上傳時間： 2016-08-03

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0-90度按鍵切換舵機程序

51控制舵機0度到90度按鍵切換，自己探究出來的可實現

標簽： 90 按鍵舵機程序

上傳時間： 2017-12-24

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51單片機控制制舵機左右90度轉動，注釋詳細

51單片機控制制舵機左右90度轉動，程序注釋詳細，非常適合單片機參考借鑒。

標簽： 51單片機

上傳時間： 2022-07-04

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180度雙排雙塑排針規(guī)格圖

180度雙塑排針,180度雙塑公針,180度雙塑排針圖紙,180度雙塑公針圖紙,DIP雙塑直插排針,雙塑DIP180度公針,DIP雙排雙塑公針

標簽： 180度雙塑排針 180度雙塑公針 180度雙塑排針圖紙 180度雙塑公針圖紙 DIP雙塑直插排針雙塑DIP180度公針 DIP雙排雙塑公針

上傳時間： 2016-01-08

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應用于十萬門FPGA的全數字鎖相環(huán)設計

在過去的十幾年間，FPGA取得了驚人的發(fā)展：集成度已達到1000萬等效門、速度可達到400～500MHz。隨著FPGA的集成度不斷增大，在高密度FPGA中，芯片上時鐘的分布質量就變得越來越重要。時鐘延時和時鐘相位偏移已成為影響系統(tǒng)性能的重要因素。現在，解決時鐘延時問題主要使用時鐘延時補償電路。為了消除FPGA芯片內的時鐘延時，減小時鐘偏差，本文設計了內置于FPGA芯片中的延遲鎖相環(huán)，采用一種全數字的電路結構，將傳統(tǒng)DLL中的用模擬方式實現的環(huán)路濾波器和壓控延遲鏈改進為數字方式實現的時鐘延遲測量電路，和延時補償調整電路，配合特定的控制邏輯電路，完成時鐘延時補償。在輸入時鐘頻率不變的情況下，只需一次調節(jié)過程即可完成輸入輸出時鐘的同步，鎖定時間較短，噪聲不會積累，抗干擾性好。在Smic0.18um工藝下，設計出的時鐘延時補償電路工作頻率范圍從25MHz到300MHz，最大抖動時間為35ps，鎖定時間為13個輸入時鐘周期。另外，完成了時鐘相移電路的設計，實現可編程相移，為用戶提供與輸入時鐘同頻的相位差為90度，180度，270度的相移時鐘；時鐘占空比調節(jié)電路的設計，實現可編程占空比，可以提供占空比為50/50的時鐘信號；時鐘分頻電路的設計，實現頻率分頻，提供1.5，2，2.5，3，4，5，8，16分頻時鐘。

標簽： FPGA 應用于全數字鎖相環(huán)

上傳時間： 2013-07-06

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