EDA (Electronic Design Automation)即“電子設(shè)計自動化”,是指以計算機(jī)為工作平臺,以EDA軟件為開發(fā)環(huán)境,以硬件描述語言為設(shè)計語言,以可編程器件PLD為實驗載體(包括CPLD、FPGA、EPLD等),以集成電路芯片為目標(biāo)器件的電子產(chǎn)品自動化設(shè)計過程。“工欲善其事,必先利其器”,因此,EDA工具在電子系統(tǒng)設(shè)計中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設(shè)計開發(fā)領(lǐng)域的EDA工具,一般至少要包含仿真器(Simulator)、綜合器(Synthesizer)和配置器(Place and Routing, P&R)等幾個特殊的軟件包中的一個或多個,因此這一領(lǐng)域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設(shè)計及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法:一種是按公司類別進(jìn)行分類,另一種是按功能進(jìn)行劃分。 若按公司類別分,大體可分兩類:一類是EDA 專業(yè)軟件公司,業(yè)內(nèi)最著名的三家公司是Cadence、Synopsys和Mentor Graphics;另一類是PLD器件廠商為了銷售其產(chǎn)品而開發(fā)的EDA工具,較著名的公司有Altera、Xilinx、lattice等。前者獨立于半導(dǎo)體器件廠商,具有良好的標(biāo)準(zhǔn)化和兼容性,適合于學(xué)術(shù)研究單位使用,但系統(tǒng)復(fù)雜、難于掌握且價格昂貴;后者能針對自己器件的工藝特點作出優(yōu)化設(shè)計,提高資源利用率,降低功耗,改善性能,比較適合產(chǎn)品開發(fā)單位使用。 若按功能分,大體可以分為以下三類。 (1) 集成的PLD/FPGA開發(fā)環(huán)境 由半導(dǎo)體公司提供,基本上可以完成從設(shè)計輸入(原理圖或HDL)→仿真→綜合→布線→下載到器件等囊括所有PLD開發(fā)流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ,Xilinx公司的ISE,Lattice公司的 ispDesignExpert等。其優(yōu)勢是功能全集成化,可以加快動態(tài)調(diào)試,縮短開發(fā)周期;缺點是在綜合和仿真環(huán)節(jié)與專業(yè)的軟件相比,都不是非常優(yōu)秀的。 (2) 綜合類 這類軟件的功能是對設(shè)計輸入進(jìn)行邏輯分析、綜合和優(yōu)化,將硬件描述語句(通常是系統(tǒng)級的行為描述語句)翻譯成最基本的與或非門的連接關(guān)系(網(wǎng)表),導(dǎo)出給PLD/FPGA廠家的軟件進(jìn)行布局和布線。為了優(yōu)化結(jié)果,在進(jìn)行較復(fù)雜的設(shè)計時,基本上都使用這些專業(yè)的邏輯綜合軟件,而不采用廠家提供的集成PLD/FPGA開發(fā)工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類 這類軟件的功能是對設(shè)計進(jìn)行模擬仿真,包括布局布線(P&R)前的“功能仿真”(也叫“前仿真”)和P&R后的包含了門延時、線延時等的“時序仿真”(也叫“后仿真”)。復(fù)雜一些的設(shè)計,一般需要使用這些專業(yè)的仿真軟件。因為同樣的設(shè)計輸入,專業(yè)軟件的仿真速度比集成環(huán)境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim,Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。 以上介紹了一些具代表性的EDA 工具軟件。它們在性能上各有所長,有的綜合優(yōu)化能力突出,有的仿真模擬功能強(qiáng),好在多數(shù)工具能相互兼容,具有互操作性。比如Altera公司的 QuartusII集成開發(fā)工具,就支持多種第三方的EDA軟件,用戶可以在QuartusII軟件中通過設(shè)置直接調(diào)用Modelsim和 Synplify進(jìn)行仿真和綜合。 如果設(shè)計的硬件系統(tǒng)不是很大,對綜合和仿真的要求不是很高,那么可以在一個集成的開發(fā)環(huán)境中完成整個設(shè)計流程。如果要進(jìn)行復(fù)雜系統(tǒng)的設(shè)計,則常規(guī)的方法是多種EDA工具協(xié)調(diào)工作,集各家之所長來完成設(shè)計流程。
上傳時間: 2013-10-11
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利用RTOS機(jī)制實現(xiàn)機(jī)械系統(tǒng)中的質(zhì)量,阻尼等...也可利用鍵盤輸入m,k,c,來改變sin波的位移量
上傳時間: 2014-01-11
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上傳時間: 2015-09-08
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華為軟件編程規(guī)范和范例的文件,可幫助編程時提昇成功性與可讀性
上傳時間: 2014-02-05
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個人開發(fā),以 DirectInput 為基底包成的類別,可同時接收滑鼠、鍵盤、JOYSTICK等輸入裝置。
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上傳時間: 2013-12-13
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執(zhí)行步驟1: 執(zhí)行EX1126程式進(jìn)入學(xué)生考試系統(tǒng) 權(quán)限描述: 使用者查詢:於”姓名”中輸入”Arno”,於”學(xué)號”中輸入”good”,再按下”使用者查詢” 即可查詢. 修改使用者:於”姓名”中輸入”GUEST”,於”學(xué)號”中輸入”0000”,再按下” 修改使用者即可修改: 功能描述: 使用者開始考試,於”姓名”中輸入自己的姓名,於”學(xué)號”中輸入學(xué)號,再按下” 考試去”即可: 開始考試,同時系統(tǒng)紀(jì)錄考生狀態(tài)為”1”. 使用者考試,完成後按下”結(jié)算成績”,同時系統(tǒng)顯示紀(jì)錄考生該科分?jǐn)?shù),同時清除考生登入狀態(tài),使其無法重覆考試,老師並可查詢考生成績.
上傳時間: 2016-07-31
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LCD 因其輕薄短小,低功耗,無輻射,平面 直角顯示,以及影像穩(wěn)定等特點,當(dāng)今應(yīng)用非常 廣泛。CPLD(復(fù)雜可編程邏輯器件) 是一種具有 豐富可編程功能引腳的可編程邏輯器件,不僅可 實現(xiàn)常規(guī)的邏輯器件功能,還可以實現(xiàn)復(fù)雜而獨 特的時序邏輯功能。并且具有ISP (在線可編 程) [1 ] 功能,便于進(jìn)行系統(tǒng)設(shè)計和現(xiàn)場對系統(tǒng)進(jìn) 行功能修改、調(diào)試、升級。通常CPLD 芯片都有 著上萬次的重寫次數(shù),即用CPLD[ 2 ] 進(jìn)行硬件設(shè) 計,就像軟件設(shè)計一樣靈活、方便。而現(xiàn)今LCD 的控制大都采用專用控制芯片,且一般都采用進(jìn) 口芯片,成本較高。并且為了保證在特定環(huán)境下 控制芯片能正常工作,往往要加上必需的與門、 非門、以及HC244 ,HC245 、HC373 等元件,這樣 不僅提高的成本,也因分立元件的引入而降低了 電路的可靠性。本設(shè)計的目的是采用Xilinx 公 司生產(chǎn)的一片XC95288 和一片XC95144 來實現(xiàn) LCD 控制器以及其外圍控制,時序邏輯的全部 功能,使得LCD 控制系統(tǒng)故障率和開發(fā)成本大 大降低,并使LCD 控制系統(tǒng)有強(qiáng)大的功能可擴(kuò) 展性。
標(biāo)簽: CPLD LCD 可編程邏輯器件 低功耗
上傳時間: 2016-09-25
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這個是去年寫的東東。 以前公司一直使用易飛ERP,也因此自學(xué)了Delphi(本人以前一直使用VFP), 這是第一個模擬易飛界面的東東。 以前有進(jìn)過易飛俱樂部論壇(http://www.dcmsclub.com)的朋友可能有下載過。 裏面使用到的都是D7裏自帶的標(biāo)準(zhǔn)組件. 認(rèn)識一些共同研究易飛及Delphi編程方面的朋友. 由于本人也在處于入門階段,非常感謝盒子及各位朋友的幫助。3Q! 先把MainMenu.exe文件改名下(可不要覆蓋掉原來易飛的文件啊), 解壓復(fù)制到易飛安裝目錄下的c_dsbin文件夾裏 如 易飛安裝在D盤的Conductor 文件夾,則解壓至D:\Conductor\c_dsbin 注:本源碼只供新手參考,有錯的請指出。
標(biāo)簽: ERP
上傳時間: 2016-11-07
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在WinAVR下的ST7565圖形點陣的驅(qū)動程序,可以顯示5*7 & 8*16的ASCII和自定義的漢字,並且有3*4矩陣按鍵的掃描解碼程序。
標(biāo)簽: WinAVR 7565 ST 驅(qū)動
上傳時間: 2013-12-26
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程式描述:使用Cypress的Cy7C68013A晶片進(jìn)行設(shè)計,實現(xiàn)USB鍵盤輸入的功能。 安裝:把來源程式碼複製到硬碟特定目錄下,使用Keil C編譯器運行即可。 注意:可以首先使用Cypress的測試工具進(jìn)行韌體程式的測試,以確保韌體程式的正確性。
標(biāo)簽: Cypress 68013A C68013 68013
上傳時間: 2017-02-10
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