GB-T4677.1-1984 印制板表層絕緣電阻測試方法
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上傳時間： 2013-06-04
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信號與信息處理是信息科學中近幾年來發展最為迅速的學科之一,隨著片上系統(SOC,System On Chip)時代的到來,FPGA正處于革命性數字信號處理的前沿。基于FPGA的設計可以在系統可再編程及在系統調試,具有吞吐量高,能夠更好地防止授權復制、元器件和開發成本進一步降低、開發時間也大大縮短等優點。然而,FPGA器件是基于SRAM結構的編程工藝,掉電后編程信息立即丟失,每次加電時,配置數據都必須重新下載,并且器件支持多種配置方式,所以研究FPGA器件的配置方案在FPGA系統設計中具有極其重要的價值,這也給用于可編程邏輯器件編程的配置接口電路和實驗開發設備提出了更高的要求。 本論文基于IEEE1149.1標準和USB2.0技術,完成了FPGA配置接口電路及實驗開發板的設計與實現。作者在充分理解IEEE1149.1標準和USB技術原理的基礎上,針對Altcra公司專用的USB數據配置電纜USB-Blaster,對其內部工作原理及工作時序進行測試與詳細分析,完成了基于USB配置接口的FPGA芯片開發實驗電路的完整軟硬件設計及功能時序仿真。作者最后進行了軟硬件調試,完成測試與驗證,實現了對Altera系列PLD的配置功能及實驗開發板的功能。 本文討論的USB下載接口電路被驗證能在Altera的QuartusII開發環境下直接使用,無須在主機端另行設計通信軟件,其兼容性較現有設計有所提高。由于PLD(Programmable Logic Device)廠商對其知識產權嚴格保密,使得基于USB接口的配置電路應用受到很大限制,同時也加大了自行對其進行開發設計的難度。 與傳統的基于PC并口的下載接口電路相比,本設計的基于USB下載接口電路及FPGA實驗開發板具有更高的編程下載速率、支持熱插拔、體積小、便于攜帶、降低對PC硬件傷害,且具備其它下載接口電路不具備的SignalTapII嵌入式邏輯分析儀和調試NiosII嵌入式軟核處理器等明顯優勢。從成本來看,本設計的USB配置接口電路及FPGA實驗開發板與其同類產品相比有較強的競爭力。
上傳時間： 2013-04-24
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工業X-CT（X-ray Computed Tomography）無損檢測技術是以不損傷或者破壞被檢測對象的一種高新檢測技術，被譽為最佳的無損檢測手段，在無損檢測領域日益受到人們的青睞。近年來，各國都在投入大量的人力、物力對其進行研究與開發。 目前，工業CT主要采用第二代和第三代掃描方式。在工業CT第三代掃描方式中，掃描系統僅作“旋轉”運動，控制系統比較簡單。對此，我國已取得了可喜的成績。然而，對工業CT系統中的二代掃描運動控制系統，即針對“平移+旋轉”運動的控制系統的研究，我國已有采用，但與發達國家相比，還存在較大的差距。二代掃描方式與其它掃描方式相比，具有對被檢物的尺寸沒有要求，且能夠對感興趣的檢測區域進行局部掃描的獨特優點。同時X光源的射線出束角較小（一般小于20°），因此在工業X-CT系統主要采用二代掃描運動控制。有鑒于此，本論文結合有關科研項目，開展了工業X-CT二代掃描控制系統的研究。 論文首先介紹了工業X-CT系統的工作原理和各種掃描運動控制方式的特點，闡述了開展二代掃描控制的研究目的和意義。其次，根據二代掃描控制的特點，提出了“在優先滿足工業X-CT二代掃描控制的基礎上，力求實現對工業X-CT掃描運動的通用控制，使其能同時支持一、三代掃描方式”的設計思想。據此，研究確立了基于單片機AT89LV52及FPGA芯片EP1C3T100C8的運動控制架構，以實現二代掃描控制系統的設計方案。論文詳細介紹了可編程邏輯器件FPGA的工作原理和開發流程，并對其相關開發環境QuartusII4.1作了闡述。結合運動控制系統的硬件設計，詳細介紹了各功能模塊的具體設計過程，給出了相關的設計原理框圖和實際運行波形。并制作了相應的PCB板，調試了整個硬件控制系統。最后，論文還詳細研究了利用VisualC++6.0來完成上位機控制軟件的設計，給出了運動控制主界面及掃描運動控制功能軟件設計的流程圖。 論文對整個運動控制系統采用的經濟型的開環控制技術所帶來的不利影響，分析研究了增加步進電機的細分數以提高掃描精度的可能性，并對所研究的控制系統在調試過程中出現的一些問題及解決方案作了簡要的分析，提出了一些完善方法。
上傳時間： 2013-04-24
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本文提出了一種適合于嵌入式SoC的USB器件端處理器的硬件實現結構。并主要研究了USB器件端處理器的RTL級實現及FPGA原型驗證、和ASIC實現研究，包括從模型建立、算法仿真、各個模塊的RTL級設計及仿真、FPGA的下載測試和ASIC的綜合分析。它的速度滿足預定的48MHz，等效門面積不超過1萬門，完全可應用于SOC設計中。 本文重點對嵌入式USB器件端處理器的FPGA實現作了研究。為了準確測試本處理器的運行情況，本文應用串口傳遞測試數據入FPGA開發板，測試模塊讀入測試數據，發送入PC機的主機端。通過NI-VISA充當軟件端，檢驗測試數據的正確。
上傳時間： 2013-07-24
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心臟疾病一直是威脅人類生命健康的主要疾病之一。研究無創的心電信號檢測設備來檢測與評價心臟功能的狀況，并研究心臟疾病的成因是生物醫學電子學的重要研究課題之一。動態心電記錄儀(Holter)是用于記錄24小時長時間心電圖的一種設備。研制高性能的動態心電記錄、監護系統對于心血管疾病的診斷和治療具有十分重要的意義。 Holter技術發展至今已有幾十年歷史，但目前的Holter仍存在許多不足之處：(1)許多Holter采用8位、16位單片機作為控制系統，運算能力有限，無法加入自動診斷功能：(2)數據存儲采用固定焊接在板上的存儲芯片，容量小，數據取出回放不方便；(3)大部分Holter還不能實現心電信號的實時遠程傳輸，心電數據的分析以及分析報告的獲取往往要滯后好幾天時間，不利于心臟疾病的及早診斷及治療。 針對這些不足，本文設計了一個基于ARM(一種32位嵌入式處理器)的動態心電記錄儀。該記錄儀具有運算功能強、能夠實現心電信號實時遠程網絡傳輸的特點。為確保信息不會因網絡傳輸故障而丟失，本系統同時還采用了便于攜帶的SD(Secure Digital Memory)閃存卡作為存儲媒介，具有大容量數據存儲的功能。本文設計的系統主要完成的任務有心電信號的采集、心電信號的放大濾波、心電信號的顯示和心電信號的存儲與傳輸。整個系統由一片ARM嵌入式微處理器控制，本系統中采用的嵌入式微處理器是三星的S3C44BOX。放大和濾波電路主要是對電極導聯傳來的心電信號進行放大和濾除干擾信號，以獲取合適的信號大小并保證采集的心電信號的正確性。心電信號的顯示是把心電信號實時地顯示在Holter的液晶屏上，能使患者直觀地觀察到自己的心電信號情況。心電信號的存儲采用了容量大、成本及功耗低并且體積小方便攜帶的SD卡來存儲心電數據。心電數據的傳輸是通過以太網實現的，以太網可以實現快速、高正確率的傳輸。傳輸的數據由醫院內的服務器接收，并且在服務器端對心電信號進行相應的顯示和處理。為實現上述功能編寫的系統軟件包括Holter的Bootloader的設計、uCLINUX操作系統的移植、A/D轉換程序、液晶屏的控制及菜單程序、SD卡FAT文件格式的數據存儲和服務器端數據接收、波形顯示程序。本系統經過一定的實驗證明符合設計要求，具有體積小、成本低、使用方便的特點。
上傳時間： 2013-07-10
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郭天祥tx_1c單片機的原理圖，可用protues和keil聯合仿真，省去買開發板的錢 了 老實惠了
上傳時間： 2013-05-18
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按照公安部規定，我國從 2004 年開始換發第二代居民身份證，預計到 2008 年基本完成第二代居民身份證的換發工作。第二代身份證與第一代身份證最大的區別在于：它的內部嵌入了一枚指甲蓋大小的非接觸式 IC 芯片，該芯片內存儲有姓名、性別等9項信息。本課題設計出一款基于 ARM 和 GPRS 技術的第二代身份證無線手持閱讀器，該閱讀器能讀出第二代身份證內 IC 卡信息，并可通過 GPRS 網絡將信息進行無線傳輸。 本文以該閱讀器的設計為主線，論述的主要內容如下： 1．介紹了課題背景及意義。全國 9 億第二代身份證的換發，必然帶來各行業對閱讀器的大量需求，而現有閱讀器的弊端促使了對閱讀器做更深入的研究。 2．介紹了相關概念及技術，包括：無線射頻識別技術、ISO/IEC14443 協議、嵌入式系統、ARM、GPRS技術等。 3．詳細介紹了該閱讀器的硬件設計方法，并給出主要硬件模塊電路原理圖及其 PCB 板設計方法，同時也簡單介紹了硬件的焊接和調試過程。 4．詳細介紹了該閱讀器的軟件設計方法，包括：讀卡模塊驅動程序、GPRS 模塊驅動程序、人機對話模塊驅動程序、I/O 口驅動程序的流程圖和部分代碼。 5．為使該閱讀器安全可靠地運行，對閱讀器進行了各種功能測試，包括：讀卡功能、GPRS 數據傳輸功能、人機接口功能。 通過功能測試，該閱讀器能準確讀取第二代身份證內信息并通過GPRS 網絡成功將信息發送出去。該閱讀器與市面上現有的閱讀器相比，具有可脫機操作、無線傳輸、小巧靈便的優點。由于該閱讀器軟件采用模塊化的設計方法，可以方便移植到其他非接觸卡閱讀器中，因此本閱讀器具有非常廣泛的應用前景。
上傳時間： 2013-06-10
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信號與信息處理是信息科學中近幾年來發展最為迅速的學科之一,隨著片上系統(SOC,System On Chip)時代的到來,FPGA正處于革命性數字信號處理的前沿。基于FPGA的設計可以在系統可再編程及在系統調試,具有吞吐量高,能夠更好地防止授權復制、元器件和開發成本進一步降低、開發時間也大大縮短等優點。然而,FPGA器件是基于SRAM結構的編程工藝,掉電后編程信息立即丟失,每次加電時,配置數據都必須重新下載,并且器件支持多種配置方式,所以研究FPGA器件的配置方案在FPGA系統設計中具有極其重要的價值,這也給用于可編程邏輯器件編程的配置接口電路和實驗開發設備提出了更高的要求。 本論文基于IEEE1149.1標準和USB2.0技術,完成了FPGA配置接口電路及實驗開發板的設計與實現。作者在充分理解IEEE1149.1標準和USB技術原理的基礎上,針對Altcra公司專用的USB數據配置電纜USB-Blaster,對其內部工作原理及工作時序進行測試與詳細分析,完成了基于USB配置接口的FPGA芯片開發實驗電路的完整軟硬件設計及功能時序仿真。作者最后進行了軟硬件調試,完成測試與驗證,實現了對Altera系列PLD的配置功能及實驗開發板的功能。 本文討論的USB下載接口電路被驗證能在Altera的QuartusII開發環境下直接使用,無須在主機端另行設計通信軟件,其兼容性較現有設計有所提高。由于PLD(Programmable Logic Device)廠商對其知識產權嚴格保密,使得基于USB接口的配置電路應用受到很大限制,同時也加大了自行對其進行開發設計的難度。 與傳統的基于PC并口的下載接口電路相比,本設計的基于USB下載接口電路及FPGA實驗開發板具有更高的編程下載速率、支持熱插拔、體積小、便于攜帶、降低對PC硬件傷害,且具備其它下載接口電路不具備的SignalTapII嵌入式邏輯分析儀和調試NiosII嵌入式軟核處理器等明顯優勢。從成本來看,本設計的USB配置接口電路及FPGA實驗開發板與其同類產品相比有較強的競爭力。
上傳時間： 2013-06-07
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