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2015

  • PADS出Excel BOM強(qiáng)勢(shì)升級(jí)

    　　網(wǎng)上瘋傳的Excel BOM經(jīng)典腳本，相信諸位PADS用戶再熟悉不過了吧！ 　　　　但是它還有缺點(diǎn)： 　　1.元件封裝不能轉(zhuǎn)換。(元件位號(hào)為R/C/L的0402/063/0805/1206封裝自動(dòng)轉(zhuǎn)換統(tǒng)一的對(duì)應(yīng)封裝，以方便統(tǒng)計(jì)。) 　　2.元件參數(shù)轉(zhuǎn)換。(電阻的轉(zhuǎn)換0R時(shí)由0mR修正為0R,KR/MR修正為K/M。) 　　3.不能按元件的SMD屬性來(lái)分類統(tǒng)計(jì)。 　　4.有些公司在制作PADS庫(kù)元件時(shí)，已經(jīng)為元件建立了Part ID。導(dǎo)出BOM時(shí)需要元件的Part ID屬性。 　　5.不能導(dǎo)出元件坐標(biāo)。（本人改進(jìn)導(dǎo)出元件幾何中心坐標(biāo)，以便貼片生產(chǎn)之用。） 　　6.不能導(dǎo)出跳線。 　　7.不能支持WPS。 　　8.不能自定義導(dǎo)出元件的Part ID屬性。 　　9.不能自定義位號(hào)之間連接符號(hào)。 　　10.導(dǎo)出BOM特殊字符亂碼，比如常見的±/µ/Ω等。（PADS9.5在中文狀態(tài)下導(dǎo)出BOM就不會(huì)亂碼， 　　　　暫時(shí)還沒有更好的解決辦法，不過可以在Excel中替換解決。） 11.加載與運(yùn)行腳本步驟繁冗；運(yùn)行速度比較慢。（本人改進(jìn)的代碼速度絕對(duì)不會(huì)比之前的慢。）

    標(biāo)簽： Excel PADS BOM

    上傳時(shí)間： 2015-01-01

    上傳用戶：rolypoly152

  • 中興--射頻板PCB工藝設(shè)計(jì)規(guī)范

    中興--射頻板PCB工藝設(shè)計(jì)規(guī)范

    標(biāo)簽： PCB 中興 射頻板 工藝

    上傳時(shí)間： 2015-01-01

    上傳用戶：18710733152

  • PCB鋪銅問題

    介紹了PCB鋪銅對(duì)電路板性能的影響，寫得的確很好，與大家分享。

    標(biāo)簽： PCB 鋪銅

    上傳時(shí)間： 2015-01-01

    上傳用戶：宋桃子

  • PCB信號(hào)完整性分析與設(shè)計(jì)(碩士學(xué)位論文)

    PCB信號(hào)完整性分析與設(shè)計(jì)(碩士學(xué)位論文)

    標(biāo)簽： PCB 信號(hào)完整性 分 碩士

    上傳時(shí)間： 2015-01-01

    上傳用戶：dongbaobao

  • 使用QUARTUS_II做FPGA開發(fā)全流程_傻瓜式詳細(xì)教程

    用QUARTUS_II做FPGA開發(fā)全流程

    標(biāo)簽： QUARTUS_II FPGA 流程 傻瓜式

    上傳時(shí)間： 2015-01-01

    上傳用戶：yl1140vista

  • AltiumDesignerWinter09破解alf文件

    不用注冊(cè)機(jī)操作生成破解文件，壓縮包里alf文件直接復(fù)制到軟件安裝目錄下既可破解激活使用。

    標(biāo)簽： AltiumDesignerWinter alf 09 破解

    上傳時(shí)間： 2015-01-01

    上傳用戶：waves_0801

  • 1.3.5 嵌入微處理器的FPGA設(shè)計(jì)流程

    1.3.5 嵌入微處理器的FPGA設(shè)計(jì)流程。

    標(biāo)簽： FPGA 嵌入微處理器 設(shè)計(jì)流程

    上傳時(shí)間： 2015-01-01

    上傳用戶：ghostparker

  • PADS建立元件庫(kù)基礎(chǔ)教程

    PADS建立元件庫(kù)基礎(chǔ)教程

    標(biāo)簽： PADS 元件庫(kù) 基礎(chǔ)教程

    上傳時(shí)間： 2015-01-01

    上傳用戶：lionlwy

  • 基于QUARTUS的仿真

    4.2 基于QUARTUS的仿真

    標(biāo)簽： QUARTUS 仿真

    上傳時(shí)間： 2015-01-01

    上傳用戶：steveng

  • 基于FPGA的隨機(jī)數(shù)性能檢測(cè)設(shè)計(jì)

    為了滿足對(duì)隨機(jī)數(shù)性能有一定要求的系統(tǒng)能夠?qū)崟r(shí)檢測(cè)隨機(jī)數(shù)性能的需求，提出了一種基于FPGA的隨機(jī)數(shù)性能檢測(cè)設(shè)計(jì)方案。根據(jù)NIST的測(cè)試標(biāo)準(zhǔn)，采用基于統(tǒng)計(jì)的方法，在FPGA內(nèi)部實(shí)現(xiàn)了對(duì)隨機(jī)序列的頻率測(cè)試、游程測(cè)試、最大游程測(cè)試、離散傅里葉變換測(cè)試和二元矩陣秩測(cè)試。與現(xiàn)在常用的隨機(jī)數(shù)性能測(cè)試軟件相比，該設(shè)計(jì)方案，能靈活嵌入到需要使用隨機(jī)數(shù)的系統(tǒng)中，實(shí)現(xiàn)對(duì)隨機(jī)性能的實(shí)時(shí)檢測(cè)。實(shí)際應(yīng)用表明，該設(shè)計(jì)具有使用靈活、測(cè)試準(zhǔn)確、實(shí)時(shí)輸出結(jié)果的特點(diǎn)，達(dá)到了設(shè)計(jì)要求。

    標(biāo)簽： FPGA 隨機(jī)數(shù) 性能檢測(cè)

    上傳時(shí)間： 2015-01-01

    上傳用戶：瓦力瓦力hong

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