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高速異步fifo

  • 基于ARM與R8C的嵌入式數控系統設計

    二十世紀九十年代以來,隨著嵌入式系統的蓬勃發展,嵌入式技術開始滲透到數控領域,傳統數控技術與嵌入式技術相結合,新型嵌入式數控技術進入一個高速發展的階段。激光切割由于具有切割尺寸質量好、速度快、精度高、效率高等優點,在工業數控系統中具有非常廣泛的應用?;谇度胧降募す馇懈顢悼叵到y是嵌入式技術在激光切割應用中新的探索,對于激光加工工業有著重要的意義。本文以ARM與R8C為平臺,對以激光切割為應用的嵌入式數控系統的設計進行了研究。 本文介紹了嵌入式數控系統的原理、體系結構和硬件組成以及激光切割和原理、發展和特點,然后從硬件和軟件兩個方面對系統的具體設計進行了研究。介紹了上位機ARMS3C44B0和下位機R8C/17的特點,執行機構步進電機的控制原理,對外圍設備相關設計進行了研究,包括上位機ARM S3C4B0的串口通信、LCD顯示、觸摸屏的設計,已及下位機R8C/17的串口通信與對步進電機的控制。介紹了嵌入式操作系統UC/OS-II的原理及特點,UC/GUI的特點及應用。對系統各功能模塊的軟件設計進行了研究,包括嵌入式操作系統上任務的設計和通訊、系統人機界面的設計。研究了兩種激光切割路徑的算法,包括通用的來回掃描切割算法以及作者研究的實際路徑切割算法。

    標簽: ARM R8C 嵌入式 數控

    上傳時間: 2013-07-22

    上傳用戶:lw4463301

  • 基于單片機的步進電機控制器設計.pdf

    步進電機是一種將電脈沖轉化為角位移的執行機構,可以通過控制脈沖個數來控制角位移量,從而達到準確定位的目的;同時可以通過控制脈沖頻率來控制電機轉動的速度和加速度,從而達到調速的目的。由于步進電機的控制原理是根據控制信號動作,因此非常適合于單片機控制。 由于工業自動化水平的提高,對很多工業監控設備的要求也隨著提高,特別是對其驅動部件步進電機的位移和速度控制的要求越來越高,用單片機機對二維步進電機實施精確位移和速度控制有極大的優越性,二維步進電機數控運行系統是由ipc(工業控制計算機)發出控制指令,通過與單片機之間的通信,使單片機產生控制步進電機運轉的脈沖波形,使二維步進電機分別作正傳、反轉、快轉、慢轉和停止等。

    標簽: 單片機 制器設計 步進電機

    上傳時間: 2013-05-18

    上傳用戶:sn2080395

  • 實用的步進電機驅動電路介紹

    本文介紹了步進電機驅動電路以及它的性能。

    標簽: 步進電機驅動 電路介紹

    上傳時間: 2013-07-20

    上傳用戶:Ruzzcoy

  • 高速電路板設計(世界級水準)

    想成為PCB高速設計高手,請看世界級的PCB設計水準。

    標簽: 高速電路板

    上傳時間: 2013-04-24

    上傳用戶:英雄

  • 基于ARM和嵌入式LINUX的無線視頻監控系統的實現

    嵌入式系統是以應用為中心,以計算機為基礎,并且軟硬件可裁剪,適用于應用系統對功能、可靠性、成本、體積、功耗有嚴格要求的專用計算機系統。嵌入式系統一般由嵌入式微處理器、外圍硬件設備、嵌入式操作系統以及用戶的應用程序4部分組成,用于實現對其它設備的控制、監視或管理等功能。其廣泛應用于控制領域、消費電子產品等行業,已成為現代電子領域的重要研究方向之一。而隨著電子技術,多媒體技術及網絡技術快速發展,視頻監控系統也正在向嵌入式,數字化,網絡化方向發展。嵌入式視頻監控系統充分利用大規模集成電路和網絡的科技成果,實現體積小巧,性能穩定,通訊便利的監控產品。本項的目的正是建立一個完整的基于 ARM9 核心處理器和嵌入式 Linux 操作系統的嵌入式視頻監控系統。 本項目是在 ARM 微處理器平臺上,移植嵌入式Linux操作系統,并完成視頻采集、壓縮、傳輸任務。系統采用 ARM 微處理器 AT91RM9200作為主處理器,以視頻采集芯片 ADV7181 作為視頻采集設備,用 H.263視頻壓縮協議對視頻數據進行壓縮,最后通過中興通信公司 MG815+CDMA通信模塊傳輸到服務器上。 本論文主要分成五個章節: 第一章:首先介紹ARM和嵌入式Linux操作系統的特點和當前的發展概況,然后說明了本文的課題背景及意義; 第二章:描述了硬件開發平臺。本系統采用了 ALTMEL 的AT91RM9200為核心的開發平臺,并擴展了以視頻采集模塊和CDMA無線傳輸模塊; 第三章:描述了本系統的軟件開發平臺,包括嵌入式Linux開發流程以及移植到具體硬件平臺需要完成的工作,如 U-Boot 的移植、Linux內核的編譯與裁剪、文件系統的制作等; 第四章:首先論述了本系統中的難點 FIFO 設備的驅動編寫,隨后在對H.263視頻壓縮編碼敘述的基礎上針對塊匹配運動估計給出了一種改進的菱形搜索算法代替原有的三步搜索法,并且通過實驗結果證明,經算法改進優化的新菱形算法優于原先的三步搜索法; 第五章:得出了實驗結果,完成了視頻數據的無線網絡傳輸。

    標簽: LINUX ARM 嵌入式 無線視頻監控系統

    上傳時間: 2013-04-24

    上傳用戶:martinyyyl

  • ADI---高速運放PCB布線實踐指南

    雖然印制電路板(PCB)布線在高速電路中具有關鍵的作用,但它往往是電路設計過程的最后幾個步驟之一。高速 PCB 布線有很多方面的問題,關于這個題目已有人撰寫了大量的文獻。本文主要從實踐的角度來探討高速電路的布線問題。主要目的在于幫助新用戶當設計高速電路 PCB 布線時對需要考慮的多種不同問題引起注意。另一個目的是為已經有一段時間沒接觸PCB 布線的客戶提供一種復習資料。由于版面有限,本文不可能詳細地論述所有的問題,但是我們將討論對提高電路性能、縮短設計時間、節省修改時間具有最大成效的關鍵部分。

    標簽: ADI PCB 高速運放 布線

    上傳時間: 2013-04-24

    上傳用戶:DanXu

  • IEEE 802.11信道編解碼及交織解交織的FPGA實現

    隨著糾錯編碼理論研究的不斷深入,糾錯碼的實際應用越來越廣泛。卷積碼作為其中重要的一種,已被大多數通信系統所采用。(2,1,7)卷積碼是一種短約束長度最佳碼,編、譯碼器易于實現,且具有較強的糾錯能力。 本文研究了IEEE 802.11協議中(2,1,7)卷積碼編碼、交織解交織及其軟判決高速Viterbi譯碼的實現問題。 首先介紹了IEEE 802.11無線局域網標準及規范,然后介紹了信道編解碼中卷積碼編碼及Viterbi譯碼算法和FPGA 設計方法,接著通過對(2,1,7)卷積碼特點的具體分析,吸取目前Viterbi譯碼算法和交織解交織算法的優點,采取一系列的改進措施,基于FPGA實現了IEEE 802.11信道編解碼及交織和解交織系統。這些改進措施包括采用并行FIFO、改進的ACS 單元、流水式塊處理結構、改進的SMDO方法、雙重交織策略,使得在同樣時鐘速率下,系統的性能大幅度提高。最后將程序下載到Altera公司的Cyclone 系列的FPGA(型號EP1C6Q240C8)器件上進測試,并對測試結果作了簡單分析。

    標簽: 802.11 IEEE FPGA 信道

    上傳時間: 2013-05-25

    上傳用戶:00.00

  • 高速數字電路設計教材華為黑魔手冊翻譯

    高速數字電路設計教材 華為黑魔手冊翻譯

    標簽: 高速數字電路 設計教材 華為

    上傳時間: 2013-07-20

    上傳用戶:ZHWKLIU

  • FPGA用于160Gbs高速光纖通信系統中PMD補償的研究

    偏振模色散(PMD)是限制光通信系統向高速率和大容量擴展的主要障礙,尤其是160Gb/s光傳輸系統中,由PMD引起的脈沖畸變現象更加嚴重。為了克服PMD帶來的危害,國內外已經開始了對PMD補償的研究。但是目前的補償系統復雜、成本高且補償效果不理想,因此采用前向糾錯(FEC)和偏振擾偏器配合抑制PMD的方法,可以實現低成本的PMD補償。 在實驗中將擾偏器連入光時分復用系統,通過觀察其工作前后的脈沖波形,發現擾偏器的應用改善了系統的性能。隨著系統速率的提高,對擾偏器速率的要求也隨之提高,目前市場上擾偏器的速率無法滿足160Gb/s光傳輸系統要求。通過對偏振擾偏器原理的分析,決定采用高速控制電路驅動偏振控制器的方法來實現高速擾偏器的設計。擾偏器采用鈮酸鋰偏振控制器,其響應時間小于100ns,是目前偏振控制器能夠達到的最高速率,但是將其用于160Gb/s高速光通信系統擾偏時,這個速率仍然偏低,因此,提出采用多段鈮酸鋰晶體并行擾偏的方法,彌補鈮酸鋰偏振控制器速率低的問題。通過對幾種處理器的分析和比較,選擇DSP+FPGA作為控制端,DSP芯片用于產生隨機數據,FPGA芯片具有豐富的I/O引腳,工作頻率高,可以實現大量數據的快速并行輸出。這樣的方案可以充分發揮DSP和FPGA各自的優勢。另外對數模轉換芯片也要求響應速度快,本論文以FPGA為核心,完成了FPGA與其它芯片的接口電路設計。在QuartusⅡ集成環境中進行FPGA的開發,使用VHDL語言和原理圖輸入法進行電路設計。 本文設計的偏振擾偏器在高速控制電路的驅動下,可以實現大量的數據處理,采用多段鈮酸鋰晶體并行工作的方法,可以提高偏振擾偏器的速率。利用本方案制作的擾偏器具有高擾偏速率,適合應用于160Gb/s光通信系統中進行PMD補償。

    標簽: FPGA 160 Gbs PMD

    上傳時間: 2013-04-24

    上傳用戶:suxuan110425

  • 基于FPGA的多路E1反向復用傳輸芯片的設計與實現

    隨著電信數據傳輸對速率和帶寬的要求變得越來越迫切,原有建成的網絡是基于話音傳輸業務的網絡,已不能適應當前的需求.而建設新的寬帶網絡需要相當大的投資且建設工期長,無法滿足特定客戶對高速數據傳輸的近期需求.反向復用技術是把一個單一的高速數據流在發送端拆散并放在兩個或者多個低速數據鏈路上進行傳輸,在接收端再還原為高速數據流.該文提出一種基于FPGA的多路E1反向復用傳輸芯片的設計方案,使用四個E1構成高速數據的透明傳輸通道,支持E1線路間最大相對延遲64ms,通過鏈路容量調整機制,可以動態添加或刪除某條E1鏈路,實現靈活、高效的利用現有網絡實現視頻、數據等高速數據的傳輸,能夠節省帶寬資源,降低成本,滿足客戶的需求.系統分為發送和接收兩部分.發送電路實現四路E1的成幀操作,數據拆分采用線路循環與幀間插相結合的方法,A路插滿一幀(30時隙)后,轉入B路E1間插數據,依此類推,循環間插所有的數據.接收電路進行HDB3解碼,幀同步定位(子幀同步和復幀同步),線路延遲判斷,FIFO和SDRAM實現多路數據的對齊,最后按照約定的高速數據流的幀格式輸出數據.整個數字電路采用Verilog硬件描述語言設計,通過前仿真和后仿真的驗證.以30萬門的FPGA器件作為硬件實現,經過綜合和布線,特別是寫約束和增量布線手動調整電路的布局,降低關鍵路徑延時,最終滿足設計要求.

    標簽: FPGA 多路 傳輸 片的設計

    上傳時間: 2013-07-16

    上傳用戶:asdkin

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