簡單的串列埠自我測試持式 測試硬體電路是否正確
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上傳時(shí)間: 2015-04-25
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FastReport3.0程序設(shè)計(jì)手冊,愛好編程的朋友可以參考本手冊.
標(biāo)簽: FastReport 3.0 手冊 程序
上傳時(shí)間: 2014-11-10
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一本對象程序設(shè)計(jì) For Delphi的書籍,內(nèi)容詳細(xì)講解了Delphi的面向?qū)幊谭椒ㄅc技巧!
標(biāo)簽: Delphi For 程序
上傳時(shí)間: 2015-04-27
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寫一個(gè)程式將n個(gè)整數(shù)相加, 輸入檔的第一行是一個(gè)整數(shù)n, 接著n行每一行是一個(gè)整數(shù), 你的程式要將這些整數(shù)相加並將結(jié)果輸出, 其中每個(gè)整數(shù)為不超過50位數(shù)的十進(jìn)位數(shù)字
標(biāo)簽: 程式
上傳時(shí)間: 2015-05-03
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隆重推出NO.7信令系統(tǒng)(SS7)之國家標(biāo)準(zhǔn)(中文)—— NO7-2M高速信令鏈路(MTP部分)yd1125
標(biāo)簽: NO 1125 MTP SS7
上傳時(shí)間: 2013-12-19
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手機(jī)遊戲,把數(shù)字排以順序,初學(xué)人士學(xué)習(xí)用
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上傳時(shí)間: 2013-12-25
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設(shè)計(jì)VHDL24小時(shí)的時(shí)鐘,去除了按鍵彈跳現(xiàn)象
標(biāo)簽: VHDL 24
上傳時(shí)間: 2013-12-23
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Oracle9iデータベース物理設(shè)計(jì)方針表領(lǐng)域編
標(biāo)簽: Oracle9i 物理
上傳時(shí)間: 2015-05-23
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PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計(jì)階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率, 降低因設(shè)計(jì)而重工之浪費(fèi).
標(biāo)簽: Layout 1.70 Rule PCB
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完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實(shí)現(xiàn)精簡電路
標(biāo)簽: convolution transection circular encoder
上傳時(shí)間: 2014-01-20
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