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高速數(shù)(shù)字信號(hào)

  • 利用高速FPGA實現(xiàn)PCI總線接口的設(shè)計方案

    PCI是一種高性能的局部總線規(guī)范，可實現(xiàn)各種功能標(biāo)準(zhǔn)的PCI總線卡。本文簡要介紹了PCI總線的特點、信號與命令，提出了一種利用高速FPGA實現(xiàn)PCI總線接口的設(shè)計方案。\r\n

    標(biāo)簽： FPGA PCI 總線接口 設(shè)計方案

    上傳時間： 2013-08-30

    上傳用戶：brain kung

  • 基于FPGA的高階高速F IR濾波器的設(shè)計與實現(xiàn)方法

    提出了一種基于FPGA的高階高速F IR濾波器的設(shè)計與實現(xiàn)方法。通過一個169階的均方根\r\n升余弦滾降濾波器的設(shè)計,介紹了如何應(yīng)用流水線技術(shù)來設(shè)計高階高速F IR濾波器,并且對所設(shè)計的\r\nFIR濾波器性能、資源占用進行了分析。

    標(biāo)簽： FPGA 濾波器 實現(xiàn)方法

    上傳時間： 2013-08-31

    上傳用戶：小火車?yán)怖怖?/p>

  • 數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述

    數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述，集成在一個模塊中，提供VHDL源程序供大家學(xué)習(xí)和討論。\r\n

    標(biāo)簽： VHDL 寄存器 數(shù)控振蕩器 加法器

    上傳時間： 2013-09-04

    上傳用戶：a471778

  • 利用Allegro進行差分信號（Differential Signal）在高速電路設(shè)計需要注意的問題

    差分信號（Differential Signal）在高速電路設(shè)計中的應(yīng)用越來越廣泛，差分線大多為電路中最關(guān)鍵的信號，差分線布線的好壞直接影響到PCB板子信號質(zhì)量。

    標(biāo)簽： Differential Allegro Signal 差分信號

    上傳時間： 2013-09-04

    上傳用戶：jennyzai

  • 數(shù)據(jù)管理：包括司機基本信息、汽車基本信息、車輛事故信息、車輛維修信

    1．?dāng)?shù)據(jù)管理：包括司機基本信息、汽車基本信息、車輛事故信息、車輛維修信\r\n息等的管理；\r\n2．派車運營記錄管理：登記派車的情況、進行派車修改；\r\n來確定庫存是否有需要的車型，為賣車做好準(zhǔn)備；\r\n3．查詢管理：能夠根據(jù)車輛編號和派車日期查詢當(dāng)日的派車情況，并能進行統(tǒng)\r\n計派車次數(shù)等；\r\n 4．系統(tǒng)管理：用戶管理和系統(tǒng)退出等。\r\n

    標(biāo)簽： 數(shù)據(jù)管理 汽車

    上傳時間： 2013-09-09

    上傳用戶：wanqunsheng

  • AN-835高速ADC測試和評估

    本應(yīng)用筆記將介紹ADI公司高速轉(zhuǎn)換器部門用來評估高速ADC的特征測試和生產(chǎn)測試方法。本應(yīng)用筆記僅供參考，不能替代產(chǎn)品數(shù)據(jù)手冊

    標(biāo)簽： 835 ADC AN 測試

    上傳時間： 2014-12-23

    上傳用戶：zhaiye

  • 高速數(shù)字電路測試技術(shù)

    高速數(shù)字電路測試技術(shù)

    標(biāo)簽： 高速數(shù)字電路 測試技術(shù)

    上傳時間： 2013-11-17

    上傳用戶：hakim

  • 信噪比估計方法研究

    在QPSK調(diào)制方式下，分別研究推導(dǎo)了基于輔助數(shù)據(jù)的極大似然比信噪比估計算法研究、基于矩的信噪比估計算法研究以及基于高階累積量的信噪比估計算法。通過仿真比較了信噪比估計算法的性能，著重分析比較了采用的迭代次數(shù)及數(shù)據(jù)長度等參數(shù)對算法性能的影響，最終根據(jù)算法各自的特點給出了相應(yīng)的適用范圍。

    標(biāo)簽： 信噪比 方法研究

    上傳時間： 2013-10-20

    上傳用戶：15736969615

  • 基于CORDIC算法的高速ODDFS電路設(shè)計

    為了滿足現(xiàn)代高速通信中頻率快速轉(zhuǎn)換的需求，基于坐標(biāo)旋轉(zhuǎn)數(shù)字計算（CORDIC，Coordinate Rotation Digital Computer）算法完成正交直接數(shù)字頻率合成（ODDFS，Orthogonal Direct Digital Frequency Synthesizer）電路設(shè)計方案。采用MATLAB和Xilinx System Generator開發(fā)工具搭建電路的系統(tǒng)模型，通過現(xiàn)場可編程門陣列（FPGA，F(xiàn)ield Programmable Gate Array）完成電路的寄存器傳輸級（RTL，Register Transfer Level）驗證，仿真結(jié)果表明電路設(shè)計具有很高的有效性和可行性。

    標(biāo)簽： CORDIC ODDFS 算法 電路設(shè)計

    上傳時間： 2013-11-09

    上傳用戶：hfnishi

  • 16位10 MSPS ADC AD7626的單端轉(zhuǎn)差分高速驅(qū)動電路

    圖1所示電路可將高頻單端輸入信號轉(zhuǎn)換為平衡差分信號，用于驅(qū)動16位10 MSPS PulSAR® ADC AD7626。該電路采用低功耗差分放大器ADA4932-1來驅(qū)動ADC，最大限度提升AD7626的高頻輸入信號音性能。此器件組合的真正優(yōu)勢在于低功耗、高性能

    標(biāo)簽： MSPS 7626 ADC AD

    上傳時間： 2013-10-21

    上傳用戶：佳期如夢

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