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高速<b>并行</b>

本源碼是高速并行乘法器的設計源碼

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用HDPLD實現的高速并行乘法器

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高速并行信號處理板數據接口與控制的FPGA設計

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高速并行信號處理板數據接口與控制的FPGA設計.rar

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基于FPGA的高速串行接口模塊仿真設計.rar

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并行接口

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8255A可編程并行接口

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基于FPGA的高速串行傳輸接口研究與實現

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基于FPGA實現的高速串行交換模塊實現方法研究

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基于RocketIO的高速串行協議設計與實現

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