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顯示芯片

  • 賽靈思FPGA芯片架構分析

    賽靈思FPGA芯片論文,值得一看。

    標簽: FPGA 賽靈思 芯片架構

    上傳時間: 2014-12-28

    上傳用戶:1583264429

  • 用FPGA實現RS485通信接口芯片

    在點對多點主從通信系統中,需要合適的接口形式和通信協議實現主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標準接口形式。當選擇主從多點同步通信方式時,工作過程與幀格式符合HDLC/SDLC協議。介紹了采用VHDL 語言在FPGA 上實現的以HDLC/ SDLC 協議控制為基礎的RS - 485 通信接口芯片。實驗表明,這種接口芯片操作簡單、體積小、功耗低、可靠性高,極具實用價值。

    標簽: FPGA 485 RS 通信接口

    上傳時間: 2013-11-02

    上傳用戶:zhf01y

  • MagicSOPC例程編譯異常及解決方法

    1.1 問題產生的環境1.1.1 軟件環境1. PC機的系統為Microsoft Window XP Professional版本2002 Service Pack 2;2. Quartus II V7.0軟件,并安裝了MegaCore IP V7.0;3. NiosII IDE 7.0軟件。1.1.2 硬件環境核心板的芯片是EP2C35F672C8N的MagicSOPC實驗箱的硬件系統。硬件的工作環境是在普通的環境下。1.2 問題的現象在使用MagicSOPC實驗箱的光盤例程時,使用Quartus II編譯工程時出現編譯錯誤,錯誤提示信息如圖1.1、圖1.2所示。

    標簽: MagicSOPC 編譯

    上傳時間: 2013-11-18

    上傳用戶:zhyiroy

  • 擴頻通信芯片STEL-2000A的FPGA實現

    針對傳統集成電路(ASIC)功能固定、升級困難等缺點,利用FPGA實現了擴頻通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核實現NCO模塊,在下變頻模塊調用了硬核乘法器并引入CIC濾波器進行低通濾波,給出了DQPSK解調的原理和實現方法,推導出一種簡便的引入?仔/4固定相移的實現方法。采用模塊化的設計方法使用VHDL語言編寫出源程序,在Virtex-II Pro 開發板上成功實現了整個系統。測試結果表明該系統正確實現了STEL-2000A的核心功能。 Abstract:  To overcome drawbacks of ASIC such as fixed functionality and upgrade difficulty, FPGA was used to realize the core functions of STEL-2000A. This paper used the DDS IP core provided by ISE to realize the NCO module, called hard core multiplier and implemented CIC filter in the down converter, described the principle and implementation detail of the demodulation of DQPSK, and derived a simple method to introduce a fixed phase shift of ?仔/4. The VHDL source code was designed by modularity method , and the complete system was successfully implemented on Virtex-II Pro development board. Test results indicate that this system successfully realize the core function of the STEL-2000A.

    標簽: STEL 2000 FPGA 擴頻通信

    上傳時間: 2013-11-06

    上傳用戶:liu123

  • Xilinx FPGA全局時鐘資源的使用方法

    目前,大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求,一般在FPGA設計中采用全局時鐘資源驅動設計的主時鐘,以達到最低的時鐘抖動和延遲。 FPGA全局時鐘資源一般使用全銅層工藝實現,并設計了專用時鐘緩沖與驅動結構,從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設計的需要,Xilinx的FPGA中集成的專用時鐘資源與數字延遲鎖相環(DLL)的數目不斷增加,最新的 Virtex II器件最多可以提供16個全局時鐘輸入端口和8個數字時鐘管理模塊(DCM)。與全局時鐘資源相關的原語常用的與全局時鐘資源相關的Xilinx器件原語包括:IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等,如圖1所示。  

    標簽: Xilinx FPGA 全局時鐘資源

    上傳時間: 2014-01-01

    上傳用戶:maqianfeng

  • 運營商級的eoc單芯片接入解決方案

    新一代運營商級的EOC單芯片接入解決方案。

    標簽: eoc 單芯片 方案

    上傳時間: 2014-12-29

    上傳用戶:qazxsw

  • 遠距離無線發射芯片MICRF102的原理與應用

    遠距離無線發射芯片MICRF102的原理與應用

    標簽: MICRF 102 無線發射芯片

    上傳時間: 2013-10-17

    上傳用戶:qq527891923

  • 藍牙模塊原理圖(PCB板+BC3+Flash的芯片)

    藍牙模塊原理圖內容有藍牙耳機的PCB板+BC3+Flash的芯片。

    標簽: Flash PCB BC 藍牙模塊

    上傳時間: 2013-11-15

    上傳用戶:suicone

  • 紅外熱釋電處理芯片BISS0001

    紅外熱釋電處理芯片BISS0001

    標簽: BISS 0001 紅外熱釋電處理芯片

    上傳時間: 2014-12-29

    上傳用戶:1234567890qqq

  • 紅紅外熱釋電處理芯片BISS0001及配套的熱釋電元件RE200B

    紅紅外熱釋電處理芯片BISS0001及配套的熱釋電元件RE200B

    標簽: BISS 0001 200B 200

    上傳時間: 2014-01-18

    上傳用戶:zhangjinzj

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