開(kāi)發(fā)與利用新能源是我國(guó)21世紀(jì)的重要能源戰(zhàn)略。風(fēng)能是一種“取之不盡，用之不竭”、環(huán)境友好的可持續(xù)性能源，已受到了越來(lái)越廣泛的重視，并成為發(fā)展最快的新型能源。但是風(fēng)電具有間歇性和隨機(jī)性的固有缺點(diǎn)，隨著大量的風(fēng)力發(fā)電接入電網(wǎng)，勢(shì)必會(huì)對(duì)電力系統(tǒng)的安全、穩(wěn)定運(yùn)行以及保證電能質(zhì)量帶來(lái)嚴(yán)峻挑戰(zhàn)，從而限制風(fēng)力發(fā)電的發(fā)展規(guī)模。風(fēng)電場(chǎng)短期風(fēng)速和發(fā)電功率預(yù)測(cè)是解決該問(wèn)題的有效途徑之一。中國(guó)的風(fēng)電場(chǎng)大都是集中的、大容量的風(fēng)電場(chǎng)，而且處于電網(wǎng)建設(shè)相對(duì)比較薄弱的地區(qū)，因此，中國(guó)更需要進(jìn)行風(fēng)電場(chǎng)短期風(fēng)速和發(fā)電功率預(yù)測(cè)的研究，而發(fā)電功率的預(yù)測(cè)主要源自風(fēng)速的預(yù)測(cè)。在此背景下，選擇風(fēng)電場(chǎng)短期風(fēng)速預(yù)測(cè)方法作為主要研究?jī)?nèi)容，主要包括以下幾個(gè)方面： 首先運(yùn)用統(tǒng)計(jì)學(xué)方法來(lái)分析風(fēng)速的時(shí)間序列特性及其預(yù)測(cè)方法和應(yīng)用特點(diǎn)，說(shuō)明現(xiàn)實(shí)中的風(fēng)速序列具有很強(qiáng)的非平穩(wěn)性。然后運(yùn)用具有“數(shù)字顯微鏡”之美譽(yù)的小波變換來(lái)分析歷史紀(jì)錄的風(fēng)速數(shù)據(jù)，通過(guò)運(yùn)用二進(jìn)正交小波變換Mallat算法對(duì)香港和河西走廊地區(qū)風(fēng)速序列進(jìn)行分解和重構(gòu)，分離出風(fēng)速序列中的低頻信息和高頻信息。對(duì)Mallat算法分解后的信號(hào)，運(yùn)用最小二乘支持向量機(jī)分別進(jìn)行向前一步預(yù)測(cè)，然后再把各預(yù)測(cè)結(jié)果合成，得到預(yù)測(cè)值。建立了基于小波變換和最小二乘支持向量機(jī)的短期風(fēng)速預(yù)測(cè)方法。應(yīng)用Matlab對(duì)該算法進(jìn)行了仿真，仿真試驗(yàn)表明，小波變換是非平穩(wěn)風(fēng)速序列時(shí)頻分析的有效工具，對(duì)風(fēng)速序列的高頻和低頻信息起到很好的分離作用；最小二乘支持向量機(jī)的應(yīng)用提高了預(yù)測(cè)的準(zhǔn)確性。應(yīng)用香港地區(qū)與河西走廊地區(qū)小時(shí)平均風(fēng)速歷史數(shù)據(jù)，驗(yàn)證了方法的有效性。
標(biāo)簽： 風(fēng)電場(chǎng) 風(fēng)速
上傳時(shí)間： 2013-04-24
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本文結(jié)合中國(guó)科技大學(xué)大規(guī)模集成電路實(shí)驗(yàn)室和中國(guó)科學(xué)院上海技術(shù)物理研究所合作的星載紅外相機(jī)項(xiàng)目，為了解決紅外相機(jī)上的不同波段的紅外探測(cè)元陣列存在的非均勻性問(wèn)題，對(duì)紅外焦平面探測(cè)元陣列存在的非均勻性問(wèn)題展開(kāi)了深入的分析和研究。 主要研究和分析了兩類(lèi)算法的基本原理，重點(diǎn)研究和實(shí)現(xiàn)了定標(biāo)校正算法，通過(guò)對(duì)積分球定標(biāo)數(shù)據(jù)進(jìn)行深入的分析，將探測(cè)元分成線(xiàn)性探測(cè)元和非線(xiàn)性探測(cè)元，對(duì)線(xiàn)性探測(cè)元采用兩點(diǎn)校正法，對(duì)非線(xiàn)性探測(cè)元采用多點(diǎn)分段校正算法，在利用FPGA硬件實(shí)現(xiàn)非均勻校正時(shí)，分析設(shè)計(jì)了基于乘法運(yùn)算和加法運(yùn)算的FPGA實(shí)現(xiàn)，在基于乘加器運(yùn)算的FPGA實(shí)現(xiàn)中。設(shè)計(jì)出了乘法和加法整體運(yùn)算的乘加器，內(nèi)部采用流水線(xiàn)wallace樹(shù)壓縮結(jié)構(gòu)，大大加快乘法和加法的速度。
上傳時(shí)間： 2013-04-24
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特點(diǎn) 精確度0.1%滿(mǎn)刻度±1位數(shù) 可直接量測(cè)交直流電壓(AC/DC 20~265V)無(wú)需另接電源 精密濾波整流,均方根值校正 尺寸小(24x48x50mm),穩(wěn)定性 分離式端子,配線(xiàn)容易 CE認(rèn)證
上傳時(shí)間： 2013-11-05
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電路主要包括以下七個(gè)單元電路：正弦波產(chǎn)生電路、正弦波放大及電平變換電路、峰值檢測(cè)電路、增益控制電路、三角波產(chǎn)生電路、比較電路、低通濾波電路。正弦波產(chǎn)生電路采用文氏橋正弦波振蕩電路，由放大電路、反饋電路（正反饋）、選頻網(wǎng)絡(luò)（和反饋電路一起）、穩(wěn)幅電路構(gòu)成，它的振蕩頻率為：f=1/(2Π*RC)，由R4和C1構(gòu)成RC并聯(lián)振蕩，產(chǎn)生正弦波，與R5和C2構(gòu)成選頻網(wǎng)絡(luò)，同時(shí)R5和C2又構(gòu)成該電路的正反饋；穩(wěn)幅電路是由該電路的負(fù)反饋構(gòu)成，當(dāng)振幅過(guò)大時(shí)，二極管導(dǎo)通，R3短路，Av=1+（R2+R3）/R1減小，振幅減小，反之Av=1+（R2+R3）/R1增大，振幅增大，達(dá)到穩(wěn)幅效果，從而保證正弦波的正常產(chǎn)生。正弦波放大及電平變換電路由R10，R7分別與R15滑動(dòng)電阻部分相連，通過(guò)滑動(dòng)R15來(lái)分VCC和VEE的電壓，通過(guò)放大器正相來(lái)抬高或降低正弦波來(lái)達(dá)到特定范圍內(nèi)的幅值，滑動(dòng)電阻R6與地相連，又與放大器反相端相連，滑動(dòng)R6分壓來(lái)改變振幅，后又由R9和R8構(gòu)成反饋來(lái)達(dá)到放大的效果，從而達(dá)到正弦波放大及電平變化的目的。峰值檢測(cè)電路是由正弦波放大及電平變換電路產(chǎn)生的正弦波送入電壓跟隨器的正相端，通過(guò)兩個(gè)反向二極管后再連電容，快速充放電達(dá)到峰值，然后再送回正弦波放大及電平變換電路的反相端，構(gòu)成負(fù)反饋，達(dá)到增益穩(wěn)幅控制效果三角波產(chǎn)生電路主要由兩個(gè)NPN型三極管Q3Q4，一個(gè)PNP型三極管Q2，兩個(gè)電容C3C4，兩個(gè)非門(mén)，一個(gè)滑動(dòng)電阻R16組成，通過(guò)充放電后經(jīng)過(guò)非門(mén)產(chǎn)生三角波。比較電路產(chǎn)生的正弦波送入放大器的正相端，產(chǎn)生的三角波送入放大器的反相端，通過(guò)作差比較產(chǎn)SPWM波，后又經(jīng)過(guò)由R22和C8組成的低通濾波電路，還原正弦波。
上傳時(shí)間： 2021-10-30
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在工業(yè)控制領(lǐng)域，多種現(xiàn)場(chǎng)總線(xiàn)標(biāo)準(zhǔn)共存的局面從客觀上促進(jìn)了工業(yè)以太網(wǎng)技術(shù)的迅速發(fā)展，國(guó)際上已經(jīng)出現(xiàn)了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業(yè)以太網(wǎng)協(xié)議。將傳統(tǒng)的商用以太網(wǎng)應(yīng)用于工業(yè)控制系統(tǒng)的現(xiàn)場(chǎng)設(shè)備層的最大障礙是以太網(wǎng)的非實(shí)時(shí)性，而實(shí)現(xiàn)現(xiàn)場(chǎng)設(shè)備間的高精度時(shí)鐘同步是保證以太網(wǎng)高實(shí)時(shí)性的前提和基礎(chǔ)。 IEEE 1588定義了一個(gè)能夠在測(cè)量和控制系統(tǒng)中實(shí)現(xiàn)高精度時(shí)鐘同步的協(xié)議——精確時(shí)間協(xié)議(Precision Time Protocol)。PTP協(xié)議集成了網(wǎng)絡(luò)通訊、局部計(jì)算和分布式對(duì)象等多項(xiàng)技術(shù)，適用于所有通過(guò)支持多播的局域網(wǎng)進(jìn)行通訊的分布式系統(tǒng)，特別適合于以太網(wǎng)，但不局限于以太網(wǎng)。PTP協(xié)議能夠使異質(zhì)系統(tǒng)中各類(lèi)不同精確度、分辨率和穩(wěn)定性的時(shí)鐘同步起來(lái)，占用最少的網(wǎng)絡(luò)和局部計(jì)算資源，在最好情況下能達(dá)到系統(tǒng)級(jí)的亞微級(jí)的同步精度。 基于PC機(jī)軟件的時(shí)鐘同步方法，如NTP協(xié)議，由于其實(shí)現(xiàn)機(jī)理的限制，其同步精度最好只能達(dá)到毫秒級(jí)；基于嵌入式軟件的時(shí)鐘同步方法，將時(shí)鐘同步模塊放在操作系統(tǒng)的驅(qū)動(dòng)層，其同步精度能夠達(dá)到微秒級(jí)。現(xiàn)場(chǎng)設(shè)備間微秒級(jí)的同步精度雖然已經(jīng)能滿(mǎn)足大多數(shù)工業(yè)控制系統(tǒng)對(duì)設(shè)備時(shí)鐘同步的要求，但是對(duì)于運(yùn)動(dòng)控制等需求高精度定時(shí)的系統(tǒng)來(lái)說(shuō)，這仍然不夠。基于嵌入式軟件的時(shí)鐘同步方法受限于操作系統(tǒng)中斷響應(yīng)延遲時(shí)間不一致、晶振頻率漂移等因素，很難達(dá)到亞微秒級(jí)的同步精度。 本文設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA的時(shí)鐘同步方法，以IEEE 1588作為時(shí)鐘同步協(xié)議，以Ethernet作為底層通訊網(wǎng)絡(luò)，以嵌入式軟件形式實(shí)現(xiàn)TCP/IP通訊，以數(shù)字電路形式實(shí)現(xiàn)時(shí)鐘同步模塊。這種方法充分利用了FPGA的特點(diǎn)，通過(guò)準(zhǔn)確捕獲報(bào)文時(shí)間戳和動(dòng)態(tài)補(bǔ)償晶振頻率漂移等手段，相對(duì)于嵌入式軟件時(shí)鐘同步方法實(shí)現(xiàn)了更高精度的時(shí)鐘同步，并通過(guò)實(shí)驗(yàn)驗(yàn)證了在以集線(xiàn)器互連的10Mbps以太網(wǎng)上能夠達(dá)到亞微秒級(jí)的同步精度。
上傳時(shí)間： 2013-08-04
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電液位置伺服系統(tǒng)具有控制精度高、響應(yīng)速度快、輸出功率大、信號(hào)處理靈活、易于實(shí)現(xiàn)各種參量反饋等優(yōu)點(diǎn)，因此它已經(jīng)遍及國(guó)民經(jīng)濟(jì)和軍事工業(yè)的各個(gè)技術(shù)領(lǐng)域。近年來(lái)，對(duì)電液位置伺服系統(tǒng)的快速性、穩(wěn)定性、準(zhǔn)確性等控制性能提出了新的要求，作為電液位置伺服系統(tǒng)核心的控制器，起到更為關(guān)鍵的作用。 現(xiàn)階段，嵌入式微處理器以其小型、專(zhuān)用、便攜、高可靠的特點(diǎn)，已經(jīng)在工業(yè)控制領(lǐng)域得到了廣泛的應(yīng)用，如工業(yè)過(guò)程、遠(yuǎn)程監(jiān)控、智能儀器儀表、機(jī)器人控制、數(shù)控系統(tǒng)等，嵌入式微處理器嵌入實(shí)時(shí)操作系統(tǒng)，可以克服傳統(tǒng)的基于單片機(jī)控制系統(tǒng)功能不足和基于PC的控制系統(tǒng)非實(shí)時(shí)性的缺點(diǎn)，其性能、可靠性等都能滿(mǎn)足電液位置伺服系統(tǒng)控制的要求，在控制領(lǐng)域具有廣泛的應(yīng)用前景。 本文以實(shí)驗(yàn)室的電液位置伺服系統(tǒng)為研究對(duì)象，按照系統(tǒng)的控制要求，提出以ARM9(S3C2410)微處理器為核心的控制器對(duì)電液位置伺服系統(tǒng)進(jìn)行控制的一種方案，設(shè)計(jì)了一種新型的基于ARM9(S3C2410)微處理器的電液位置伺服控制器。本系統(tǒng)控制器的開(kāi)發(fā)設(shè)計(jì)中，在以ARM9(S3C2410)微處理器為核心的控制器基礎(chǔ)上，通過(guò)外部擴(kuò)展，使得系統(tǒng)控制器具有豐富的硬件資源，開(kāi)發(fā)了A/D轉(zhuǎn)換電路、D/A(PWM)轉(zhuǎn)換電路、伺服放大電路、串行接口等電路，同時(shí)為了使得控制器的程序代碼具有較強(qiáng)的可讀性、可維護(hù)性、可擴(kuò)展性，使用了操作系統(tǒng)，通過(guò)比較選擇了uC/OS-Ⅱ?qū)崟r(shí)內(nèi)核，并成功移植到ARM9(S3C2410)微處理器中，并編寫(xiě)了A/D、數(shù)字濾波、D/A(PWM)等軟件程序，通過(guò)編譯、調(diào)試、驗(yàn)證，程序運(yùn)行正常。在對(duì)電液位置伺服系統(tǒng)進(jìn)行控制策略的選擇中，分別采用PID、滑模變結(jié)構(gòu)、模糊自學(xué)習(xí)滑模三種控制策略進(jìn)行仿真比較，得出采用模糊自學(xué)習(xí)滑模控制策略更有利于系統(tǒng)控制。
標(biāo)簽： ARM 微處理器 伺服控制系統(tǒng) 電液位置
上傳時(shí)間： 2013-04-24
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近年來(lái)，隨著生物識(shí)別技術(shù)的興起，虹膜識(shí)別技術(shù)被日益關(guān)注。由于虹膜識(shí)別技術(shù)對(duì)個(gè)體識(shí)別具有高度的可靠性，已成為目前生物識(shí)別中最有發(fā)展前景的識(shí)別技術(shù)之一。與其它生物識(shí)別技術(shù)相比，虹膜識(shí)別技術(shù)具有唯一性、穩(wěn)定性、非侵犯性、不易偽造性和活體特性等優(yōu)勢(shì)。因此，虹膜識(shí)別技術(shù)具有廣闊的使用前景和很好的經(jīng)濟(jì)效益，越來(lái)越受到國(guó)內(nèi)外有關(guān)研究人員的重視。 目前，虹膜識(shí)別產(chǎn)品大多都是基于PC平臺(tái)的，在便攜性、穩(wěn)定性和安全性方面還存在一些問(wèn)題。為了克服以上的缺點(diǎn)，本文構(gòu)架了基于DSP和FPGA的嵌入式虹膜識(shí)別硬件平臺(tái)，使虹膜識(shí)別技術(shù)可應(yīng)用與更多的領(lǐng)域。 本文的主要工作如下： 1．設(shè)計(jì)了一個(gè)嵌入式硬件系統(tǒng)，包括DSP處理器、FPGA、COMS圖像傳感器、人機(jī)交互接口和通信接口。同時(shí)，還編寫(xiě)了各硬件模塊的驅(qū)動(dòng)程序。另外，由于系統(tǒng)中DSP工作頻率為300Mhz，另外有些器件工作在100Mhz，因此本文還給出了一些信號(hào)完整性分析和PCB設(shè)計(jì)經(jīng)驗(yàn)。 2．在FPGA設(shè)計(jì)中，編寫(xiě)Verilog程序，完成了虹膜圖像采集模塊、乒乓存儲(chǔ)器切換模塊、圖像采樣模塊以及將采樣后的圖像顯示在TFT彩色液晶上的模塊，最終實(shí)現(xiàn)了虹膜圖像實(shí)時(shí)顯示系統(tǒng)。此外，還設(shè)計(jì)實(shí)現(xiàn)了用于和DSP通信的HPI接口模塊。 3．完成了部分系統(tǒng)應(yīng)用程序設(shè)計(jì)。在使用DSP/BIOS實(shí)時(shí)操作系統(tǒng)的基礎(chǔ)上設(shè)計(jì)了各系統(tǒng)任務(wù)，通過(guò)調(diào)用驅(qū)動(dòng)程序控制和協(xié)調(diào)各硬件模塊，實(shí)現(xiàn)了虹膜識(shí)別功能。 最終，本文實(shí)現(xiàn)了系統(tǒng)設(shè)計(jì)，本設(shè)計(jì)可以快速有效的進(jìn)行虹膜識(shí)別。同時(shí)，由于本系統(tǒng)采用模塊化的軟硬件設(shè)計(jì)技術(shù)，使系統(tǒng)便于快速應(yīng)用于各種場(chǎng)合。
上傳時(shí)間： 2013-04-24
上傳用戶(hù)：qlpqlq
本文在深入分析紅外焦平面陣列熱成像系統(tǒng)工作原理的基礎(chǔ)上，根據(jù)紅外圖像處理系統(tǒng)的實(shí)際應(yīng)用，研究了相應(yīng)的圖像處理算法，為使其實(shí)時(shí)實(shí)現(xiàn)，本文對(duì)算法基于FPGA的高效硬件實(shí)現(xiàn)進(jìn)行了深入研究。首先對(duì)IRFRA器件的工作原理和讀出電路結(jié)構(gòu)進(jìn)行了分析，敘述了相應(yīng)的驅(qū)動(dòng)電路設(shè)計(jì)原理和相關(guān)模擬電路的處理技術(shù)。然后，以本文設(shè)計(jì)的基于FPGA高速紅外圖像處理硬件系統(tǒng)為運(yùn)行平臺(tái)，針對(duì)紅外溫差成像圖像高背景、低對(duì)比度的特點(diǎn)和系統(tǒng)中主要存在的非均勻性圖案噪聲，研究了非均勻性校正和直方圖投影增強(qiáng)算法的實(shí)時(shí)實(shí)現(xiàn)技術(shù)。還將基于FPGA的紅外圖像處理的實(shí)現(xiàn)技術(shù)，拓展到一些空域、頻域及基于直方圖的圖像處理基本算法。其中以紅外增強(qiáng)算法作為重點(diǎn)，引入了一種易于FPGA實(shí)現(xiàn)、基于雙閾值調(diào)節(jié)、可有效改善系統(tǒng)成像質(zhì)量的增強(qiáng)算法。并在FPGA硬件平臺(tái)上成功地實(shí)現(xiàn)了該算法。最后，本系統(tǒng)還將處理后的圖像數(shù)據(jù)轉(zhuǎn)化成了全電視信號(hào)，實(shí)時(shí)地顯示在監(jiān)視器上。實(shí)驗(yàn)結(jié)果表明，本文設(shè)計(jì)的系統(tǒng)，能夠很好地完成大容量數(shù)據(jù)流的實(shí)時(shí)處理，有效地改善了圖像質(zhì)量，顯著提高了圖像顯示效果。
上傳時(shí)間： 2013-07-02
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在工業(yè)控制領(lǐng)域，多種現(xiàn)場(chǎng)總線(xiàn)標(biāo)準(zhǔn)共存的局面從客觀上促進(jìn)了工業(yè)以太網(wǎng)技術(shù)的迅速發(fā)展，國(guó)際上已經(jīng)出現(xiàn)了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業(yè)以太網(wǎng)協(xié)議。將傳統(tǒng)的商用以太網(wǎng)應(yīng)用于工業(yè)控制系統(tǒng)的現(xiàn)場(chǎng)設(shè)備層的最大障礙是以太網(wǎng)的非實(shí)時(shí)性，而實(shí)現(xiàn)現(xiàn)場(chǎng)設(shè)備間的高精度時(shí)鐘同步是保證以太網(wǎng)高實(shí)時(shí)性的前提和基礎(chǔ)。 IEEE 1588定義了一個(gè)能夠在測(cè)量和控制系統(tǒng)中實(shí)現(xiàn)高精度時(shí)鐘同步的協(xié)議——精確時(shí)間協(xié)議(Precision Time Protocol)。PTP協(xié)議集成了網(wǎng)絡(luò)通訊、局部計(jì)算和分布式對(duì)象等多項(xiàng)技術(shù)，適用于所有通過(guò)支持多播的局域網(wǎng)進(jìn)行通訊的分布式系統(tǒng)，特別適合于以太網(wǎng)，但不局限于以太網(wǎng)。PTP協(xié)議能夠使異質(zhì)系統(tǒng)中各類(lèi)不同精確度、分辨率和穩(wěn)定性的時(shí)鐘同步起來(lái)，占用最少的網(wǎng)絡(luò)和局部計(jì)算資源，在最好情況下能達(dá)到系統(tǒng)級(jí)的亞微級(jí)的同步精度。 基于PC機(jī)軟件的時(shí)鐘同步方法，如NTP協(xié)議，由于其實(shí)現(xiàn)機(jī)理的限制，其同步精度最好只能達(dá)到毫秒級(jí)；基于嵌入式軟件的時(shí)鐘同步方法，將時(shí)鐘同步模塊放在操作系統(tǒng)的驅(qū)動(dòng)層，其同步精度能夠達(dá)到微秒級(jí)。現(xiàn)場(chǎng)設(shè)備間微秒級(jí)的同步精度雖然已經(jīng)能滿(mǎn)足大多數(shù)工業(yè)控制系統(tǒng)對(duì)設(shè)備時(shí)鐘同步的要求，但是對(duì)于運(yùn)動(dòng)控制等需求高精度定時(shí)的系統(tǒng)來(lái)說(shuō)，這仍然不夠。基于嵌入式軟件的時(shí)鐘同步方法受限于操作系統(tǒng)中斷響應(yīng)延遲時(shí)間不一致、晶振頻率漂移等因素，很難達(dá)到亞微秒級(jí)的同步精度。 本文設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA的時(shí)鐘同步方法，以IEEE 1588作為時(shí)鐘同步協(xié)議，以Ethernet作為底層通訊網(wǎng)絡(luò)，以嵌入式軟件形式實(shí)現(xiàn)TCP/IP通訊，以數(shù)字電路形式實(shí)現(xiàn)時(shí)鐘同步模塊。這種方法充分利用了FPGA的特點(diǎn)，通過(guò)準(zhǔn)確捕獲報(bào)文時(shí)間戳和動(dòng)態(tài)補(bǔ)償晶振頻率漂移等手段，相對(duì)于嵌入式軟件時(shí)鐘同步方法實(shí)現(xiàn)了更高精度的時(shí)鐘同步，并通過(guò)實(shí)驗(yàn)驗(yàn)證了在以集線(xiàn)器互連的10Mbps以太網(wǎng)上能夠達(dá)到亞微秒級(jí)的同步精度。
上傳時(shí)間： 2013-07-28
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One of the most misunderstood constructs in the Verilog language is the nonblockingassignment. Even very experienced Verilog designers do not fully understand how nonblockingassignments are scheduled in an IEEE compliant Verilog simulator and do not understand whenand why nonblocking assignments should be used. This paper details how Verilog blocking andnonblocking assignments are scheduled, gives important coding guidelines to infer correctsynthesizable logic and details coding styles to avoid Verilog simulation race conditions
上傳時(shí)間： 2013-10-17
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