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雙線性

  • CPU可測試性設計

    可測試性設計(Design-For-Testability,DFT)已經成為芯片設計中不可或缺的重要組成部分。它通過在芯片的邏輯設計中加入測試邏輯提高芯片的可測試性。在高性能通用 CPU 的設計中,可測試性設計技術得到了廣泛的應用。本文結合幾款流行的 CPU,綜述了可應用于通用 CPU 等高性能芯片設計中的各種可測試性方法,包括掃描設計(Scan Design),內建自測試(Built-In Self-Test,BIST),測試點插入(Test Point Insertion),與 IEEE 1149.1標準兼容的邊界掃描設計(Boundary Scan Design,BSD)等技術。

    標簽: 可測試性設計 CPU

    上傳時間: 2021-10-15

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  • 電動汽車逆變器用IGBT驅動電源設計及可用性測試

    電動汽車逆變器用于控制汽車主電機為汽車運行提供動力,IGBT功率模塊是電動汽車逆變器的核心功率器件,其驅動電路是發揮IGBT性能的關鍵電路。驅動電路的設計與工業通用變頻器、風能太陽能逆變器的驅動電路有更為苛刻的技術要求。其中的電源電路受到空間尺寸小、工作溫度高等限制,面臨諸多挑戰。介紹了一種驅動供電電源的設計,并通過實際測試證明其可用性。

    標簽: 電動汽車 逆變器 igbt 驅動 電源

    上傳時間: 2021-10-27

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  • 走向數學叢書 凸性 [史樹中 著] 2011年版

    “走向數學”小叢書,每本小冊子盡量用深入淺出的語言來講述數學的某一問題或方面,使工程技術人員、非數學專業的大學生,甚至具有中學數學水平的人,亦能懂得書中全部或部分含義與內容。這對提高我國人民的數學修養與水平,可能會起些作用。史樹中所著的《凸性》主要介紹了凸集定義、凸集承托定理及其解析證明、凸函數的定義、凸性不等式、凸函數的導數性質、凸函數的次微分和共軛函數、凸分析的兩條基本定理及凸規劃等。

    標簽: 凸性

    上傳時間: 2021-11-03

    上傳用戶:nhhrzh

  • 利用云系統實現電子健康檔案的機密性

    該文檔為利用云系統實現電子健康檔案的機密性簡介文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………

    標簽: 云系統

    上傳時間: 2021-11-19

    上傳用戶:shjgzh

  • 基于場景的光學遙感影像非均勻性校正

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    標簽: 光學遙感影像 非均勻性校正

    上傳時間: 2021-11-21

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  • 醫療器械-可用性工程對醫療器械的應用

    醫療器械-可用性工程對醫療器械的應用

    標簽: 醫療器械

    上傳時間: 2021-11-24

    上傳用戶:qingfengchizhu

  • “斜率補償”是指用電流控制方式時 將一部分鋸齒波電壓加到控制信號上 以改進控制特 性 包括消除諧波振

    “斜率補償”是指用電流控制方式時,將一部分鋸齒波電壓加到控制信號上,以改進控制特性,包括消除諧波振蕩。

    標簽: 斜率補償

    上傳時間: 2021-11-25

    上傳用戶:fliang

  • 基于可分性的多類目標特征選擇算法

    基于可分性的多類目標特征選擇算法這是一份非常不錯的資料,歡迎下載,希望對您有幫助!

    標簽: 特征選擇

    上傳時間: 2021-12-01

    上傳用戶:zhanglei193

  • 互換性與技術測量基礎

    互換性與技術測量基礎這是一份非常不錯的資料,歡迎下載,希望對您有幫助!

    標簽: 測量

    上傳時間: 2022-01-04

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  • cadence-allegro16.6高級教程

    主要內容介紹 Allegro 如何載入 Netlist,進而認識新式轉法和舊式轉法有何不同及優缺點的分析,透過本章學習可以對 Allegro 和 Capture 之間的互動關係,同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉入動作只是針對由 Capture(線路圖部分)產生的 Netlist 轉入 Allegro(Layout部分)1. 在 OrCAD Capture 中設計好線路圖。2. 然後由 OrCAD Capture 產生 Netlist(annotate 是在進行線路圖根據第五步產生的資料進行編改)。 3. 把產生的 Netlist 轉入 Allegro(layout 工作系統)。 4. 在 Allegro 中進行 PCB 的 layout。 5. 把在 Allegro 中產生的 back annotate(Logic)轉出(在實際 layout 時可能對原有的 Netlist 有改動過),並轉入 OrCAD Capture 裏進行回編。

    標簽: cadence allegro

    上傳時間: 2022-04-28

    上傳用戶:kingwide

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