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雙網(wǎng)

  • PWM(可以查500筆的SPWM)由TI官網(wǎng)PWM範(fàn)例改

    PWM(可以查500筆的SPWM)由TI官網(wǎng)PWM範(fàn)例改

    標(biāo)簽: PWM SPWM 500

    上傳時間: 2013-12-11

    上傳用戶:wang0123456789

  • 網(wǎng)際網(wǎng)路socket程式設(shè)計(jì)之聊天程式,Client端,編譯環(huán)境:Bloodshed Dev-C++ 4.9.9.2

    網(wǎng)際網(wǎng)路socket程式設(shè)計(jì)之聊天程式,Client端,編譯環(huán)境:Bloodshed Dev-C++ 4.9.9.2

    標(biāo)簽: Bloodshed socket Client Dev-C

    上傳時間: 2014-01-22

    上傳用戶:hanli8870

  • 從KIMO股價網(wǎng)頁抓取即時股價的程式範(fàn)例

    從KIMO股價網(wǎng)頁抓取即時股價的程式範(fàn)例

    標(biāo)簽: KIMO 程式

    上傳時間: 2014-01-17

    上傳用戶:heart520beat

  • 讀取股市網(wǎng)頁資料~~並列表出來~~~~~~~~

    讀取股市網(wǎng)頁資料~~並列表出來~~~~~~~~

    標(biāo)簽:

    上傳時間: 2013-12-21

    上傳用戶:凌云御清風(fēng)

  • 於嵌入式系統(tǒng)中實(shí)作無線網(wǎng)路之

    於嵌入式系統(tǒng)中實(shí)作無線網(wǎng)路之 於嵌入式系統(tǒng)中實(shí)作無線網(wǎng)路之 於嵌入式系統(tǒng)中實(shí)作無線網(wǎng)路之 於嵌入式系統(tǒng)中實(shí)作無線網(wǎng)路之

    標(biāo)簽: programming

    上傳時間: 2015-03-04

    上傳用戶:1547591994

  • 局域網(wǎng)最常見十大錯誤及解決(一).pdf

    雜志及論文專輯 19冊 720M局域網(wǎng)最常見十大錯誤及解決(一).pdf

    標(biāo)簽:

    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 抓取網(wǎng)路上所有的影片 VideoGet_32x32

    輕鬆下載影片.不避安裝  抓取網(wǎng)路上所有的影片

    標(biāo)簽: VideoGet 32

    上傳時間: 2016-06-10

    上傳用戶:sanon

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點(diǎn)2. Test Point : ATE 測試點(diǎn)供工廠ICT 測試治具使用ICT 測試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點(diǎn)),其原則如下:1. 一般測試點(diǎn)大小均為30-35mil,元件分布較密時,測試點(diǎn)最小可至30mil.測試點(diǎn)與元件PAD 的距離最小為40mil。2. 測試點(diǎn)與測試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點(diǎn)必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 準(zhǔn)確的電源排序可防止系統(tǒng)受損

    諸如電信設(shè)備、存儲模塊、光學(xué)繫統(tǒng)、網(wǎng)絡(luò)設(shè)備、服務(wù)器和基站等許多復(fù)雜繫統(tǒng)都采用了 FPGA 和其他需要多個電壓軌的數(shù)字 IC,這些電壓軌必須以一個特定的順序進(jìn)行啟動和停機(jī)操作,否則 IC 就會遭到損壞。

    標(biāo)簽: 電源排序 防止

    上傳時間: 2014-12-24

    上傳用戶:packlj

  • 理想二極管提供了針對電源布線錯誤的保護(hù)作用

    高可用性繫統(tǒng)常常采用雙路饋送功率分配,旨在實(shí)現(xiàn)冗餘並增強(qiáng)系統(tǒng)的可靠性。“或”二極管把兩路電源一起連接在負(fù)載點(diǎn)上,最常用的是肖特基二極管,目的在於實(shí)現(xiàn)低損耗

    標(biāo)簽: 理想二極管 保護(hù) 電源布線 錯誤

    上傳時間: 2013-10-19

    上傳用戶:BOBOniu

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