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  • 高速PCB設計指南

    高速PCB設計指南之(一~八 )目錄      2001/11/21  一、1、PCB布線2、PCB布局3、高速PCB設計 二、1、高密度(HD)電路設計2、抗干擾技術3、PCB的可靠性設計4、電磁兼容性和PCB設計約束 三、1、改進電路設計規程提高可測性2、混合信號PCB的分區設計3、蛇形走線的作用4、確保信號完整性的電路板設計準則 四、1、印制電路板的可靠性設計 五、1、DSP系統的降噪技術2、POWERPCB在PCB設計中的應用技術3、PCB互連設計過程中最大程度降低RF效應的基本方法 六、1、混合信號電路板的設計準則2、分區設計3、RF產品設計過程中降低信號耦合的PCB布線技巧 七、1、PCB的基本概念2、避免混合訊號系統的設計陷阱3、信號隔離技術4、高速數字系統的串音控制 八、1、掌握IC封裝的特性以達到最佳EMI抑制性能2、實現PCB高效自動布線的設計技巧和要點3、布局布線技術的發展 注:以上內容均來自網上資料,不是很系統,但是對有些問題的分析還比較具體。由于是文檔格式,所以缺圖和表格。另外,可能有小部分內容重復。

    標簽: PCB 設計指南

    上傳時間: 2014-05-15

    上傳用戶:wuchunzhong

  • 磁芯電感器的諧波失真分析

    磁芯電感器的諧波失真分析 摘  要:簡述了改進鐵氧體軟磁材料比損耗系數和磁滯常數ηB,從而降低總諧波失真THD的歷史過程,分析了諸多因數對諧波測量的影響,提出了磁心性能的調控方向。 關鍵詞:比損耗系數, 磁滯常數ηB ,直流偏置特性DC-Bias,總諧波失真THD  Analysis on THD of the fer rite co res u se d i n i nductancShi Yan Nanjing Finemag Technology Co. Ltd., Nanjing 210033   Abstract:    Histrory of decreasing THD by improving the ratio loss coefficient and hysteresis constant of soft magnetic ferrite is briefly narrated. The effect of many factors which affect the harmonic wave testing is analysed. The way of improving the performance of ferrite cores is put forward.  Key words: ratio loss coefficient,hysteresis constant,DC-Bias,THD  近年來,變壓器生產廠家和軟磁鐵氧體生產廠家,在電感器和變壓器產品的總諧波失真指標控制上,進行了深入的探討和廣泛的合作,逐步弄清了一些似是而非的問題。從工藝技術上采取了不少有效措施,促進了質量問題的迅速解決。本文將就此熱門話題作一些粗淺探討。  一、 歷史回顧 總諧波失真(Total harmonic distortion) ,簡稱THD,并不是什么新的概念,早在幾十年前的載波通信技術中就已有嚴格要求<1>。1978年郵電部公布的標準YD/Z17-78“載波用鐵氧體罐形磁心”中,規定了高μQ材料制作的無中心柱配對罐形磁心詳細的測試電路和方法。如圖一電路所示,利用LC組成的150KHz低通濾波器在高電平輸入的情況下測量磁心產生的非線性失真。這種相對比較的實用方法,專用于無中心柱配對罐形磁心的諧波衰耗測試。 這種磁心主要用于載波電報、電話設備的遙測振蕩器和線路放大器系統,其非線性失真有很嚴格的要求。  圖中  ZD   —— QF867 型阻容式載頻振蕩器,輸出阻抗 150Ω, Ld47 —— 47KHz 低通濾波器,阻抗 150Ω,阻帶衰耗大于61dB,       Lg88 ——并聯高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB Ld88 ——并聯高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB FD   —— 30~50KHz 放大器, 阻抗 150Ω, 增益不小于 43 dB,三次諧波衰耗b3(0)≥91 dB, DP  —— Qp373 選頻電平表,輸入高阻抗, L ——被測無心罐形磁心及線圈, C  ——聚苯乙烯薄膜電容器CMO-100V-707APF±0.5%,二只。 測量時,所配用線圈應用絲包銅電磁線SQJ9×0.12(JB661-75)在直徑為16.1mm的線架上繞制 120 匝, (線架為一格) , 其空心電感值為 318μH(誤差1%) 被測磁心配對安裝好后,先調節振蕩器頻率為 36.6~40KHz,  使輸出電平值為+17.4 dB, 即選頻表在 22′端子測得的主波電平 (P2)為+17.4 dB,然后在33′端子處測得輸出的三次諧波電平(P3), 則三次諧波衰耗值為:b3(+2)= P2+S+ P3 式中:S 為放大器增益dB 從以往的資料引證, 就可以發現諧波失真的測量是一項很精細的工作,其中測量系統的高、低通濾波器,信號源和放大器本身的三次諧波衰耗控制很嚴,阻抗必須匹配,薄膜電容器的非線性也有相應要求。濾波器的電感全由不帶任何磁介質的大空心線圈繞成,以保證本身的“潔凈” ,不至于造成對磁心分選的誤判。 為了滿足多路通信整機的小型化和穩定性要求, 必須生產低損耗高穩定磁心。上世紀 70 年代初,1409 所和四機部、郵電部各廠,從工藝上改變了推板空氣窯燒結,出窯后經真空罐冷卻的落后方式,改用真空爐,并控制燒結、冷卻氣氛。技術上采用共沉淀法攻關試制出了μQ乘積 60 萬和 100 萬的低損耗高穩定材料,在此基礎上,還實現了高μ7000~10000材料的突破,從而大大縮短了與國外企業的技術差異。當時正處于通信技術由FDM(頻率劃分調制)向PCM(脈沖編碼調制) 轉換時期, 日本人明石雅夫發表了μQ乘積125 萬為 0.8×10 ,100KHz)的超優鐵氧體材料<3>,其磁滯系數降為優鐵

    標簽: 磁芯 電感器 諧波失真

    上傳時間: 2014-12-24

    上傳用戶:7891

  • 1.5-600平方負載力距與電壓降

    電工技術

    標簽: 1.5 600 負載 電壓

    上傳時間: 2013-10-26

    上傳用戶:cjf0304

  • 逆變器電壓補償參數離線辨識及其應用研究

    在異步電機三相逆變中,當電機低速運行時,因輸出電壓較低,由死區時間和信號傳播延遲造成的電壓損失會使輸出電流發生明顯的畸變。為改善逆變器輸出電流波形,需要進行電壓補償。常用的電壓補償方法有電壓反饋補償、電流反饋補償、死區解耦補償、自適應死區補償等,最常用且容易實現的方法就是電流反饋補償。電流反饋補償需要知道電流采樣通道及開關器件延遲、開關器件壓降、死區時間等參數,為避免直接查閱芯片資料造成的參數誤差,本文提出了一種逆變器電壓補償參數離線辨識方法,并研究了該方法在電壓補償中的應用。

    標簽: 逆變器 電壓補償 參數 應用研究

    上傳時間: 2013-10-30

    上傳用戶:wangdean1101

  • 寬輸入范圍1A LED驅動器利用汽車和12V AC電源給高亮度LED供電

    LT3474 是一款支持多種電源的降壓型 1ALED 驅動器,具有一個 4V 至 36V 的寬輸入電壓範圍,並可通過編程以高達 88% 的效率來輸送 35mA 至1A 的 LED 電流

    標簽: LED 12V AC電源

    上傳時間: 2013-11-09

    上傳用戶:xhwst

  • 采用集成電流檢測來監視和保護汽車系統

    對於集成電路而言,汽車是一種苛刻的使用環境,這裡,引擎罩下的工作溫度範圍可寬達 -40°C 至 125°C,而且,在電池電壓總線上出現大瞬變偏移也是預料之中的事

    標簽: 集成 電流檢測 保護 汽車系統

    上傳時間: 2013-11-20

    上傳用戶:zhaiye

  • 單個電阻器設定DCDC轉換器的正或負輸出

    對於許多電子子繫統而言,比如:VFD (真空熒光顯示屏)、TFT-LCD、GPS 或 DSL 應用,僅采用一個簡單的降壓或升壓型 DC/DC 轉換器並不能滿足其要求

    標簽: DCDC 電阻器 設定

    上傳時間: 2014-12-24

    上傳用戶:nostopper

  • 降壓型同步控制器可采用低至2.2V的工作輸入電源

    許多電信和計算應用都需要一個能夠從非常低輸入電壓獲得工作電源的高效率降壓型 DC/DC 轉換器。高輸出功率同步控制器 LT3740 就是這些應用的理想選擇,該器件能把 2.2V 至 22V 的輸入電源轉換為低至 0.8V 的輸出,並提供 2A 至 20A 的負載電流。其應用包括分布式電源繫統、負載點調節和邏輯電源轉換。

    標簽: 2.2 降壓型 同步控制器 輸入

    上傳時間: 2013-12-30

    上傳用戶:arnold

  • 一種無片外電容LDO的瞬態增強電路設計

    利用RC高通電路的思想,針對LDO提出了一種新的瞬態增強電路結構。該電路設計有效地加快了LDO的瞬態響應速度,而且瞬態增強電路工作的過程中,系統的功耗并沒有增加。此LDO芯片設計采用SMIC公司的0.18 μm CMOS混合信號工藝。仿真結果表明:整個LDO是靜態電流為3.2 μA;相位裕度保持在90.19°以上;在電源電壓為1.8 V,輸出電壓為1.3 V的情況下,當負載電流在10 ns內由100 mA降到50 mA時,其建立時間由原來的和28 μs減少到8 μs;而在負載電流為100 mA的條件下,電源電壓在10 ns內,由1.8 V跳變到2.3 V時,輸出電壓的建立時間由47 μs降低為15 μs。

    標簽: LDO 無片外電容 瞬態 電路設計

    上傳時間: 2013-12-20

    上傳用戶:niumeng16

  • 采用線補償技術的原邊反饋ACDC控制器

    基于1 μm 40V BCD 工藝,使用Cadence軟件對原邊反饋AC/DC控制器進行仿真和分析。線補償技術可以使原邊反饋AC/DC電路獲得很好的負載調整率,抵消電感上所消耗的電壓和整流二極管上的壓降,使輸出達到的最佳值。在輸入加220 V交流電壓時,輸出結果最大值為5.09 V,最小值為5 V,最大負載調整率為9.609%。

    標簽: ACDC 線補償 反饋 控制器

    上傳時間: 2013-10-20

    上傳用戶:sglccwk

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