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  • 電工速查速算手冊-1220頁-9.2M.pdf

    專輯類-電工電力專輯-99冊-1.27G 電工速查速算手冊-1220頁-9.2M.pdf

    標(biāo)簽: 1220 9.2 電工

    上傳時間: 2013-04-24

    上傳用戶:stvnash

  • 語音錄放和識別集成電路應(yīng)用與制作實例-251頁-6.2M.pdf

    專輯類-數(shù)字處理及顯示技術(shù)專輯-106冊-9138M 語音錄放和識別集成電路應(yīng)用與制作實例-251頁-6.2M.pdf

    標(biāo)簽: 251 6.2 語音錄放

    上傳時間: 2013-05-29

    上傳用戶:1417818867

  • 常用運放電路集錦.rar

    常用運放電路的設(shè)計與制作 了解各種常用類型運放電路的設(shè)計并區(qū)分它們的不同

    標(biāo)簽: 運放電路 集錦

    上傳時間: 2013-08-05

    上傳用戶:dtvboyy

  • 實時視頻縮放算法研究及FPGA實現(xiàn).rar

    調(diào)整視頻圖像的分辨率需要視頻縮放技術(shù)。如果圖像縮放技術(shù)的處理速度達(dá)到實時性要求就可以應(yīng)用于視頻縮放。 傳統(tǒng)圖像縮放技術(shù)利用插值核函數(shù)對已有像素點進(jìn)行插值重建還原圖像。本文介紹了圖像插值的理論基礎(chǔ)一采樣定理,并對理想重建函數(shù)Sinc函數(shù)進(jìn)行了討論。本文介紹了常用的線性圖像插值技術(shù)及像素填充、自適應(yīng)插值和小波域圖像縮放等技術(shù)。然后,本文討論了分級線性插值算法的思想,設(shè)計并實現(xiàn)了FPGA上的分級雙三次算法。最后本文對各種算法的縮放效果進(jìn)行了分析和討論。 本文在分析現(xiàn)有視頻縮放算法基礎(chǔ)之上,提出了分級線性插值算法,并應(yīng)用在簡化線性插值算法中。分級線性插值算法以犧牲一定的計算精度為代價,用查找表代替乘法計算,降低了算法復(fù)雜度。本文設(shè)計并實現(xiàn)了分級雙三次插值算法,詳細(xì)說明了板上系統(tǒng)的模塊結(jié)構(gòu)。最后本文將分級線性插值算法與原線性插值算法效果圖進(jìn)行比較,比較結(jié)果顯示分級插值算法與原算法誤差較小,在放大比例較小時可以取代原算法。結(jié)果證明分級雙三次線性插值算法的FPGA實現(xiàn)能夠滿足額定幀頻,可以進(jìn)行實時視頻縮放。

    標(biāo)簽: FPGA 實時視頻 算法研究

    上傳時間: 2013-04-24

    上傳用戶:亞亞娟娟123

  • 圖像縮放算法的研究與FPGA設(shè)計.rar

    Scaler是平板顯示器件(FPD,F(xiàn)lat Panel Display)中的重要組成部分,它將輸入源圖像信號轉(zhuǎn)換成與顯示屏固定分辨率一致的信號,并控制其顯示在顯示屏上。本文在研究圖像縮放算法和scaler在FPD中工作過程的基礎(chǔ)上,采用自上而下(Top-down)的設(shè)計方法,給出了scaler的設(shè)計及FPGA驗證。該scaler支持不同分辨率圖像的縮放,且縮放模式可調(diào),也可以以IP core的形式應(yīng)用于相關(guān)圖像處理芯片中。 圖像縮放內(nèi)核是scaler的核心部分,它是scaler中的主要運算單元,完成圖像縮放的基本功能,它所采用的核心算法以及所使用的結(jié)構(gòu)設(shè)計決定著縮放性能的優(yōu)劣,也是控制芯片成本的關(guān)鍵。因此,本文從縮放內(nèi)核的結(jié)構(gòu)入手,對scaler的總體結(jié)構(gòu)進(jìn)行了設(shè)計;通過對圖像縮放中常用算法的深入研究提出了一種新的優(yōu)化算法——矩形窗縮放算法,并對其計算進(jìn)行分析和簡化,降低了計算的復(fù)雜度。FPGA設(shè)計中,采用列縮放與行縮放分開處理的結(jié)構(gòu),使用雙口RAM作為兩次縮放間的數(shù)據(jù)緩沖區(qū)。使用這種結(jié)構(gòu)的優(yōu)勢在于:行列縮放可以同時進(jìn)行,數(shù)據(jù)處理的可靠性高、速度快:內(nèi)核結(jié)構(gòu)簡單明了,數(shù)據(jù)緩沖區(qū)大小合適,便于設(shè)計。此外,本文還介紹了其他輔助模塊的設(shè)計,包括DVI接口信號處理模塊、縮放參數(shù)計算與控制模塊以及輸出信號檢測與時序濾波模塊。 本設(shè)計使用Verilog HDL對各模塊進(jìn)行了RTL級描述,并使用Quartus II7.2進(jìn)行了邏輯仿真,最后使用Altera公司的FPGA芯片來進(jìn)行驗證。通過邏輯驗證和系統(tǒng)仿真,證明該scaler的設(shè)計達(dá)到了預(yù)期的目標(biāo)。對于不同分辨率的圖像,均可以在顯示屏上得到穩(wěn)定的顯示。

    標(biāo)簽: FPGA 圖像 法的研究

    上傳時間: 2013-05-30

    上傳用戶:xiaowei314

  • WCDMA數(shù)字直放站數(shù)字上下變頻及降低峰均比的研究與FPGA實現(xiàn).rar

    隨著3G網(wǎng)絡(luò)建設(shè)的展開,移動用戶數(shù)量逐漸增加,用戶和運營商對網(wǎng)絡(luò)的質(zhì)量和覆蓋要求也越來越高。而在實際工作中,基站成本在網(wǎng)絡(luò)投資中占有很大比例,并且基站選址是建網(wǎng)的主要難題之一。同基站相比,直放站以其性價比高、建設(shè)周期短等優(yōu)點在我國移動網(wǎng)絡(luò)上有著大量的應(yīng)用。目前,直放站已成為提高運營商網(wǎng)絡(luò)質(zhì)量、解決網(wǎng)絡(luò)盲區(qū)或弱區(qū)問題、增強(qiáng)網(wǎng)絡(luò)覆蓋的主要手段之一。但由于傳統(tǒng)的模擬直放站受周邊環(huán)境因素影響較大、抗干擾能力較差、傳輸距離受限、功放效率低,同時設(shè)備間沒有統(tǒng)一的協(xié)議規(guī)范,無法滿足系統(tǒng)廠商與直放站廠商的兼容,所以移動通信市場迫切需要通過數(shù)字化來解決這些問題。 本文正是以設(shè)計新型數(shù)字化直放站為目標(biāo),以實現(xiàn)數(shù)字中頻系統(tǒng)為研究重心,圍繞數(shù)字中頻的相關(guān)技術(shù)而展開研究。 文章介紹了數(shù)字直放站的研究背景和國內(nèi)外的研究現(xiàn)狀,闡述了數(shù)字直放站系統(tǒng)的設(shè)計思想及總體實現(xiàn)框圖,并對數(shù)字直放站數(shù)字中頻部分進(jìn)行了詳細(xì)的模塊劃分。針對其中的數(shù)字上下變頻模塊設(shè)計所涉及到的相關(guān)技術(shù)作詳細(xì)介紹,涉及到的理論主要有信號采樣理論、整數(shù)倍內(nèi)插和抽取理論等,在理論基礎(chǔ)上闡述了一些具體模塊的高效實現(xiàn)方案,最終利用FPGA實現(xiàn)了數(shù)字變頻模塊的設(shè)計。 在數(shù)字直放站系統(tǒng)中,降低峰均比是提高功放工作效率的關(guān)鍵技術(shù)之一。本文首先概述了降低峰均比的三類算法,然后針對目前常用的幾種算法進(jìn)行了仿真分析,最后在綜合考慮降低峰均比效果與實現(xiàn)復(fù)雜度的基礎(chǔ)上,提出了改進(jìn)的二次限幅算法。通過仿真驗證算法的有效性后,針對其中的噪聲整形濾波器提出了“先分解,再合成”的架構(gòu)實現(xiàn)方式,并指出其中間級窄帶濾波器采用內(nèi)插級聯(lián)的方式實現(xiàn),最后整個算法在FPGA上實現(xiàn)。 在軟件無線電思想的指導(dǎo)下,本文利用系統(tǒng)級的設(shè)計方法完成了WCDMA數(shù)字直放站中頻系統(tǒng)設(shè)計。遵照3GPP等相關(guān)標(biāo)準(zhǔn),完成了系統(tǒng)的仿真測試和實物測試。最后得出結(jié)論:該系統(tǒng)實現(xiàn)了WCDMA數(shù)字直放站數(shù)字中頻的基本功能,并可保證在現(xiàn)有硬件不變的基礎(chǔ)上實現(xiàn)不同載波間平滑過渡、不同制式間輕松升級。

    標(biāo)簽: WCDMA FPGA 數(shù)字

    上傳時間: 2013-07-07

    上傳用戶:林魚2016

  • 圖像縮放算法研究及其FPGA實現(xiàn).rar

    圖像縮放在圖像處理領(lǐng)域中,發(fā)揮著重要作用。圖像的分辨率調(diào)整和格式變換,都需要用到圖像縮放技術(shù)。隨著多媒體技術(shù)和大規(guī)模集成電路的發(fā)展,利用硬件實現(xiàn)視頻圖像無級縮放已成為圖像處理研究的一個重要課題。 圖像縮放通常由插值算法實現(xiàn)。傳統(tǒng)的插值算法由于實現(xiàn)原理的局限性,在縮放時容易引起邊緣鋸齒或細(xì)節(jié)模糊現(xiàn)象。針對傳統(tǒng)插值算法的這個不足,出現(xiàn)了許多基于邊緣改進(jìn)的算法。但這些算法一般只能完成2k倍數(shù)插值,無法真正做到基于邊緣的無級縮放。 為了實現(xiàn)基于邊緣改進(jìn)的無級縮放,本文做了如下五個方面的研究工作: 1.系統(tǒng)回顧了圖像縮放技術(shù),包括傳統(tǒng)圖像縮放技術(shù)和多邊緣檢測插值,分析了這些圖像縮放技術(shù)的優(yōu)缺點。 2.重點研究了新興的方向多項式插值算法,該算法能夠真正完成基于邊緣改進(jìn)的無級縮放。 3.提出改進(jìn)的方向多項式插值算法(IOPI算法),該算法針對硬件實現(xiàn),做了兩個方面改進(jìn):提出EDV算法,簡化邊緣方向的確定;提出Cubic6逼近插值算法(A-Cubic6算法),改善平坦區(qū)域縮放效果。其中的EDV算法通過加減、比較模塊,完成邊緣方向的確定。相比原算法中的乘除法、直方圖計算,大大簡化了硬件實現(xiàn),降低了硬件實現(xiàn)成本。A-Cubic6算法利用查找表簡化了Cubic6點插值算法的實現(xiàn),而且明顯改善了非邊緣區(qū)域的縮放效果。 4.研究縮放算法與圖像質(zhì)量的評價方法。比較、分析各算法的軟件仿真結(jié)果,得出結(jié)論:本文提出的IOPI算法在平坦區(qū)域和邊緣區(qū)域都具有比其它算法更突出的效果。 5.結(jié)合實時視頻處理要求,研究了IOPI算法的FPGA實現(xiàn)。已完成最近鄰域插值和A-Cubic6算法的FPGA實現(xiàn),可以在硬件平臺上穩(wěn)定工作。

    標(biāo)簽: FPGA 圖像 算法研究

    上傳時間: 2013-06-05

    上傳用戶:2728460838

  • 集成運放線性應(yīng)用電路分析方法的研究.rar

    集成運放線性應(yīng)用電路分析方法的研究 集成運放線性應(yīng)用電路分析方法的研究

    標(biāo)簽: 集成運放 線性應(yīng)用 電路分析

    上傳時間: 2013-06-06

    上傳用戶:gxf2016

  • 常用運放電路范例及分析.rar

    一些常用的運放電路及分析。國家半導(dǎo)體公司的應(yīng)用筆記。

    標(biāo)簽: 運放電路 范例

    上傳時間: 2013-05-28

    上傳用戶:YYRR

  • 基于AT89C2051和ISD2560的錄放音系統(tǒng)設(shè)計

    介紹了由Flash單片機(jī)AT89C2051及數(shù)碼語音芯片 ISD256o組成的電腦語音系統(tǒng)。設(shè)計出了系統(tǒng)的硬件電路, 給出了錄、放音實用的源程序。

    標(biāo)簽: C2051 2051 2560 89C

    上傳時間: 2013-04-24

    上傳用戶:wangzhen1990

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