使用FPGA設(shè)計(jì)WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)
標(biāo)簽: WiMax FPGA OFDM VHDL
上傳時(shí)間: 2016-01-22
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ADS操作影片,教我們?cè)觞Ntuning電路.中文發(fā)音,步驟清楚,非常適合初學(xué)入門者.希望對(duì)大家有幫助.
標(biāo)簽: tuning ADS 操作 家
上傳時(shí)間: 2016-02-25
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這是一個(gè)修改Oreilly Java 網(wǎng)路程式設(shè)計(jì)範(fàn)例的程式 主要是將裡面的一個(gè)小程式加上視窗管理者介面方便使用 使用環(huán)境: 需有JRE的環(huán)境 path需有指到JAVA_HOME下bin/ 如環(huán)境設(shè)定OK,在windows直接點(diǎn)選執(zhí)行即可 如在其他OS(unix-like) java -jar nsLookUp.jar
標(biāo)簽: JAVA_HOME Oreilly Java path
上傳時(shí)間: 2014-01-15
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一個(gè)可以計(jì)算分壓電路的源碼。 可透過輸出與輸入電壓,計(jì)算電阻的大小;或透過輸入電壓與電阻,計(jì)算最後輸出之電壓
標(biāo)簽: 分
上傳時(shí)間: 2014-12-09
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向量矩陣運(yùn)算包 電腦視覺常會(huì)使用到的向量矩陣的複雜運(yùn)算, 可利用此數(shù)學(xué)模組簡化你程式的複雜度 是非常有用的工具
標(biāo)簽: 向量 模 程式
上傳時(shí)間: 2016-03-19
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89x51 or 8051 英文電子書 , 圖路及原程式
標(biāo)簽: 89x51 8051 or 英文
上傳時(shí)間: 2013-12-30
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是一個(gè)用verilog寫成的加法器電路,可把七個(gè)元件加起來
標(biāo)簽: verilog 加法器 元件
上傳時(shí)間: 2014-01-07
上傳用戶:zhangzhenyu
使用硬體描述語言HDL 設(shè)計(jì)硬體電路,臺(tái)灣人寫的PPT講義,非常不錯(cuò)。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語法架構(gòu),VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽: HDL
上傳時(shí)間: 2014-01-22
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5 bits 的加法器與減法器合併電路之原始程式製作
標(biāo)簽: bits 加法器 法器 程式
上傳時(shí)間: 2016-05-18
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verilog除頻器可用於編碼段運(yùn)用可以穩(wěn)定電路設(shè)計(jì)
標(biāo)簽: verilog
上傳時(shí)間: 2013-12-26
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