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量產(chǎn)工具

  • 基于FPGA的64位CPU驗證平臺的建立

    現代IC設計中,隨著設計規模的擴大和復雜度的增長,驗證成為最嚴峻的挑戰之一。在現代ASIC設計中,很難用單一的驗證方法來對復雜芯片進行有效的驗證,為了將設計錯誤減少到可接受的最小量,需要將一系列的驗證方法和工具結合起來。 在64位全定制嵌入式CPU設計過程中,使用了多種驗證技術和方法,并將FPGA驗證作為ASIC驗證的重要補充,加強了設計正確的可靠性。 論文首先介紹了64位CPU的結構,結合選用的Xilinx的Virtex

    標簽: FPGA CPU

    上傳時間: 2013-04-24

    上傳用戶:003030

  • 基于FPGA的DDS信號源的設計

    頻率合成技術廣泛應用于通信、航空航天、儀器儀表等領域,目前,常用的頻率合成技術有直接頻率合成、鎖相頻率合成和直接數字頻率合成(DDS)等。其中DDS是一種新的頻率合成方法,是頻率合成的一次革命。全數字化的DDS技術由于具有頻率分辨率高、頻率切換速度快、相位噪聲低和頻率穩定度高等優點而成為現代頻率合成技術中的佼佼者。隨著數字集成電路、微電子技術和EDA技術的深入研究,DDS技術得到了飛速的發展。 DDS是把一系列數字量化形式的信號通過D/A轉換形成模擬量形式的信號的合成技術。主要是利用高速存儲器作查尋表,然后通過高速D/A轉換產生已經用數字形式存入的正弦波(或其它任意波形)。一個典型的DDS系統應包括以下三個部分:相位累加器可以時鐘的控制下完成相位的累加;相位一幅度碼轉換電路一般由ROM實現;D/A轉換電路,將數字形式的幅度碼轉換成模擬信號。 現場可編程門陣列(FPGA)設計靈活、速度快,在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用FPGA來實現一個DDS系統,該DDS系統的硬件結構是以FPGA為核心實現的,使用Altera公司的Cyclone系列FPGA。 文章首先介紹了頻率合成器的發展,闡述了基于FPGA實現DDS技術的意義;然后介紹了DDS的基本理論;接著介紹了FPGA的基礎知識如結構特點、開發流程、使用工具等;隨后介紹了利用FPGA實現直接數字頻率合成(DDS)的原理、電路結構、優化方法等。重點介紹DDS技術在FPGA中的實現方法,給出了部分VHDL源程序。采用該方法設計的DDS系統可以很容易地嵌入到其他系統中而不用外接專用DDS芯片,具有高性能、高性價比,電路結構簡單等特點;接著對輸出信號頻譜進行了分析,特別是對信號的相位截斷誤差和幅度量化誤差進行了詳細的討論,由此得出了改善系統性能的幾種方法;最后給出硬件實物照片和測試結果,并對此作了一定的分析。

    標簽: FPGA DDS 信號源

    上傳時間: 2013-04-24

    上傳用戶:yx007699

  • 基于FPGA的HDMI顯示系統的設計與實現

    伴隨著多媒體顯示和傳輸技術的發展,人們獲得了越來越高的視聽享受。從傳統的模擬電視,到標清、高清、全高清。與顯示技術發展結伴而行的是顯示接口技術的發展,從模擬的AV端子,S-Video和VGA接口,到數字顯示的DVI接口,技術上經歷了一個從模擬到數字,從并行到串行,從低速到高速的發展過程。 HDMI是最新的高清晰度多媒體接口,它的規范由Silicon Image等七家公司提出,具有帶寬大,尺寸小,傳輸距離長和支持正版保護等功能,符合當今技術的發展潮流,一經推出,就獲得了巨大的成功。成為平板顯示器、高清電視等設備的標準接口之一,并獲得了越來越廣泛的應用。 從上世紀80年代XILINX發明第一款FPGA芯片以來,FPGA就以其體系結構和邏輯單元靈活,運算速度快,編程方便等優點廣泛應用與IC設計、系統控制、視頻處理、通信系統、航空航天等諸多方面。 本文利用ALTERA的一款高端FPGA芯片EP2S180F1508C3為核心,配合Silicon Image的專用HDMI接收芯片搭建了一個HDMI的接收顯示平臺。針對HDMI帶寬寬,數據量大的特點,使用了新型的DDR2 SDRAM作為視頻信號的輸入和輸出緩沖。在硬件板級設計上,針對HDMI和DDR2的相關高速電路,采用了一系列的高速電路設計方法,有效的避免了信號的反射,串擾等不良現象。同時在對HDMI規范和DDR2 SDRAM時序規范的深入研究的基礎上,在ALTERA的開發平臺QUARTUSII上編寫了系統的頂層模塊和相關各功能子模塊,并仿真通過。 論文的主要工作和創新點表現在以下幾個方面: 1、論文研究了最新的HDMI接口規范和新型存儲器件DDR2的時序規范。 2、論文搭建的整個系統相當龐大,涉及到相關的規范、多種芯片的資料、各種工具軟件的使用、原理圖的繪制和PCB板的布局布線,直至后期的編程仿真,花費了作者大量的時間和精力。 3、論文首次使用FPGA來處理HDMI信號且直接驅動顯示器件,區別于-般的ASIC方案。 4、論文對高速電路特別是的DDR2布局布線,采用了一系列的專門措施,具有一定的借鑒價值。

    標簽: FPGA HDMI 顯示系統

    上傳時間: 2013-06-22

    上傳用戶:784533221

  • 串口收發工具

    使用VB2008制作的串口收發工具,可以收發16進制數據,文本(支持ASCII或UNICODE編碼);具備定時自動發送功能.系統需要.NET FRAMWORK3.5支持.

    標簽: 串口 收發

    上傳時間: 2013-04-24

    上傳用戶:qq442012091

  • FPGA設計指南——器件、工具和流程

    本書涉及大量豐富的、工程師所喜好的技術細節如多種不同的設計流程、工具和概念。此外本書還涵蓋了一系列技術層次相對低的主題,如基本概念等。

    標簽: FPGA 設計指南 器件 流程

    上傳時間: 2013-07-20

    上傳用戶:D&L37

  • 用FPGA實現8051內核及外設I2C接口

    8051處理器自誕生起近30年來,一直都是嵌入式應用的主流處理器,不同規模的805l處理器涵蓋了從低成本到高性能、從低密度到高密度的產品。該處理器極具靈活性,可讓開發者自行定義部分指令,量身訂制所需的功能模塊和外設接口,而且有標準版和經濟版等多種版本可供選擇,可讓設計人員各取所需,實現更高性價比的結構。如此多的優越性使得8051處理器牢固地占據著龐大的應用市場,因此研究和發展8051及與其兼容的接口具有極大的應用前景。在眾多8051的外設接口中,I2C總線接口扮演著重要的角色。通用的12C接口器件,如帶12C總線的RAM,ROM,AD/DA,LCD驅動器等,越來越多地應用于計算機及自動控制系統中。因此,本論文的根本目的就是針對如何在8051內核上擴展I2C外設接口進行較深入的研究。 本課題項目采用可編程技術來開發805l核以及12C接口。由于8051內核指令集相容,我們能借助在現有架構方面的經驗,發揮現有的大量代碼和工具的優勢,較快地完成設計。在8051核模塊里,我們主要實現中央處理器、程序存儲器、數據存儲器、定時/計數器、并行接口、串行接口和中斷系統等七大單元及數據總線、地址總線和控制總線等三大總線,這些都是標準8051核所具有的模塊。在其之上我們再嵌入12C的串行通信模塊,采用自下而上的方法,逐次實現一位的收發、一個字節的收發、一個命令的收發,直至實現I2C的整個通信協議。 8051核及I2C總線的研究通過可編程邏輯器件和一塊外圍I2C從設備TMPl01來驗證。本課題的最終目的是可編程邏輯器件實現的8051核成功并高效地控制擴展的12C接口與從設備TMPl01通信。 用EP2C35F672C6芯片開發的12C接口,數據的傳輸速率由該芯片嵌入8051微處理的時鐘頻率決定。經測試其傳輸速率可達普通速率和快速速率。 目前集成了該12C接口的8051核已經在工作中投入使用,主要用于POS設備的用戶數據加密及對設備溫度的實時控制。雖然該設備尚未大批量投產,但它已成功通過PCI(PaymentCardIndustry)協會認證。

    標簽: FPGA 8051 I2C 內核

    上傳時間: 2013-06-18

    上傳用戶:731140412

  • GPS信號CA碼跟蹤的FPGA實現

    GPS全球定位系統是美國國防部為軍事目的而建立的衛星導航系統,其主要目的是解決海上、陸地和空中運載工具的導航定位問題。GPS作為新一代衛星導航系統,不僅具有全球、全天候、連續、高精度導航與定位能力,而且具有優良的抗干擾性和保密性。因此,發展全球定位系統是當今導航技術現代化的一個重要標志。在GPS接收機中,為了得到導航電文并對其進行解算,要完成復雜的信號處理過程。其中,怎樣捕獲到衛星信號,并對C/A碼進行跟蹤是研制GPS接收機的重要問題之一。本文在對GPS信號的結構進行深入的分析后,結合FPGA的特點,對算法進行設計及優化后,給出了相應的仿真。內容主要包括以下幾個方面: 1.對GPS信號結構的產生原理進行了深入地分析,并對GPS信號的調制機理進行詳細地闡述。 2.在GPS信號的捕獲方面,采用了基于FFT頻域的快速捕獲的方法,即將接收到的GPS信號先利用快速傅立葉變換(FFT)變換到頻域,在頻域完成相應的運算后,再利用傅立葉反變換(IFFT)變換到時域。從而大大減少了計算量,加快了信號捕獲的速度,提高了捕獲性能。 3.在C/A碼跟蹤部分,本文采用了非相干延遲鎖定環對C/A碼進行跟蹤。來自載波跟蹤環路的本地載波將輸入的信號變成基帶信號,然后分別和本地碼的三個不同相位序列進行相乘,將相乘結果進行累加,經過處理將得到碼相位和當前的載波頻率送到載波跟蹤環路。 4.載波跟蹤環,本文采用的是科斯塔斯環。載波跟蹤環和碼跟蹤環在結構上相似,故本文只對關鍵的載波NCO進行了仿真。 本文的創新點主要是使用FPGA對整個GPS信號的捕獲及C/A碼的跟蹤進行設計。此外,根據FPGA的特點,在不改變外部硬件設計的前提下,改變相應的IP核或相關的VHDL程序就可對系統進行各種優化設計,以適應不同類型的GPS接收機的不同功能。

    標簽: FPGA GPS 信號

    上傳時間: 2013-06-27

    上傳用戶:哇哇哇哇哇

  • PCB特性阻抗計算工具

    PCB特性阻抗計算工具:用于射頻電路,高速數字電路中傳輸線阻抗的計算

    標簽: PCB 特性阻抗 計算工具

    上傳時間: 2013-07-02

    上傳用戶:abc123456.

  • 中興通訊康訊EDA工具手冊

    Cadence 軟件是我們公司統一使用的原理圖設計、PCB 設計、高速仿真、自動布線的EDA 工具。本篇 Cadence 使用手冊是一本基于Allegro SPB V15.2 版本的Cadence 軟件的基礎使用手冊,包括原理圖設計、 PCB 設計、高速仿真、約束管理器、自動布線五個方面的內容,是一個入門級的教材。通過這本手冊旨在 讓新進員工能掌握Cadence 的基本使用方法,能獨立進行原理圖及PCB 的設計,了解自動布線、約束管理 器的使用,熟悉高速仿真的過程,并對公司的EDA 流程有全面的了解。

    標簽: EDA 中興通訊

    上傳時間: 2013-04-24

    上傳用戶:天天天天

  • 串口測試程序源碼.rar

    N 串口調試工具.rar

    標簽: 串口 測試程序 源碼

    上傳時間: 2013-07-17

    上傳用戶:thuyenvinh

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