本文結合工程需要詳細論述了一種數字相位計的實現方法,該方法是基于FPGA(現場可編程門陣列)芯片運用FFT(快速傅立葉變換)算法完成的。首先,從相位測量的原理出發,分析了傳統相位計的缺點,給出了一種高可靠性的相位檢測實用算法,其算法核心是對采集信號進行FFT變換,通過頻譜分析,實現對參考信號和測量信號初相位的檢測,并同時闡述了FPGA在實現數字相位計核心FFT算法中的優勢。在優化的硬件結構中,利用多個乘法器并行運算的方式加快了蝶形運算單元的運算速度;內置雙端口RAM、旋轉因子ROM使數據存儲的速度得到提高;采用了流水線的工作方式使數據的存儲、運算在時間上達到匹配。整個設計采用VHDL(超高速硬件描述語言)語言作為系統內部硬件結構的描述手段,在Altera的QuartusⅡ軟件支持下完成。仿真結果表明,基于FPGA實現的FFT算法無論在速度和精度上都滿足了相位測量的需要,其運算64點數據僅需27.5us,最大誤差在1%之內。
上傳時間: 2013-06-04
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本論文依據IEEE802.16a物理層對RS-CC碼的參數要求,研究了RS-CC碼的高速編、譯碼的VLSI硬件算法,同時對FPGA開發技術進行了研究,以VerilogHDL為描述語言,在Xilinx公司的FPGA上實現了高速的RS-CC編、譯碼器。RS譯碼器中,錯誤位置多項式和錯誤值多項式的求解采用無求逆單元,并具有規則數據流、易于VLSI實現的改進的歐幾里德算法(MEA);CC譯碼器由采用模歸一化路徑度量的全并行的“加比選(ACS)”模塊和具有脈動陣列結構的幸存路徑回溯模塊組成。 在實現RS-CC譯碼器的過程中,分別從算法上和根據FPGA的結構特點上,對譯碼器做了一些優化工作,降低了硬件資源占有率和提高了譯碼速度。 此外,還搭建了以Xilinx公司40萬等效門的FPGASpartan-Ⅲ400-4PQ208為主體,以Cypress公司的USB2.0芯片CY7C68013為高速數據接口的硬件試驗平臺,并在此試驗平臺上實現了文中的高速RS-CC編譯碼系統。
上傳時間: 2013-06-03
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隨著微電子技術的發展,可編程邏輯器件取得了迅速的發展,其功能日益強大,FPGA內部可用邏輯資源飛速增長,近來推出的FPGA都針對數字信號處理的特點做了特定設計,集成了存儲器、鎖相環(PLL)、硬件乘法器、DSP模塊等,通過使用各個公司提供的FPGA開發軟件使用硬件描述語言,可以實現特定的信號處理算法,如FFT、FIR等算法,為電子設計工程師提供了新的選擇。實時圖像處理系統采用FPGA+DSP的結構來完成整個復雜的圖像處理算法。將圖像處理算法進行分類,FPGA和DSP份協作發揮各自的長處,對于算法實現簡單、運算量大、實時性高的這類處理過程由大容量高性能的FPGA實現,DSP則用來處理經過預處理后的圖像數據,來運行算法結構復雜,乘加運算多的算法。整個系統主要包括FPGA處理單元、DSP處理單元以及PCI接口通訊三個部分。主要取得的了以下的研究成果:(1)研究了FPGA的工作原理及應用,完成了Stratix芯片的選型。設計了數字圖像處理板的電路原理圖和PCB設計圖。并對電路板進行調試,工作正常。(2)完成了FPGA程序下載電纜的PCB電路設計,并調試成功,應用到FPGA的調試下載配置中,取得了良好的實驗與經濟效果。(3)充分利用FPGA的設計開發軟件與工具,完成了中值濾波、形態學濾波和自適應閾值的FPGA實現,并給出了詳細的實現過程。將算法下載到FPGA芯片,經過試驗調試,達到要求。(4)研究了PCI接口通訊的實現方式,選用PCI9054芯片實現通訊,完成PCI接口電路設計,經過調試,實現了中斷、DMA等方式,滿足了數據傳輸的要求。(5)學習了C6701DSP芯片的工作特性以及內部功能結構,完成了DSP外圍存儲器的擴展、時鐘信號發生以及電源模塊等外圍電路的設計。
上傳時間: 2013-07-16
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C代碼實現DES加密算法,KEil開發環境,調試通過。
上傳時間: 2013-07-03
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jm編碼算法描述及配置文件參數解釋,包括h.264算法描述和參數解釋
上傳時間: 2013-06-06
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在arm平臺下,采集usb攝像頭,并保存為jpg格式的圖片。
上傳時間: 2013-07-31
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無傳感器,永磁同步電機。FOC 控制算法詳解
標簽: Sensorless PSMS FOC 控制算法
上傳時間: 2013-06-19
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在信息化發展的當前,音視頻等多媒體作為信息的載體,在社會生活的各個領域,起著越來越重要的作用。數字視頻的海量性成為阻礙其應用的的瓶頸之一。在這種情況下,H.264作為新一代的視頻壓縮標準,以其高性能的壓縮效率,成為備受關注的焦點和研究問題。H.264通過運動估計/運動補償(MP/MC)消除視頻時間冗余,對差值圖像進行離散余弦變換(DCT)消除空間冗余,對量化后的系數進行可變長編碼(VLC)消除統計冗余,獲得了極高的壓縮效率。隨著嵌入式處理器性能的逐漸提升和3G網絡即將商用的推動,H.264以其優秀的壓縮性能,無論是無線信道傳輸方面,還是存儲容量有限的嵌入式設備都具有廣闊的應用前景。 但H.264在提升壓縮性能的同時付出的代價是算法復雜度的成倍增加,實際應用中人們對視頻解碼的實時性要求嚴格,已出現的對應算法代碼多基于PC通用處理器實現,而嵌入式設備的主頻和處理能力仍然相對有限,存儲容量相對較小,總線速率相對偏低,因此必須對標準對應算法進行優化移植,才能滿足實際應用的需求。 本文在對H.264標準及其新特性進行詳細介紹后,重點研究了在解碼端如何針對解碼耗時較多的模塊進行改進,然后將算法移植到ARM平臺,并針對平臺特點作出相應優化,最后完成解碼圖象顯示,并給出了測試結果。本文主要完成的工作如下: 詳細分析了H.264的參考軟件JM中解碼流程,并利用測試工具分析了各模塊耗時,針對耗時較多的模塊如插值運算及去塊濾波模塊,提出了對應的改進算法并在H.264的參考軟件JM86上進行了實現,PC測試實驗證明了算法改進的優越性和運算優化的可行性。最后針對ARM平臺,在對程序結構和對應代碼進行優化之后,將其移植到WINCE系統之下,同時給出了WINCE平臺解碼后圖象加速顯示方法,并對最終測試結果與性能做出了評價。
上傳時間: 2013-06-04
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微處理器技術、傳感器技術和無線通信技術的進步,推動了無線數據采集系統的產生和發展。數據采集技術廣泛應用于雷達、通信、遙感遙測等領域。在各種信息的獲取中,對高速數據采集的需求非常廣泛。隨著測控技術的發展,對數據采集系統的智能化和網絡化水平也提出了更高的要求。并且由于通訊網絡的飛速發展,移動通信與實際應用的結合使得各種基于GPRS網絡的無線數據傳輸系統成為當前遠距離無線通訊領域最為廣泛的應用。本課題將廣泛應用的嵌入式控制器引入到數據采集系統設計中,并結合GPRS優秀的網絡特性,實現了一個低功耗、智能化、網絡化、軟硬件可根據具體測量任務適當裁減的無線高速數據采集平臺。 本設計采用32位ARM處理器S3C2410為核心器件,配以FPGA+DDRSDRAM高速數據采集模塊,GPRS數據通信模塊,在Linux嵌入式操作系統和應用軟件的支持下,實現了數字化高速采集,數字化無線數據網絡傳輸的現場數據采集系統。該平臺采集的現場數據主要為各種傳感器輸出的電壓模擬量。前端數據采集模塊的FPGA控制高速AD轉換器將輸入的模擬量信號采集后,存儲在由DDRSDRAM構成的大容量緩存中,再經過嵌入式系統中的微控制器進行各種處理,然后將處理結果保存在ARM系統的SDRAM內存,最后通過在ARM系統模塊擴展的GPRS模塊,將采集到的數據通過GPRS網絡發送出去。 IAnux由于其代碼開放性以及強大的網絡功能等特點,在許多的嵌入式網絡設備中有著廣泛應用,與其他的嵌入式操作系統相比,具有著更多的優勢。因此本課題將其作為硬件平臺的操作系統。基于ARM的嵌入式數據采集與處理系統結構清晰、通用性好、可擴展性強,可為各種嵌入式應用提供一套完整的硬、軟件解決方案,在工業測量與控制領域具有較為廣闊的應用前景。
上傳時間: 2013-04-24
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隨著我國工農業生產的發展和人民生活水平的提高,作為國民經濟基礎之一的電力行業取得了迅猛的發展,電力系統輸配電的安全性和可靠性也越來越受到電力系統運行、管理和科研人員的關注。輸電線路的各種事故是影響電力線路安全運行的重要因素之一。本文正是在這一前提下,在參考國內外大量文獻及研究成果的基礎上,設計實現了一套輸電線路綜合在線監測系統。 本文研制的輸電線路在線監測終端通過測量線路的泄漏電流、分布電壓、氣候參數以及圖像信息,并將數據進行采集、處理后,將數據發送到后臺監控中心,達到對輸電線路運行狀況進行實時監測的目的,并以此為依據給出線路的評估信息提供給電力部門作為其安排檢修的依據,可以大大減少電力部門的工作量并預防線路事故的發生。 針對本系統功能豐富、監測參數眾多的特點,作者設計了基于ARM的數據采集與傳輸系統。通過對ARM資源的合理分配,實現了監測終端的數據采集處理功能。終端的數據傳輸功能由ARM和無線傳輸模塊配合完成,實現了GPRS和GSM SMS兩種數據傳輸方式。 本文是對輸電線路綜合在線監測終端數據采集與傳輸系統設計和研究工作的總結,本文內容主要偏重于監測終端硬件和軟件的研究設計。論文在最后一部分對運行得到的數據也進行了分析、總結。 本文研制的輸電線路綜合監測終端已在在幾條高壓輸電線路上掛網運行,運行結果表明系統各方面性能良好,滿足設計要求。
上傳時間: 2013-07-20
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