本文首先研究了常規的數據采集的方法,針對由單片機構成的數據采集系統數據處理能力弱的問題提出了基于現場可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對三片A/D芯片進行控制的遠程多路數據采集的解決方案。 本文利用VisualBasic編寫串口通信程序,通過串行端口向FPGA數據采集板發送數據采集的參數指令,FPGA數據采集板接受指令后進行現場數據采集,并通過串行通信將數據發送到PC機,在通信過程中完全遵守RS-232協議,具有較強的通用性和推廣價值。然后本文重點介紹了該采集系統的硬件設計原理和軟件設計框架,實現實時嵌入式微機數據采集系統的軟件和硬件設計方法,將部分軟件的功能改由硬件實現,從邏輯上大大簡化了嵌入式軟件的設計。
上傳時間: 2013-04-24
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本文首先研究了常規的數據采集的方法,針對由單片機構成的數據采集系統數據處理能力弱的問題提出了基于現場可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對三片A/D芯片進行控制的遠程多路數據采集的解決方案。 本文利用VisualBasic編寫串口通信程序,通過串行端口向FPGA數據采集板發送數據采集的參數指令,FPGA數據采集板接受指令后進行現場數據采集,并通過串行通信將數據發送到PC機,在通信過程中完全遵守RS-232協議,具有較強的通用性和推廣價值。然后本文重點介紹了該采集系統的硬件設計原理和軟件設計框架,實現實時嵌入式微機數據采集系統的軟件和硬件設計方法,將部分軟件的功能改由硬件實現,從邏輯上大大簡化了嵌入式軟件的設計。
上傳時間: 2013-05-30
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采用自動增益控制(AGC)技術實現的寬頻帶放大器在雷達系統及其他相關電子領域有著廣泛的應用。 本文詳細討論了基于FPGA和可編程增益放大器(PGA)實現的自動增益控制寬帶視頻放大器的設計及實現方法。首先給出了自動增益控制寬帶放大器取樣反饋、數字控制部分的多種實現方案,并根據實際應用情況及性能指標要求進行了方案論證。接著,分別介紹了模擬通道部分、數字取樣模塊、FPGA邏輯控制模塊及數模轉換模塊,包括它們的芯片選擇、實現方法和注意事項等。最后,對FPGA邏輯控制模塊進行了功能分解,并以XilinxISE和Modelsim為開發平臺完成了其子模塊的程序設計及相關階段的仿真。 本文實現的電路板可對帶寬達40M的信號進行平穩的放大并輸出較平坦的信號波形。同時,該電路板具有自動增益及固定增益選擇能力。當選擇自動增益方式時,增益的改變通過增益同步脈沖觸發,觸發脈沖可由系統內部周期產生或外部提供。
上傳時間: 2013-06-05
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頻率特性測試儀(簡稱掃頻儀)是一種測試電路頻率特性的儀器,它廣泛應用于無線電、電視、雷達及通信等領域,為分析和改善電路的性能提供了便利的手段。而傳統的掃頻儀由多個模塊構成,電路復雜,體積龐大,而且在高頻測量中,大量的分立元件易受溫度變化和電磁干擾的影響。為此,本文提出了集成化設計的方法,針對可編程邏輯器件的特點,對硬件實現方法進行了探索。 本文對三大關鍵技術進行了深入研究: 第一,由掃頻信號發生器的設計出發,對直接數字頻率合成技術(DDS)進行了系統的理論研究,并改進了ROM壓縮方法,在提高壓縮比的同時,改進了DDS系統的雜散度,并且利用該方法實現了幅度和相位可調制的DDS系統-掃頻信號發生器。 第二,為了提高系統時鐘的工作頻率,對流水線算法進行了深入的研究,并針對累加器的特點,進行了一系列的改進,使系統能在100MHz的頻率下正常工作。 第三,從系統頻率特性測試的理論出發,研究如何在FPGA中提高多位數學運算的速度,從而提出了一種實現多位BCD碼除法運算的方法—高速串行BCD碼除法;隨后,又將流水線技術應用于該算法,對該方法進行改進,完成了基于流水線技術的BCD碼除法運算的設計,并用此方法實現了頻率特性的測試。 在研究以上理論方法的基礎上,以大規模可編程邏輯器件EP1K100QC208和微處理器89C52為實現載體,提出了基于單片機和FPGA體系結構的集成化設計方案;以VerilogHDL為設計語言,實現了頻率特性測試儀主要部分的設計。該頻率特性測試儀完成掃頻信號的輸出和頻率特性的測試兩大主要任務,而掃頻信號源和頻率特性測試這兩大主要模塊可集成在一片可編程邏輯器件中,充分體現了可編程邏輯器件的優勢。 本文首先對相關的概念理論進行了介紹,包括DDS原理、流水線技術等,進而提出了系統的總體設計方案,包括設計工具、語言和實現載體的選擇,而后,簡要介紹了微處理器電路和外圍電路,最后,較為詳細地闡述了兩個主要模塊的設計,并給出了實現方式。
上傳時間: 2013-06-08
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論文首先介紹了SRAM型FPGA的典型代表XC4000系列的結構和主要特性,并對XC4000系列器件的配置模式和配置順序做了簡單介紹。根據XC4000系列器件各組成模塊的功能和特點,可以將其分為可編程邏輯功能塊(CLB)、輸入輸出功能塊(IOB)、互連資源(IR)、可配置接口模塊(CIM)和進位邏輯(CLM)等五大部分組成。 對于這五個功能模塊,可以采用“分治法”分別考慮各個模塊的測試問題。論文隨后深入討論了各模塊的測試問題,由于RAM測試的特殊性,所以對函數發生器RAM模式的測試單獨進行了討論。
上傳時間: 2013-06-29
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隨著移動終端、多媒體、Internet網絡、通信,圖像掃描技術的發展,以及人們對圖象分辨率,質量要求的不斷提高,用軟件壓縮難以達到實時性要求,而且會帶來因傳輸大量原始圖象數據帶來的帶寬要求,因此采用硬件實現圖象壓縮已成為一種必然趨勢。而熵編碼單元作為圖像變換,量化后的處理環節,是圖像壓縮中必不可少的部分。研究熵編解碼器的硬件實現,具有廣闊的應用背景。本文以星載視頻圖像壓縮的硬件實現項目為背景,對熵編碼器和解碼器的硬件實現進行探討,給出了并行熵編碼和解碼器的實現方案。熵編解碼器中的難點是huffman編解碼器的實現。在設計并行huffman編碼方案時通過改善Huffman編碼器中變長碼流向定長碼流轉換時的控制邏輯,避免了因數據處理不及時造成數據丟失的可能性,從而保證了編碼的正確性。而在實現并行的huffman解碼器時,解碼算法充分利用了規則化碼書帶來的碼字的單調性,及在特定長度碼字集內碼字變化的連續性,將并行解碼由模式匹配轉換為算術運算,提高了存儲器的利用率、系統的解碼效率和速度。在實現并行huffman編碼的基礎上,結合針對DC子帶的預測編碼,針對直流子帶的游程編碼,能夠對圖像壓縮系統中經過DWT變換,量化,掃描后的數據進行正確的編碼。同時,在并行huffman解碼基礎上的熵解碼器也可以解碼出正確的數據提供給解碼系統的后續反量化模塊,進一步處理。在本文介紹的設計方案中,按照自頂向下的設計方法,對星載圖像壓縮系統中的熵編解碼器進行分析,進而進行邏輯功能分割及模塊劃分,然后分別實現各子模塊,并最終完成整個系統。在設計過程中,用高級硬件描述語言verilogHDL進行RTL級描述。利用了Altera公司的QuartusII開發平臺進行設計輸入、編譯、仿真,同時還采用modelsim仿真工具和symplicity的綜合工具,驗證了設計的正確性。通過系統波形仿真和下板驗證熵編碼器最高頻率可以達到127M,在62.5M的情況下工作正常。而熵解碼器也可正常工作在62.5M,吞吐量可達到2500Mbps,也能滿足性能要求。仿真驗證的結果表明:設計能夠滿足性能要求,并具有一定的使用價值。
上傳時間: 2013-05-19
上傳用戶:吳之波123
軟件無線電是二十世紀九十年代提出的一種實現無線通信的體系結構,被認為是繼模擬通信、數字通信之后的第三代無線電通信技術。它的中心思想是:構造一個開放性、標準化、模塊化的通用硬件平臺,并使寬帶模數和數模轉換器盡可能靠近天線,從而將各種功能,如工作頻段、調制解調類型、數據格式、加密模式、通信協議等用軟件來完成。 本論文首先介紹了軟件無線電的基本原理和三種結構形式,綜述了軟件無線電的幾項關鍵技術及其最新研究進展。其中調制解調模塊是軟件無線電系統中的重要部分,集中體現了軟件無線電最顯著的優點——靈活性。目前這一部分的技術實現手段多種多樣。隨著近幾年來芯片制造工藝的飛速發展,可編程器件FPGA以其高速的處理性能、高容量和靈活的可重構能力,成為實現軟件無線電技術的重要手段。 本論文調制解調系統的設計,選擇有代表性的16QAM和QPSK兩種方式作為研究對象,采用SystemView軟件作為系統級開發工具進行集成化設計。在實現系統仿真和FPGA整體規劃后,著重分析用VHDL實現其中關鍵模塊以及利用嵌入FPGA的CPU核控制調制解調方式轉換的方法。同時,在設計中成功地調用了Xilinx公司的IP核,實現了設計復用。由于FPGA內部邏輯可以根據需要進行重構,因而硬件的調試和升級變得很容易,而內嵌CPU使信號處理過程可以用軟件進行控制,充分體現了軟件無線電的靈活性。 通過本論文的研究,初步驗證了在FPGA內實現數字調制解調過程及控制的技術可行性和應用的靈活性,并對將來的擴展問題進行了研究和討論,為實現完整的軟件無線電系統奠定了基礎。
上傳時間: 2013-06-10
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隨著微電子技術的發展,可編程邏輯器件取得了迅速的發展,其功能日益強大,FPGA內部可用邏輯資源飛速增長,近來推出的FPGA都針對數字信號處理的特點做了特定設計,集成了存儲器、鎖相環(PLL)、硬件乘法器、DSP模塊等,通過使用各個公司提供的FPGA開發軟件使用硬件描述語言,可以實現特定的信號處理算法,如FFT、FIR等算法,為電子設計工程師提供了新的選擇。實時圖像處理系統采用FPGA+DSP的結構來完成整個復雜的圖像處理算法。將圖像處理算法進行分類,FPGA和DSP份協作發揮各自的長處,對于算法實現簡單、運算量大、實時性高的這類處理過程由大容量高性能的FPGA實現,DSP則用來處理經過預處理后的圖像數據,來運行算法結構復雜,乘加運算多的算法。整個系統主要包括FPGA處理單元、DSP處理單元以及PCI接口通訊三個部分。主要取得的了以下的研究成果:(1)研究了FPGA的工作原理及應用,完成了Stratix芯片的選型。設計了數字圖像處理板的電路原理圖和PCB設計圖。并對電路板進行調試,工作正常。(2)完成了FPGA程序下載電纜的PCB電路設計,并調試成功,應用到FPGA的調試下載配置中,取得了良好的實驗與經濟效果。(3)充分利用FPGA的設計開發軟件與工具,完成了中值濾波、形態學濾波和自適應閾值的FPGA實現,并給出了詳細的實現過程。將算法下載到FPGA芯片,經過試驗調試,達到要求。(4)研究了PCI接口通訊的實現方式,選用PCI9054芯片實現通訊,完成PCI接口電路設計,經過調試,實現了中斷、DMA等方式,滿足了數據傳輸的要求。(5)學習了C6701DSP芯片的工作特性以及內部功能結構,完成了DSP外圍存儲器的擴展、時鐘信號發生以及電源模塊等外圍電路的設計。
上傳時間: 2013-07-16
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隨著嵌入式系統的發展、嵌入式應用的不斷增長以及嵌入式系統復雜性不斷提高,嵌入式軟件的規模和復雜性也不斷提高。在目前的嵌入式系統開發中間,軟件開發占80%以上的工作量,嵌入式軟件的質量和開發周期對產品的最終質量和上市時間起到決定性的影響。因此,為了保持產品競爭力,支持用戶對嵌入式設備進行快速、高效的軟件開發,嵌入式的開發人員迫切需要更加強大的調試技術和手段來為開發復雜的嵌入式應用提供幫助;同時,強有力的嵌入式軟件開發工具也是基本的必備條件。 本文結合ARM公司RVDS集成開發環境中調試模塊組成部分Event Viewer系統的開發,實現了對通過原始數據源采集到的CoreSight跟蹤數據的完整實時解析,并最終在顯示模塊中將其包含的信息以可視化的形式直觀地展現給用戶,以供后續的程序性能分析和嵌入式軟件系統調試。研究了與本課題相關的一些技術,包括CoreSight調試體系結構、嵌入式常見調試技術、Eclipse平臺體系架構及其插件擴展點技術。在研究嵌入式集成開發環境國內外現狀及其發展趨勢的基礎上,結合Event Viewer系統的整體需求,介紹了系統的總體設計及其功能模塊劃分,并給出了系統的第三方擴展設計。討論了系統解析模塊的設計與實現。在分析CoreSight跟蹤數據解析流程的基礎上,對系統中解析模塊進行了詳細設計,并完成了基于ITM數據流的解析實現。結合系統的功能需求和解析模塊的設計,本文利用Eclipse插件擴展點機制,劃分解析模塊提供對外擴展,實現了系統向第三方產品提供商提供擴展接口的功能,第三方可以在此基礎上提供自己的解析處理。利用Eclipse View擴展點和SWT/JFace技術,實現了對跟蹤數據的前臺展示,包括Text、Event、Analog三種類型;本文著重討論了Analog展示部分的詳細設計和實現,將解析后得到的Analog數據信息以實時曲線圖的形式展現給客戶,提供對Analog數據變化趨勢的直觀描述。
標簽: ARMCoreSight 調試技術
上傳時間: 2013-04-24
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工程機械監控系統是利用計算機技術、現場總線技術、無線通信技術以及衛星定位技術對工程機械的運行狀態、位置等進行監測,是一個既復雜又龐大的系統,涉及的領域廣,而且由于其工作環境的特殊性,對系統的安全性、穩定性要求特別高。現在隨著嵌入式技術的不斷成熟與發展,高可靠性、小型化、人性化、網絡化和智能化將是其發展方向。 本文采用底層單元控制系統、車載監控系統和遠程監控系統三級網絡總體結構,對起重機底層安全控制單元進行監控。在底層單元中引入CAN總線,研究基于CAN總線協議的Hilon A協議實現底層各單元的通信。中間層以S3C2410和Linux為核心,融合嵌入式技術,開發Qt.Embedded界面,對實時采集起重機的吊重、風速、仰角信號狀態參數,以及通過計算比較判斷是否發生異常的狀態進行顯示。最后研究了GPRS網絡,完成遠程數據傳輸和遠程終端監控的通訊。 文中詳細介紹了系統的各部分硬件設計,結合硬件平臺實現了Linux操作系統的移植、引導加載程序BootLoader,構建了根文件系統。結合Linux操作系統平臺,實現了CAN總線通信、GPRS通訊、PPP腳本撥號、Socket網絡編程、LCD幀緩沖顯示設備Framebuffer、觸摸屏、A/D轉換器驅動程序的開發,并通過嵌入式圖形用戶Qt/Embedded在嵌入式Linux平臺上的移植,開發了友好的人機交互界面。
上傳時間: 2013-06-30
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