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  • STM32F407 GPIO復用功能

    STM32F407管腳復用介紹,能方便使用管腳的復用功能,對編程會用幫助

    標簽: F407 GPIO STM 32F

    上傳時間: 2013-05-27

    上傳用戶:invtnewer

  • 從硬件和軟件兩方面建立了基于DSP和FPGA的軟件無線電平臺

    從硬件和軟件兩方面建立了基于DSP和FPGA的軟件無線電平臺。重點研究了該實驗平臺多模式\\\\\\\\r\\\\\\\\n數字調制解調的硬件實現結構、軟件實現結構和不同模式之間的切換等,充分體現了軟件無線電系統的靈活性、\\\\\\\\r\\\\\\\\n開放性和兼容性等特點。

    標簽: FPGA DSP 軟件 硬件

    上傳時間: 2013-08-06

    上傳用戶:miaochun888

  • 基于FPGA 的出租車計價器系統設計

    摘要: 本文介紹了基于FPGA 的出租車計價器系統的功能、設計思想和實現, 該設計采用模塊化自上而下的層次化設計,頂\r\n層設計有5 個模塊,各模塊中子模塊采用VHDL 或圖形法設計。在Max+plusⅡ下實現編譯、仿真等,最后成功下載到FPGA 芯\r\n片中。完成了可預置自動計費、自動計程、計時、空車顯示等多功能計價器。由于FPGA 具有高密度、可編程及有強大的軟件\r\n支持等特點,所以該設計具有功能強、靈活和可靠性高等特點,具有一定的實用價值。

    標簽: FPGA 出租車計價器 系統設計

    上傳時間: 2013-08-09

    上傳用戶:Zxcvbnm

  • 用FPGA實現的8點32 位FFT 處理器方案

    :文章針對目前數字信號處理中大量采用的快速傅立葉變換[FFT] 算法采用軟件編程來處理的應用現狀,在對FFT 算法進行\\\\\\\\r\\\\\\\\n分析的基礎上,給出了用FPGA[Field Programmable Gate Array] 實現的8 點32 位FFT 處理器方案,并得到了系統的仿真結果。\\\\\\\\r\\\\\\\\n最后在Altera 公司FLEX10K系列FPGA 芯片上成功地實現了綜合。

    標簽: FPGA FFT 處理器 方案

    上傳時間: 2013-08-09

    上傳用戶:yangzhiwei

  • 一種以CPLD為核心、以VHDL為開發工具的時間控制器

    本文介紹一種以CPLD[1]為核心、以VHDL[2]為開發工具的時間控制器,該控制器不僅具有時間功能,而且具有定時器功能,能在00:00~23:59之間任意設定開啟時間和關閉時間,其設置方便、靈活,廣泛應用于路燈、廣告燈箱、霓虹燈等處的定時控制。

    標簽: CPLD VHDL 核心 開發工具

    上傳時間: 2013-08-16

    上傳用戶:chenjjer

  • 可編程邏輯器件的開發與應用實驗教學大綱

    可編程邏輯器件的開發與應用實驗教學大綱\r\n本課程是高等院校電氣、信息、通信類專業的一門技術基礎課。通過本課程的學習,使學生獲得數字系統設計和可編程邏輯器件方面的基本概念、基本知識和基本技能,培養他們對數字系統的分析與設計的能力,為后續課程的學習及今后的實際工作打下良好的基礎。

    標簽: 可編程邏輯器件 實驗 教學大綱

    上傳時間: 2013-08-26

    上傳用戶:shinesyh

  • 計PLD/FPGA時通常采用幾種時鐘類型

    無淪是用離散邏輯、可編程邏輯,還是用全定制硅器件實現的任何數字設計,為了成功地操\r\n作,可靠的時鐘是非常關鍵的。設計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將\r\n導致錯誤的行為,并且調試困難、花銷很大。 在設計PLD/FPGA時通常采用幾種時鐘類型。時鐘可\r\n分為如下四種類型:全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。多時鐘系統能夠包括上\r\n述四種時鐘類型的任意組合。

    標簽: FPGA PLD 時鐘

    上傳時間: 2013-09-04

    上傳用戶:yelong0614

  • Protel最新版本Altium Designer 6.0

    Altium Designer 6.0保留了包括全面集成化的版本控制系統的圖形化團隊設計功能,例如:內嵌了文檔歷史管理系統、新增強大的可以檢測原理圖與PCB  文件的差異的工程比較修正功能、元件到文檔的鏈接功能。Altium Designer 6.0 存儲管理器可以幫助比較并恢復舊的工程文件功能的高級文件控制和易用的備份管理;比較功能不僅能查找電氣差異,也包括原理圖與PCB 文檔間圖形變化;還提供無需第三方版本控制系統的完整的本地文件歷史管理功能。強大的設計比較工具不僅可以隨時用于同步原理圖工程到PCB,也可以被用于比較兩個文檔,例如:兩個網表、兩張原理圖、網表和PCB等等。還可以是元件與連通性比較。

    標簽: Designer Protel Altium 6.0

    上傳時間: 2013-11-03

    上傳用戶:RQB123

  • PADS9.3完整破解版和CadenceAllegro16.5完整破解版親測win7安裝下載地址

    請注意軟件勿用于商業用途,否則后果自負!請不要做拿手黨,好用大家享!頂起吧!解壓不成功時請把你們解壓軟件升級到最新版本! 附件也有本人學習PADS9.3、CadenceAllegro16.5、orcad軟件以及教程一塊上傳,下載時最好不要用第三方軟件,直接保存就可以了。 PADS9.3安裝說明(兼容win7、xp): 1.參考“PADS9.3圖文安裝方法(WIN7_XP)”完成軟件安裝。 2.參考“PADS9.3”完成破解!破解需要dos環境下完成,具體操作步驟教程有。 3.安裝目錄和源文件都不能是中文目錄 CadenceAllegro16.5(兼容win7、xp)兩個文件下載完成才能解壓,: 1.參考“真正的cadence_16.5_破解方法”按照操作步驟即可。 2.安裝目錄和源文件都不能是中文目錄 注意!!! 如果破解不成功有可能破解文件壞掉了,請把“Cadence_Allegro16.5crack-修正破解方法”文件解壓,用里面破解文件重新破解一遍!

    標簽: CadenceAllegro PADS 16.5 win7

    上傳時間: 2013-12-22

    上傳用戶:butterfly2013

  • genesis 2000 v9.1軟件下載

    enesis 2000 v9.1軟件可免費下載,但由cam之家提供制作,為綠化中文版。壓縮包里面有安裝說明與安裝視頻,注冊碼為:sx0397b10011。只要你的電腦有打印端口,完全可以安裝。非常方便。WINDOWS XP 系統是可以裝GENESIS2000的,不管什么版本,安裝文件不能放得太深,就是只能放在硬盤根目錄下面,要不然就無法啟動安裝程序,一閃而過。  

    標簽: genesis 2000 9.1 軟件

    上傳時間: 2013-10-18

    上傳用戶:hphh

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