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  • 電路原理課件.rar

    丘關(guān)源 電路原理課件 從第一章到第七章全是經(jīng)典 希望大家喜歡

    標(biāo)簽: 電路原理

    上傳時間: 2013-05-20

    上傳用戶:xhz1993

  • 基于FPGA的H.264變換量化、去方塊濾波研究及設(shè)計(jì).rar

    H.264/AVC是由國際電信聯(lián)合會的視頻專家組和國際標(biāo)準(zhǔn)化組織的運(yùn)動圖像專家組組成的聯(lián)合視頻小組制定的下一代視頻壓縮標(biāo)準(zhǔn)。新標(biāo)準(zhǔn)采用了一些先進(jìn)算法,因此具有優(yōu)異的壓縮性能和極好的網(wǎng)絡(luò)親和性,滿足低碼率情況下的高質(zhì)量視頻的傳輸。 H.264/AVC采用的先進(jìn)算法包括多模式幀間預(yù)測、1/4像素精度預(yù)測、整數(shù)變換量化、去方塊濾波和熵編碼。本論文著重對整數(shù)變換與量化、去方塊濾波做了研究。整數(shù)變換是一種只有加法和移位的運(yùn)算,量化可以通過查表和乘法操作就可以完成,避免了反變換的時候失配問題,沒有精度損失;去方塊濾波是一種用來去除低碼率情況下的每個宏塊的塊效應(yīng),提高了解碼圖像的外觀。 本文主要從算法研究和硬件實(shí)現(xiàn)兩方面著手,在算法研究方面設(shè)計(jì)了一個可視化測試軟件,在硬件實(shí)現(xiàn)方面主要對整數(shù)變換、量化和去方塊濾波做了研究和實(shí)現(xiàn)。視頻壓縮技術(shù)的關(guān)鍵在于視頻壓縮算法及其芯片的實(shí)現(xiàn),F(xiàn)PGA可重復(fù)使用,設(shè)計(jì)修改靈活,片內(nèi)資源豐富,具備DSP模塊等優(yōu)勢。在本論文的目標(biāo)實(shí)現(xiàn)部分模塊FPGA的硬件設(shè)計(jì),用Verilog完成了關(guān)鍵部分的設(shè)計(jì)。首先簡要介紹了視頻壓縮基本原理,常用視頻壓縮標(biāo)準(zhǔn)及其特性以及國內(nèi)外的研究動態(tài),并對H.264標(biāo)準(zhǔn)基本檔次所涉及的核心技術(shù)進(jìn)行了詳細(xì)介紹,兩種分層結(jié)構(gòu)分別討論。其次在掌握了H.264.算法及編解碼流程的基礎(chǔ)上,設(shè)計(jì)了基于H.264編解碼的可視化軟件平臺。然后詳細(xì)介紹了整數(shù)變換、量化、反變換和反量化核心模塊的設(shè)計(jì)和實(shí)現(xiàn),并在Altera的軟件和開發(fā)板上進(jìn)行了仿真驗(yàn)證;對去方塊濾波算法做了軟件研究測試,并給出了一種改進(jìn)的硬件整體結(jié)構(gòu)設(shè)計(jì)。最后,對全文工作進(jìn)行了總結(jié)和對未來研究工作做了展望。我在課題中所做的主要工作有: 1.查閱相關(guān)文獻(xiàn),熟悉H.264.標(biāo)準(zhǔn)及整數(shù)變換、量化和去方塊濾波等算法。 2.用VC++完成了基于H.264編解碼的可視化軟件平臺設(shè)計(jì)。 3.用Verilog完成了整數(shù)變換量化、反變換反量化模塊FPGA設(shè)計(jì)與驗(yàn)證。 4.去方塊濾波器的算法研究、仿真和硬件整體結(jié)構(gòu)設(shè)計(jì)。

    標(biāo)簽: FPGA 264 變換

    上傳時間: 2013-04-24

    上傳用戶:lanjisu111

  • H.264幀內(nèi)預(yù)測算法優(yōu)化及幾個重要模塊的FPGA實(shí)現(xiàn).rar

    H.264作為新一代視頻編碼標(biāo)準(zhǔn),相比上一代視頻編碼標(biāo)準(zhǔn)MPEG2,在相同畫質(zhì)下,平均節(jié)約64﹪的碼流。該標(biāo)準(zhǔn)僅設(shè)定了碼流的語法結(jié)構(gòu)和解碼器結(jié)構(gòu),實(shí)現(xiàn)靈活性極大,其規(guī)定了三個檔次,每個檔次支持一組特定的編碼功能,并支持一類特定的應(yīng)用,因此。H.264的編碼器的設(shè)計(jì)可以根據(jù)需求的不同而不同。 H.264雖然具有優(yōu)異的壓縮性能,但是其復(fù)雜度卻比一般編碼器高的多。本文對H.264進(jìn)行了編碼復(fù)雜度分析,并統(tǒng)計(jì)了整個軟件編碼中計(jì)算量的分布。H.264中采用了率失真優(yōu)化算法,提高了幀內(nèi)預(yù)測編碼的效率。在該算法下進(jìn)行幀內(nèi)預(yù)測時,為了得到一個宏塊的預(yù)測模式,需要進(jìn)行592次率失真代價(jià)計(jì)算。因此為了降低幀內(nèi)預(yù)測模式選擇的計(jì)算復(fù)雜度,本文改進(jìn)了幀內(nèi)預(yù)測模式選擇算法。實(shí)踐證明,在PSNR值的損失可以忽略不計(jì)的情況下,該算法相比原算法,幀內(nèi)編碼時間平均節(jié)約60﹪以上,對編碼的實(shí)時性有較大幫助。 為了實(shí)現(xiàn)實(shí)時編碼,考慮到FPGA的高效運(yùn)算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實(shí)現(xiàn)。首先研究了H.264編碼器硬件實(shí)現(xiàn)架構(gòu),并對影響編碼速度,且具有硬件實(shí)現(xiàn)優(yōu)越性的幾個重要部分進(jìn)行了算法研究和FPGA.實(shí)現(xiàn)。本文主要研究了H.264編碼器中整數(shù)DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數(shù)DCT變換等部分。分別對這些模塊進(jìn)行了綜合和時序仿真,并將驗(yàn)證后通過的系統(tǒng)模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進(jìn)行了在線測試,驗(yàn)證了該系統(tǒng)對輸入的殘差數(shù)據(jù)實(shí)時壓縮編碼的功能。 本文對H.264編碼器幀內(nèi)預(yù)測模式選擇算法的改進(jìn),算法實(shí)現(xiàn)簡單,對軟件編碼的實(shí)時性有很大幫助。本文對在單片F(xiàn)PGA上實(shí)現(xiàn)H.264編碼器做出了探索性嘗試,這對H.264編碼器芯片的設(shè)計(jì)有著積極的借鑒性。

    標(biāo)簽: FPGA 264 幀內(nèi)預(yù)測

    上傳時間: 2013-06-13

    上傳用戶:夜月十二橋

  • 基于H.264編解碼的算法優(yōu)化研究及FPGA的硬件實(shí)現(xiàn).rar

    H.264/AVC是由ITU和ISO兩大組織聯(lián)合組成的JVT共同制定的一項(xiàng)新的視頻壓縮技術(shù)標(biāo)準(zhǔn),在較低帶寬上提供高質(zhì)量的圖像傳輸是H.264/AVC的應(yīng)用亮點(diǎn)。在同樣的視覺質(zhì)量前提下,H.264/AVC比H.263和MPEG-4節(jié)約了50%的碼率。但H.264獲得優(yōu)越性能的代價(jià)是計(jì)算復(fù)雜度的增加,據(jù)估計(jì)其編碼的計(jì)算復(fù)雜度大約為H.263的3倍,因此很難應(yīng)用于實(shí)時視頻處理領(lǐng)域。針對這一現(xiàn)狀,業(yè)內(nèi)做了大量的研究工作,力圖降低其計(jì)算復(fù)雜度和提高運(yùn)行效率。比如在運(yùn)動估計(jì)方面,國內(nèi)外在這方面的研究已經(jīng)很成熟。而針對幀內(nèi)/幀間預(yù)測編碼的研究卻較少。因此研究預(yù)測模式的快速算法具有理論意義和應(yīng)用價(jià)值。 本文在詳細(xì)研究H.264標(biāo)準(zhǔn)視頻壓縮編碼特點(diǎn)基礎(chǔ)上,分析了H.264幀內(nèi)編碼, 幀間編碼及變換,量化技術(shù)的原理及特點(diǎn),提出了一種基于局部邊緣方向信息的快速幀內(nèi)模式判決算法,通過結(jié)合SAD的模式選擇方法來減少模式選擇數(shù)目。它采用了Sobel梯度算子計(jì)算當(dāng)前塊的邊緣信息,累加當(dāng)前塊中屬于同一方向像素點(diǎn)的邊緣矢量構(gòu)造不同模式下的邊緣方向直方圖,以便確定最可能的預(yù)測模式。該算法有效降低了編碼器的運(yùn)算復(fù)雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸?shù)馁|(zhì)量。 另外在幀間預(yù)測模式選擇算法方面進(jìn)行了改進(jìn)研究:按順序?qū)Σ煌愋瓦M(jìn)行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數(shù)量的同時,結(jié)合小塊模式搜索中途停止準(zhǔn)則來確定最優(yōu)模式。仿真表明:改進(jìn)算法相對與原來算法能夠節(jié)省很多的編碼時間(平均下降了49.3%),但帶來的圖像質(zhì)星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時在整數(shù)DCT變換模塊中,提出了一種快速蝶形算法,使得對4×4點(diǎn)數(shù)據(jù)做一次變換,只需通過8×8次加法和2×8次移位運(yùn)算便可完成,與原來12×8次加法和4×8次移位相比,新算法大大降低了運(yùn)算復(fù)雜度。 最后介紹FPGA的特點(diǎn)及設(shè)計(jì)流程,并實(shí)現(xiàn)了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實(shí)現(xiàn)的H.264編碼視頻處理模塊設(shè)計(jì)具備了成本低,周期短,設(shè)計(jì)方法靈活等優(yōu)點(diǎn),具有廣闊的市場應(yīng)用前景。 仿真表明,通過使用本文提出的幀內(nèi)/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺上實(shí)現(xiàn)實(shí)時編碼。

    標(biāo)簽: FPGA 264 編解碼

    上傳時間: 2013-07-18

    上傳用戶:zukfu

  • 51單片機(jī)初學(xué)者課件.zip

    單片機(jī)初學(xué)者課件,是你走進(jìn)單片機(jī)世界的第一步,一定要把握好

    標(biāo)簽: zip 51單片機(jī) 初學(xué)者

    上傳時間: 2013-06-14

    上傳用戶:西伯利亞

  • 中文固件庫.rar

    stm32的中文固件庫,哈哈,不用啃英文了

    標(biāo)簽: 固件

    上傳時間: 2013-07-18

    上傳用戶:3233

  • Uc_OS-II精彩課件.rar

    ucosII精彩課件,適合初學(xué)者。講得比較詳細(xì)。

    標(biāo)簽: Uc_OS-II

    上傳時間: 2013-07-24

    上傳用戶:huangld

  • 馬老師課件.rar

    關(guān)于屏蔽、濾波、接地技術(shù)相關(guān)文件(馬老師課件)

    標(biāo)簽:

    上傳時間: 2013-06-04

    上傳用戶:user08x

  • 適用于H.264視頻解碼器的VLD設(shè)計(jì)

    設(shè)計(jì)了一種適合于H.264 的變字長解碼器根據(jù)碼流特點(diǎn)進(jìn)行模塊劃分減少硬件開銷采用并行結(jié)構(gòu)解NAL 包解碼效率高采用了桶形移位器進(jìn)行并行解碼每個時鐘解一個碼字采用Verilog 語言進(jìn)行設(shè)計(jì)仿真并通過

    標(biāo)簽: 264 VLD 視頻解碼器

    上傳時間: 2013-07-15

    上傳用戶:shen007yue

  • h.264官方中文版

    H.264官方中文版,H.264官方中文版,H.264官方中文版,H.264官方中文版

    標(biāo)簽: 264

    上傳時間: 2013-05-27

    上傳用戶:h886166

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