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車輛交通系統(tǒng)(tǒng)管理

  • 用Verilog HDL語言編寫的交通燈程序

    這是一個用Verilog HDL語言編寫的交通燈程序?？梢杂肣uartus II運行。

    標簽： Verilog HDL 語言 編寫

    上傳時間： 2013-08-19

    上傳用戶：alex wang

  • 基于CPLD的交通燈系統(tǒng)設(shè)計

    基于CPLD的交通燈系統(tǒng)設(shè)計，可以給大家參考一下喲

    標簽： CPLD 交通燈 系統(tǒng)設(shè)計

    上傳時間： 2013-08-24

    上傳用戶：x18010875091

  • fpga/CPLD開發(fā)管理Digit-Serial DSP Functions

    fpga/CPLD開發(fā)管理Digit-Serial DSP Functions

    標簽： Digit-Serial Functions fpga CPLD

    上傳時間： 2013-08-30

    上傳用戶：lz4v4

  • 基于cpld的交通燈設(shè)計

    基于cpld的交通燈設(shè)計\r\n

    標簽： cpld 交通燈

    上傳時間： 2013-08-31

    上傳用戶：skfreeman

  • EDA 實驗原代碼 包括數(shù)字脈沖 觸發(fā)器 和交通燈等

    EDA 實驗原代碼 包括數(shù)字脈沖 觸發(fā)器 和交通燈等

    標簽： EDA 實驗 代碼 交通燈

    上傳時間： 2013-09-01

    上傳用戶：wdq1111

  • 交通燈信號的FPGA實現(xiàn)-Verilog語言編程

    交通燈信號的ｆｐｇａ實現(xiàn)。通過ｖｅｒｉｌｏｇ語言編程，在ｆｐｇａ上調(diào)試通過。

    標簽： Verilog FPGA 交通燈 信號

    上傳時間： 2013-09-04

    上傳用戶：xwd2010

  • 數(shù)據(jù)管理：包括司機基本信息、汽車基本信息、車輛事故信息、車輛維修信

    1．數(shù)據(jù)管理：包括司機基本信息、汽車基本信息、車輛事故信息、車輛維修信\r\n息等的管理；\r\n2．派車運營記錄管理：登記派車的情況、進行派車修改；\r\n來確定庫存是否有需要的車型，為賣車做好準備；\r\n3．查詢管理：能夠根據(jù)車輛編號和派車日期查詢當日的派車情況，并能進行統(tǒng)\r\n計派車次數(shù)等；\r\n 4．系統(tǒng)管理：用戶管理和系統(tǒng)退出等。\r\n

    標簽： 數(shù)據(jù)管理 汽車

    上傳時間： 2013-09-09

    上傳用戶：wanqunsheng

  • Protel 99SE采用數(shù)據(jù)庫的管理方式

    Protel 99SE采用數(shù)據(jù)庫的管理方式。Protel 99SE軟件沿襲了Protel以前版本方便易學的特點，內(nèi)部界面與Protel 99大體相同，新增加了一些功能模塊，功能更加強大。新增的層堆棧管理功能，可以設(shè)計32個信號層，16個地電層，

    標簽： Protel 99 SE 數(shù)據(jù)庫

    上傳時間： 2013-09-10

    上傳用戶：我累個乖乖

  • Protel采用數(shù)據(jù)庫的管理方式

    Protel 99SE采用數(shù)據(jù)庫的管理方式。Protel 99SE軟件沿襲了 Protel 以前版本方便易學的特點，內(nèi)部界面與 Protel 99 大體相同，新增加了一些功能模塊，功能更加強大。新增的層堆棧管理功能，可以設(shè)計 32 個信號層，16 個地電層，16 個機械層。新增的 3D 功能讓您在加工印制版之前可以看到板的三維效果。增強的打印功能，使您可以輕松修改打印設(shè)置控制打印結(jié)果。Protel 99SE容易使用的特性還體現(xiàn)在“這是什么”幫助，按下右上角的小問號，然后輸入你所要的信息，可以很快地看到特性的功能，然后用到設(shè)計中，按下狀態(tài)   欄末端的按鈕，使用自然語言幫助顧問。

    標簽： Protel 數(shù)據(jù)庫 方式

    上傳時間： 2013-12-23

    上傳用戶：彭玖華

  • EDA工程建模及其管理方法研究2

    EDA工程建模及其管理方法研究2 1 隨著微電子技術(shù)與計算機技術(shù)的日益成熟，電子設(shè)計自動化(EDA)技術(shù)在電子產(chǎn)品與集成電路 (IC)芯片特別是單片集成(SoC)芯片的設(shè)計應用中顯得越來越重要。EDA技術(shù)采用“自上至下”的設(shè)計思想，允許設(shè)計人員能夠從系統(tǒng)功能級或電路功能級進行產(chǎn)品或芯片的設(shè)計，有利于產(chǎn)品在系統(tǒng)功能上的綜合優(yōu)化，從而提高了電子設(shè)計項目的協(xié)作開發(fā)效率，降低新產(chǎn)品的研發(fā)成本。 近十年來，EDA電路設(shè)計技術(shù)和工程管理方面的發(fā)展主要呈現(xiàn)出兩個趨勢： (1) 電路的集成水平已經(jīng)進入了深亞微米的階段，其復雜程度以每年58％的幅度迅速增加，芯片設(shè)計的抽象層次越來越高，而產(chǎn)品的研發(fā)時限卻不斷縮短。 (2) IC芯片的開發(fā)過程也日趨復雜。從前期的整體設(shè)計、功能分，到具體的邏輯綜合、仿真測試，直至后期的電路封裝、排版布線，都需要反復的驗證和修改，單靠個人力量無法完成。IC芯片的開發(fā)已經(jīng)實行多人分組協(xié)作。由此可見，如何提高設(shè)計的抽象層次，在較短時間內(nèi)設(shè)計出較高性能的芯片，如何改進EDA工程管理，保證芯片在多組協(xié)作設(shè)計下的兼容性和穩(wěn)定性，已經(jīng)成為當前EDA工程中最受關(guān)注的問題。

    標簽： EDA 工程建模 管理方法

    上傳時間： 2013-11-10

    上傳用戶：yan2267246

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