近年來，以電池作為電源的微電子產(chǎn)品得到廣泛使用，因而迫切要求采用低電源電壓的模擬電路來降低功耗。目前低電壓、低功耗的模擬電路設(shè)計技術(shù)正成為微電子行業(yè)研究的熱點(diǎn)之一。 在模擬集成電路中，運(yùn)算放大器是最基本的電路，所以設(shè)計低電壓、低功耗的運(yùn)算放大器非常必要。在實現(xiàn)低電壓、低功耗設(shè)計的過程中，必須考慮電路的主要性能指標(biāo)。由于電源電壓的降低會影響電路的性能，所以只實現(xiàn)低壓、低功耗的目標(biāo)而不實現(xiàn)優(yōu)良的性能(如高速)是不大妥當(dāng)?shù)摹?論文對國內(nèi)外的低電壓、低功耗模擬電路的設(shè)計方法做了廣泛的調(diào)查研究，分析了這些方法的工作原理和各自的優(yōu)缺點(diǎn)，在吸收這些成果的基礎(chǔ)上設(shè)計了一個3.3 V低功耗、高速、軌對軌的CMOS/BiCMOS運(yùn)算放大器。在設(shè)計輸入級時，選擇了兩級直接共源一共柵輸入級結(jié)構(gòu)；為穩(wěn)定運(yùn)放輸出共模電壓，設(shè)計了共模負(fù)反饋電路，并進(jìn)行了共?；芈费a(bǔ)償；在偏置電路設(shè)計中，電流鏡負(fù)載并不采用傳統(tǒng)的標(biāo)準(zhǔn)共源-共柵結(jié)構(gòu)，而是采用適合在低壓工況下的低壓、寬擺幅共源-共柵結(jié)構(gòu)；為了提高效率，在設(shè)計時采用了推挽共源極放大器作為輸出級，輸出電壓擺幅基本上達(dá)到了軌對軌；并采用帶有調(diào)零電阻的密勒補(bǔ)償技術(shù)對運(yùn)放進(jìn)行頻率補(bǔ)償。 采用標(biāo)準(zhǔn)的上華科技CSMC 0.6μpm CMOS工藝參數(shù)，對整個運(yùn)放電路進(jìn)行了設(shè)計，并通過了HSPICE軟件進(jìn)行了仿真。結(jié)果表明，當(dāng)接有5 pF負(fù)載電容和20 kΩ負(fù)載電阻時，所設(shè)計的CMOS運(yùn)放的靜態(tài)功耗只有9.6 mW，時延為16.8ns，開環(huán)增益、單位增益帶寬和相位裕度分別達(dá)到82.78 dB，52.8 MHz和76°，而所設(shè)計的BiCMOS運(yùn)放的靜態(tài)功耗達(dá)到10.2 mW，時延為12.7 ns，開環(huán)增益、單位增益帶寬和相位裕度分別為83.3 dB、75 MHz以及63°，各項技術(shù)指標(biāo)都達(dá)到了設(shè)計要求。
標(biāo)簽： CMOSBiCMOS 低壓 低功耗
上傳時間： 2013-06-29
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該講義由德州儀器的高級工程師主講。主要講述放大器如何才能穩(wěn)定的工作，
標(biāo)簽： 運(yùn)算放大器 穩(wěn)定性分析
上傳時間： 2013-07-07
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應(yīng)用于煤礦、石化等易燃易爆環(huán)境的電子設(shè)備必須滿足防爆的要求，本質(zhì)安全型是最佳的防爆形式。本質(zhì)安全型開關(guān)電源具有重量輕、體積小、制造工藝簡單、成本低、安全性能高等優(yōu)點(diǎn)，因而具有廣闊的發(fā)展前景。單端反激變換器是開關(guān)變換器的一種基本的拓?fù)浣Y(jié)構(gòu)，在實際中應(yīng)用比較廣泛，因此對單端反激變換器進(jìn)行本質(zhì)安全特性分析是本質(zhì)安全開關(guān)電源設(shè)計的重要基礎(chǔ)。本質(zhì)安全型開關(guān)變換器的設(shè)計，主要是對變換器中的儲能元件進(jìn)行設(shè)計，即變換器中的電感和輸出濾波電容進(jìn)行設(shè)計。 本文對變換器的靜態(tài)特性進(jìn)行了深入分析，指出反激變換器存在三種工作模式：CISM-CCM、IISM-CCM和DCM：得出了變換器工作在整個動態(tài)范圍內(nèi)的最大輸出紋波電壓、最大電感電流和最大輸出短路釋放能量。對單端反激變換器的本質(zhì)安全特性進(jìn)行了分析，得出輸出本質(zhì)安全型單端反激變換器的非爆炸判斷方法，并通過安全火花試驗裝置對變換器進(jìn)行爆炸性試驗，驗證了輸出本安判據(jù)的正確性。得出輸出本質(zhì)安全型單端反激變換器的設(shè)計方法，以同時滿足輸出紋波電壓和輸出本安要求作為約束條件，得到了本質(zhì)安全型單端反激變換器電感、電容參數(shù)的設(shè)計范圍。給出了具體實例，并進(jìn)行仿真和試驗研究，仿真和實驗結(jié)果驗證了理論分析的正確性和設(shè)計方法的可行性。
上傳時間： 2013-06-25
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MOS集成運(yùn)算放大器的版圖設(shè)計 集成電路設(shè)計綜合實驗指導(dǎo)書
標(biāo)簽： MOS 集成運(yùn)算放大器 版圖設(shè)計
上傳時間： 2013-04-24
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單電源運(yùn)算放大器電路應(yīng)用圖集單電源運(yùn)算放大器電路應(yīng)用圖集
標(biāo)簽： 單電源 運(yùn)算放大器 電路應(yīng)用
上傳時間： 2013-06-15
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運(yùn)算放大器、比較器設(shè)計指南,運(yùn)算放大器、比較器設(shè)計指南
標(biāo)簽： 運(yùn)算放大器 比較器 設(shè)計指南
上傳時間： 2013-07-19
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數(shù)字D類音頻放大器，也叫數(shù)字脈沖調(diào)制放大器，具有效率高，低電壓，低失真的特點(diǎn)，在低成本，高性能的消費(fèi)類產(chǎn)品特別是便攜式設(shè)備中得到越來越廣泛的應(yīng)用。數(shù)字D類放大器包括數(shù)字脈沖寬度調(diào)制（PWM）和輸出級（含低通濾波器）兩個部分，數(shù)字PWM又包括兩個部分，采樣處理和脈沖產(chǎn)生。傳統(tǒng)的采樣處理算法運(yùn)算復(fù)雜，硬件實現(xiàn)成本高，面積大，從而導(dǎo)致功耗也大，不適合當(dāng)今向低功耗發(fā)展的趨勢。 本文在傳統(tǒng)算法的基礎(chǔ)上提出了一種新的算法，該算法不包括乘法或者除法這些計算復(fù)雜和非常消耗硬件資源的單元，只含加法和減法運(yùn)算。在推導(dǎo)出該算法的傅立葉表達(dá)式后，在MATLAB的simulink中建立系統(tǒng)模型進(jìn)行仿真以驗證算法的可行性，在輸入信號頻率為1kHZ，采樣頻率為48kHZ，電源電壓為10V，輸出負(fù)載為4Ω的條件下，得到的總諧波失真為0．12％，符合D類放大器的性能要求。本文還在基于Xilinx公司的Spartan-3系列FPGA的基礎(chǔ)上實現(xiàn)了該算法的電路結(jié)構(gòu)，綜合結(jié)果表明，實現(xiàn)基于本文算法的數(shù)字D類音頻系統(tǒng)所需要的硬件資源大大減少，從而減少了功耗。 關(guān)鍵詞：D類放大器；脈沖寬度調(diào)制；采樣算法；數(shù)字音頻放大器；FPGA
上傳時間： 2013-07-19
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主要介紹如何使用運(yùn)算放大器，既有理論，又有實踐電路
標(biāo)簽： 運(yùn)算放大器
上傳時間： 2013-07-25
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運(yùn)算放大器是一種應(yīng)用非常廣泛的器件，如何調(diào)整運(yùn)算放大器的反饋環(huán)，以及如何面對各種不同特性的負(fù)載等等，是我們必須面對的一個問題。相信你讀完本文你會有所斬獲。
標(biāo)簽： 運(yùn)算放大器
上傳時間： 2013-05-26
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帶有負(fù)反饋的光電耦合線性放大器，含原理圖，PCB及multisim仿真
上傳時間： 2013-06-23
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