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語音報(bào)站器

  • MP3音頻解碼器的FPGA原型芯片設(shè)計(jì)與實(shí)現(xiàn).rar

    MP3音樂是目前最為流行的音樂格式,因其音質(zhì)、復(fù)雜度與壓縮比的完美折中,占據(jù)著廣闊的市場,不僅在互聯(lián)網(wǎng)上廣為流傳,而且在便攜式設(shè)備領(lǐng)域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象,在實(shí)時性、面積等約束條件下,研究MP3解碼電路的設(shè)計(jì)方法,實(shí)現(xiàn)FPGA原型芯片,研究MP3原型芯片的驗(yàn)證方法。 論文的主要貢獻(xiàn)如下: (1)使用算法融合方法合并MP3解碼過程的相關(guān)步驟,以減少緩沖區(qū)存儲單元的容量和訪存次數(shù)。如把重排序步驟融合到反量化模塊,可以減少一半的讀寫RAM操作;把IMDCT模塊內(nèi)部的三個算法步驟融合在一起進(jìn)行設(shè)計(jì),可以省去存儲中間計(jì)算結(jié)果的緩存區(qū)單元。 (2)反量化、立體聲處理等模塊中,采用流水線設(shè)計(jì)技術(shù),設(shè)置寄存器把較長的組合邏輯路徑隔開,提高了電路的性能和可靠性;使用連續(xù)訪問公共緩存技術(shù),合理規(guī)劃各計(jì)算子模塊的工作時序,將數(shù)據(jù)計(jì)算的時間隱藏在訪存過程中;充分利用頻率線的零值區(qū)特性,有效地減少數(shù)據(jù)計(jì)算量,加快了數(shù)據(jù)處理的速度。 (3)設(shè)計(jì)了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設(shè)計(jì)RTL級電路,完成功能仿真,以Altera公司Stratix II系列的EP2S180 FPGA開發(fā)板為平臺,實(shí)現(xiàn)MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內(nèi)的資源利用率約為5%,其中組合邏輯查找表ALUT為7189個,寄存器共有4024個,系統(tǒng)頻率可達(dá)69.6MHz,充分滿足了MP3解碼過程的實(shí)時性要求。實(shí)驗(yàn)結(jié)果表明,MP3音頻解碼FPGA原型芯片可正常播放聲音,解碼音質(zhì)良好。

    標(biāo)簽: FPGA MP3 音頻解碼器

    上傳時間: 2013-07-01

    上傳用戶:xymbian

  • 安川變頻器逆變電路.rar

    安川變頻器的大功率逆變電路很有特色,它沒有采用負(fù)電源,值得大家學(xué)習(xí)。

    標(biāo)簽: 變頻器 逆變電路

    上傳時間: 2013-07-28

    上傳用戶:kkchan200

  • DVBSS2調(diào)制器的設(shè)計(jì)及其FPGA實(shí)現(xiàn).rar

    數(shù)字高清電視是當(dāng)前世界上最先進(jìn)的圖像壓縮編碼技術(shù)和數(shù)字傳輸技術(shù)的結(jié)合,是高技術(shù)競爭的焦點(diǎn)之一。其中,信道處理系統(tǒng)及其相關(guān)芯片更是集中了數(shù)字信號處理、前向糾錯編解碼等數(shù)字電視傳輸?shù)暮诵募夹g(shù),成為設(shè)計(jì)和開發(fā)整個數(shù)字電視系統(tǒng)的關(guān)鍵技術(shù)之一。本文以衛(wèi)星數(shù)字電視的信道處理系統(tǒng)為對象,結(jié)合國際通行的DVB-S/S2標(biāo)準(zhǔn),研究了該系統(tǒng)在發(fā)射端的設(shè)計(jì)與實(shí)現(xiàn)所涉及到的一系列內(nèi)容。 本文介紹了數(shù)字電視的發(fā)展概況和主要標(biāo)準(zhǔn),特別是對我國衛(wèi)星電視的發(fā)展進(jìn)行了詳細(xì)的介紹。然后,本文DVB-S/S2信道處理系統(tǒng)的基本原理進(jìn)行了介紹和分析,主要包括RS碼、卷積碼、BCH碼、LDPC碼等的差錯編碼的基本原理,以及基帶信號處理的基本原理。在此基礎(chǔ)上對兩種系統(tǒng)的傳輸性能和DVB-S2的后向兼容系統(tǒng)分別進(jìn)行了基于Matlab的仿真。最后闡述了基于FPGA的DVB-S調(diào)制器的信道編碼和調(diào)制實(shí)現(xiàn),按功能對DVB-S/S2信道編碼過程進(jìn)行模塊分解,并針對每個模塊進(jìn)行工作原理分析、算法分析、HDL描述、時序仿真及FPGA實(shí)現(xiàn)。DVB-S/S2調(diào)制器的核心是信道編碼和調(diào)制部分,利用FPGA在數(shù)字信號處理方面的優(yōu)勢,本文重點(diǎn)對其中的幾個關(guān)鍵模塊,包括RS編碼、卷積交織器、卷積編碼、BCH編碼、LDPC編碼等的實(shí)現(xiàn)算法進(jìn)行了比較詳細(xì)的分析,并通過HDL描述和時序仿真來驗(yàn)證算法正確性。

    標(biāo)簽: DVBSS2 FPGA 調(diào)制器

    上傳時間: 2013-07-10

    上傳用戶:gmh1314

  • 基于FPGA的絕對式光電編碼器通信接口研究.rar

    高速、高精度已經(jīng)成為伺服驅(qū)動系統(tǒng)的發(fā)展趨勢,而位置檢測環(huán)節(jié)是決定伺服系統(tǒng)高速、高精度性能的關(guān)鍵環(huán)節(jié)之一。光電編碼器作為伺服驅(qū)動系統(tǒng)中常用的檢測裝置,根據(jù)結(jié)構(gòu)和原理的不同分為增量式和絕對式。本文從原理上對增量式光電編碼器和絕對式光電編碼器做了深入的分析,通過對比它們的特性,得出了絕對式光電編碼器更適合高速、高精度伺服驅(qū)動系統(tǒng)的結(jié)論。 絕對式光電編碼器精度高、位數(shù)多的特點(diǎn)決定其通信方式只能采取串行傳輸方式,且由相應(yīng)的通信協(xié)議控制信息的傳輸。本文首先針對編碼器主要生產(chǎn)廠商日本多摩川公司的絕對式光電編碼器,深入研究了通信協(xié)議相關(guān)的硬件電路、數(shù)據(jù)幀格式、時序等。隨后介紹了新興的電子器件FPGA及其開發(fā)語言硬件描述語言Verilog HDL,并對基于FPGA的絕對式編碼器通信接口電路做了可行性的分析。在此基礎(chǔ)上,采用自頂向下的設(shè)計(jì)方法,將整個接口電路劃分成發(fā)送模塊、接收模塊、序列控制模塊等多個模塊,各個模塊采用Verilog語言進(jìn)行描述設(shè)計(jì)編碼器接口電路。最終的設(shè)計(jì)在相關(guān)硬件電路上實(shí)現(xiàn)。最后,通過在TMS320F2812伺服控制平臺上編寫的硬件驅(qū)動程序驗(yàn)證了整個設(shè)計(jì)的各項(xiàng)功能,達(dá)到了設(shè)計(jì)的要求。

    標(biāo)簽: FPGA 光電編碼器 通信接口

    上傳時間: 2013-07-11

    上傳用戶:snowkiss2014

  • 數(shù)字電視傳輸系統(tǒng)中LDPC碼編碼器的研究與FPGA實(shí)現(xiàn).rar

    自香農(nóng)先生于1948年開創(chuàng)信息論以來,經(jīng)過將近60年的發(fā)展,信道編碼技術(shù)已經(jīng)成為通信領(lǐng)域的一個重要分支,各種編碼技術(shù)層出不窮。目前廣泛研究的低密度奇偶校驗(yàn)(LDCP)碼是由R.G.Gallager先生提出的一種具有逼近香農(nóng)限性能的優(yōu)秀糾錯碼,并已在數(shù)字電視、無線通信、磁盤存儲等領(lǐng)域得到大量應(yīng)用。 目前數(shù)字電視已經(jīng)成為最熱門的話題之一,用手機(jī)看北京奧運(yùn),已經(jīng)成為每一個中國人的夢想。最近兩年我國頒布了兩部與數(shù)字電視有關(guān)的通信標(biāo)準(zhǔn),分別是數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)(DMB-TH)和移動多媒體(CMMB)即俗稱的手機(jī)電視標(biāo)準(zhǔn)。數(shù)字電視正與每個人走得越來越近,我國預(yù)期在2015年全面實(shí)現(xiàn)數(shù)字電視并停止模擬電視的播出。作為數(shù)字電視標(biāo)準(zhǔn)的核心技術(shù)之一的前向糾錯碼技術(shù)已經(jīng)成為眾多科研單位的研究熱點(diǎn),相應(yīng)的編解碼芯片更成為重中之重。在DMB-TH標(biāo)準(zhǔn)中用到了LDPC碼和BCH碼的級聯(lián)編碼方式,在CMMB標(biāo)準(zhǔn)中用到了LDPC碼和RS碼的級聯(lián)編碼方式,在DVB-S2標(biāo)準(zhǔn)中用到了LDPC碼和BCH碼的級聯(lián)編碼方式。 本論文以目前最重要的三個與數(shù)字電視相關(guān)的標(biāo)準(zhǔn):數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)(DMB-TH)、手機(jī)電視標(biāo)準(zhǔn)(CMMB)以及數(shù)字衛(wèi)星電視廣播標(biāo)準(zhǔn)(DVB-S2)為切入點(diǎn),深入研究它們的編碼方式,設(shè)計(jì)了這三個標(biāo)準(zhǔn)中的LDPC碼編碼器,并在FPGA上實(shí)現(xiàn)了前兩個標(biāo)準(zhǔn)的編碼芯片,實(shí)現(xiàn)了DMB-TH標(biāo)準(zhǔn)中0.4、0.6以及0.8三種碼率的復(fù)用。在研究CMMB標(biāo)準(zhǔn)中編碼器設(shè)計(jì)時,提出一種改進(jìn)的LU分解算法,該分解方式適合任意的H矩陣,具有一定的廣泛性。測試結(jié)果表明,芯片邏輯功能完全正確,速度和資源消耗均達(dá)到了標(biāo)準(zhǔn)的要求,具有一定的商用價值。

    標(biāo)簽: LDPC FPGA 數(shù)字電視

    上傳時間: 2013-07-07

    上傳用戶:327000306

  • WCDMA數(shù)字直放站中數(shù)字預(yù)失真研究及其FPGA實(shí)現(xiàn).rar

    現(xiàn)代社會對各種無線通信業(yè)務(wù)的需求迅猛增長,這就要求無線通信在具有較高傳輸質(zhì)量的同時,還必須具有較大的傳輸容量。這種需求要求在無線通信中必須采用效率較高的線性調(diào)制方式,以提高有限頻帶帶寬的數(shù)據(jù)速率和頻譜利用率,而效率較高的調(diào)制方式通常會對發(fā)端發(fā)射機(jī)的線性要求較高,這就使功率放大器線性化技術(shù)成為下一代無線通信系統(tǒng)的關(guān)鍵技術(shù)之一。 在本文中,研究了前人所提出的各種功放線性化技術(shù),如功率回退法、正負(fù)反饋法、預(yù)失真和非線性器件法等等,針對功率放大器對信號的失真放大問題進(jìn)行研究,對比和研究了目前廣泛流行的自適應(yīng)數(shù)字預(yù)失真算法。在一般的自適應(yīng)數(shù)字預(yù)失真算法中,主要有兩類:無記憶非線性預(yù)失真和有記憶非線性預(yù)失真。無記憶非線性預(yù)失真主要是通過比較功率放大器的反饋信號和已知輸入信號的幅度和相位的誤差來估計(jì)預(yù)失真器的各種修正參數(shù)。而有記憶非線性預(yù)失真主要是綜合考慮功率放大器非線性和記憶性對信號的污染,需要同時分析信號的當(dāng)前狀態(tài)和歷史狀態(tài)。在對比完兩種數(shù)字預(yù)失真算法之后,文章著重分析了有記憶預(yù)失真算法,選擇了其中的多項(xiàng)式預(yù)失真算法進(jìn)行了具體分析推演,并通過軟件無線電的方法將數(shù)字信號處理與FPGA結(jié)合起來,在內(nèi)嵌了System Generator軟件的Matlab/Simulink上對該算法進(jìn)行仿真分析,證明了這個算法的性能和有效性。 本文另外一個最重要的創(chuàng)新點(diǎn)在于,在FPGA設(shè)計(jì)上,使用了系統(tǒng)級設(shè)計(jì)的思路,與Xilinx公司提供的軟件能夠很好的配合,在完成仿真后能夠直接將代碼轉(zhuǎn)換成FPGA的網(wǎng)表文件或者硬件描述語言,大大簡化了開發(fā)過程,縮短了系統(tǒng)的開發(fā)周期。

    標(biāo)簽: WCDMA FPGA 數(shù)字

    上傳時間: 2013-06-20

    上傳用戶:handless

  • 基于FPGA與AD9857的四路DVBC調(diào)制器的設(shè)計(jì).rar

    隨著數(shù)字時代的到來,信息化程度的不斷提高,人們相互之間的信息和數(shù)據(jù)交換日益增加。正交幅度調(diào)制器(QAM Modulator)作為一種高頻譜利用率的數(shù)字調(diào)制方式,在數(shù)字電視廣播、固定寬帶無線接入、衛(wèi)星通信、數(shù)字微波傳輸?shù)葘拵ㄐ蓬I(lǐng)域得到了廣泛應(yīng)用。 近年來,集成電路和數(shù)字通信技術(shù)飛速發(fā)展,F(xiàn)PGA作為集成度高、使用方便、代碼可移植性等優(yōu)點(diǎn)的通用邏輯開發(fā)芯片,在電子設(shè)計(jì)行業(yè)深受歡迎,市場占有率不斷攀升。本文研究基于FPGA與AD9857實(shí)現(xiàn)四路QAM調(diào)制的全過程。FPGA實(shí)現(xiàn)信源處理、信道編碼輸出四路基帶I/Q信號,AD9857實(shí)現(xiàn)對四路I/Q信號的調(diào)制,輸出中頻信號。本文具體內(nèi)容總結(jié)如下: 1.介紹國內(nèi)數(shù)字電視發(fā)展?fàn)顩r、國內(nèi)國際的數(shù)字電視標(biāo)準(zhǔn),并詳細(xì)介紹國內(nèi)有線電視的系統(tǒng)組成及QAM調(diào)制器的發(fā)展過程。 2.研究了QAM調(diào)制原理,其中包括信源編碼、TS流標(biāo)準(zhǔn)格式轉(zhuǎn)換、信道編碼的原理及AD9857的工作原理等。并著重研究了信道編碼過程,包括能量擴(kuò)散、RS編碼、數(shù)據(jù)交織、星座映射與差分編碼等。 3.深入研究了基于FPAG與AD9857電路設(shè)計(jì),其中包括詳細(xì)研究了FPGA與AD9857的電路設(shè)計(jì)、在allegro下的PCB設(shè)計(jì)及光繪文件的制作,并做成成品。 4.簡單介紹了FPGA的開發(fā)流程。 5.深入研究了基于FPAG代碼開發(fā),其中主要包括I2C接口實(shí)現(xiàn),ASI到SPI的轉(zhuǎn)換,信道編碼中的TS流包處理、能量擴(kuò)散、RS編碼、數(shù)據(jù)交織、星座映射與差分編碼的實(shí)現(xiàn)及AD9857的FPGA控制使其實(shí)現(xiàn)四路QAM的調(diào)制。 6.介紹代碼測試、電路測試及系統(tǒng)指標(biāo)測試。 最終系統(tǒng)指標(biāo)測試表明基于FPGA與AD9857的四路DVB-C調(diào)制器基本達(dá)到了國標(biāo)的要求。

    標(biāo)簽: FPGA 9857 DVBC

    上傳時間: 2013-04-24

    上傳用戶:sn2080395

  • WCDMA數(shù)字直放站數(shù)字上下變頻及降低峰均比的研究與FPGA實(shí)現(xiàn).rar

    隨著3G網(wǎng)絡(luò)建設(shè)的展開,移動用戶數(shù)量逐漸增加,用戶和運(yùn)營商對網(wǎng)絡(luò)的質(zhì)量和覆蓋要求也越來越高。而在實(shí)際工作中,基站成本在網(wǎng)絡(luò)投資中占有很大比例,并且基站選址是建網(wǎng)的主要難題之一。同基站相比,直放站以其性價比高、建設(shè)周期短等優(yōu)點(diǎn)在我國移動網(wǎng)絡(luò)上有著大量的應(yīng)用。目前,直放站已成為提高運(yùn)營商網(wǎng)絡(luò)質(zhì)量、解決網(wǎng)絡(luò)盲區(qū)或弱區(qū)問題、增強(qiáng)網(wǎng)絡(luò)覆蓋的主要手段之一。但由于傳統(tǒng)的模擬直放站受周邊環(huán)境因素影響較大、抗干擾能力較差、傳輸距離受限、功放效率低,同時設(shè)備間沒有統(tǒng)一的協(xié)議規(guī)范,無法滿足系統(tǒng)廠商與直放站廠商的兼容,所以移動通信市場迫切需要通過數(shù)字化來解決這些問題。 本文正是以設(shè)計(jì)新型數(shù)字化直放站為目標(biāo),以實(shí)現(xiàn)數(shù)字中頻系統(tǒng)為研究重心,圍繞數(shù)字中頻的相關(guān)技術(shù)而展開研究。 文章介紹了數(shù)字直放站的研究背景和國內(nèi)外的研究現(xiàn)狀,闡述了數(shù)字直放站系統(tǒng)的設(shè)計(jì)思想及總體實(shí)現(xiàn)框圖,并對數(shù)字直放站數(shù)字中頻部分進(jìn)行了詳細(xì)的模塊劃分。針對其中的數(shù)字上下變頻模塊設(shè)計(jì)所涉及到的相關(guān)技術(shù)作詳細(xì)介紹,涉及到的理論主要有信號采樣理論、整數(shù)倍內(nèi)插和抽取理論等,在理論基礎(chǔ)上闡述了一些具體模塊的高效實(shí)現(xiàn)方案,最終利用FPGA實(shí)現(xiàn)了數(shù)字變頻模塊的設(shè)計(jì)。 在數(shù)字直放站系統(tǒng)中,降低峰均比是提高功放工作效率的關(guān)鍵技術(shù)之一。本文首先概述了降低峰均比的三類算法,然后針對目前常用的幾種算法進(jìn)行了仿真分析,最后在綜合考慮降低峰均比效果與實(shí)現(xiàn)復(fù)雜度的基礎(chǔ)上,提出了改進(jìn)的二次限幅算法。通過仿真驗(yàn)證算法的有效性后,針對其中的噪聲整形濾波器提出了“先分解,再合成”的架構(gòu)實(shí)現(xiàn)方式,并指出其中間級窄帶濾波器采用內(nèi)插級聯(lián)的方式實(shí)現(xiàn),最后整個算法在FPGA上實(shí)現(xiàn)。 在軟件無線電思想的指導(dǎo)下,本文利用系統(tǒng)級的設(shè)計(jì)方法完成了WCDMA數(shù)字直放站中頻系統(tǒng)設(shè)計(jì)。遵照3GPP等相關(guān)標(biāo)準(zhǔn),完成了系統(tǒng)的仿真測試和實(shí)物測試。最后得出結(jié)論:該系統(tǒng)實(shí)現(xiàn)了WCDMA數(shù)字直放站數(shù)字中頻的基本功能,并可保證在現(xiàn)有硬件不變的基礎(chǔ)上實(shí)現(xiàn)不同載波間平滑過渡、不同制式間輕松升級。

    標(biāo)簽: WCDMA FPGA 數(shù)字

    上傳時間: 2013-07-07

    上傳用戶:林魚2016

  • 基于FPGA的視頻圖像畫面分割器的設(shè)計(jì).rar

    視頻監(jiān)控一直是人們關(guān)注的應(yīng)用技術(shù)熱點(diǎn)之一,它以其直觀、方便、信息內(nèi)容豐富而被廣泛用于在電視臺、銀行、商場等場合。在視頻圖像監(jiān)控系統(tǒng)中,經(jīng)常需要對多路視頻信號進(jìn)行實(shí)時監(jiān)控,如果每一路視頻信號都占用一個監(jiān)視器屏幕,則會大大增加系統(tǒng)成本。視頻圖像畫面分割器主要功能是完成多路視頻信號合成一路在監(jiān)視器顯示,是視頻監(jiān)控系統(tǒng)的核心部分。 傳統(tǒng)的基于分立數(shù)字邏輯電路甚至DSP芯片設(shè)計(jì)的畫面分割器的體積較大且成本較高。為此,本文介紹了一種基于FPGA技術(shù)的視頻圖像畫面分割器的設(shè)計(jì)與實(shí)現(xiàn)。 本文對視頻圖像畫面分割技術(shù)進(jìn)行了分析,完成了基于ITU-RBT.656視頻數(shù)據(jù)格式的畫面分割方法設(shè)計(jì);系統(tǒng)采用Xilinx公司的FPGA作為核心控制器,設(shè)計(jì)了視頻圖像畫面分割器的硬件電路,該電路在FPGA中,將數(shù)字電路集成在一起,電路結(jié)構(gòu)簡潔,具有較好的穩(wěn)定性和靈活性;在硬件電路平臺基礎(chǔ)上,以四路視頻圖像分割為例,完成了I2C總線接口模塊,異步FIFO模塊,有效視頻圖像數(shù)據(jù)提取模塊,圖像存儲控制模塊和圖像合成模塊的設(shè)計(jì),首先,由攝像頭采集四路模擬視頻信號,經(jīng)視頻解碼芯片轉(zhuǎn)換為數(shù)字視頻圖像信號后送入異步FIFO緩沖。然后,根據(jù)畫面分割需要進(jìn)行視頻圖像數(shù)據(jù)抽取,并將抽取的視頻圖像數(shù)據(jù)按照一定的規(guī)則存儲到圖像存儲器。最后,按照數(shù)字視頻圖像的數(shù)據(jù)格式,將四路視頻圖像合成一路編碼輸出,實(shí)現(xiàn)了四路視頻圖像分割的功能。從而驗(yàn)證了電路設(shè)計(jì)和分割方法的正確性。 本文通過由FPGA實(shí)現(xiàn)多路視頻圖像的采集、存儲和合成等邏輯控制功能,I2C總線對兩片視頻解碼器進(jìn)行動態(tài)配置等方法,實(shí)現(xiàn)四路視頻圖像的輪流采集、存儲和圖像的合成,提高了系統(tǒng)集成度,并可根據(jù)系統(tǒng)需要修改設(shè)計(jì)和進(jìn)一步擴(kuò)展功能,同時提高了系統(tǒng)的靈活性。

    標(biāo)簽: FPGA 視頻圖像 畫面分割器

    上傳時間: 2013-04-24

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  • 基于軟件無線電的16QAM調(diào)制解調(diào)器設(shè)計(jì)與FPGA實(shí)現(xiàn).rar

    本文將高效數(shù)字調(diào)制方式QAM和軟件無線電技術(shù)相結(jié)合,在大規(guī)??删幊踢壿嬈骷﨔PGA上對16QAM算法實(shí)現(xiàn)。在當(dāng)今頻譜資源日趨緊缺的情況下有很大現(xiàn)實(shí)意義。 論文對16QAM軟件實(shí)現(xiàn)的基礎(chǔ)理論,帶通采樣理論、變速率數(shù)字信號處理相關(guān)抽取內(nèi)插技術(shù)做了推導(dǎo)和分析;深入研究了軟件無線電核心技術(shù)數(shù)字下變頻原理和其實(shí)現(xiàn)結(jié)構(gòu);對CIC、半帶等高效數(shù)字濾波器原理結(jié)構(gòu)和性能作了研究;16QAM調(diào)制和解調(diào)系統(tǒng)設(shè)計(jì)采用自項(xiàng)向下設(shè)計(jì)思想;采用硬件描述語言VerilogHDL在EDA工具QuartusII環(huán)境下實(shí)現(xiàn)代碼輸入;對系統(tǒng)調(diào)試采用了算法仿真和在系統(tǒng)實(shí)測調(diào)試相結(jié)合方法。 論文首先對16QAM調(diào)制解調(diào)算法進(jìn)行系統(tǒng)級仿真,并對實(shí)現(xiàn)的各模塊的可行性仿真驗(yàn)證,在此基礎(chǔ)上,完成了調(diào)制端16QAM信號的時鐘分頻模塊、串并轉(zhuǎn)換模塊、星座映射、8倍零值內(nèi)插、低通濾波以及FPGA和AD9857接口等模塊;解調(diào)器主要完成帶通采樣、16倍CIC抽取濾波,升余弦滾降濾波,以及16QAM解碼等模塊,實(shí)現(xiàn)了16QAM調(diào)制器;給出了中頻信號時域測試波形和頻譜圖。本系統(tǒng)在200KHz帶寬下實(shí)現(xiàn)了512Kbps的高速數(shù)據(jù)數(shù)率傳輸。論文還對增強(qiáng)型數(shù)字鎖相環(huán)EPLL的實(shí)現(xiàn)結(jié)構(gòu)進(jìn)行了研究和性能分析。

    標(biāo)簽: FPGA QAM 16

    上傳時間: 2013-07-10

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