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設(shè)(shè)計芯片

將Verilog設(shè)計轉(zhuǎn)成VHDL設(shè)計的程式

將Verilog設(shè)計轉(zhuǎn)成VHDL設(shè)計的程式

標(biāo)簽： Verilog VHDL 程式

上傳時間： 2016-01-18

上傳用戶：lifangyuan12
將VHDL設(shè)計轉(zhuǎn)換成Verilog設(shè)計的程式

將VHDL設(shè)計轉(zhuǎn)換成Verilog設(shè)計的程式

標(biāo)簽： Verilog VHDL 程式

上傳時間： 2016-01-18

上傳用戶：wkchong
JPEG的硬體設(shè)計採用的是VHDL設(shè)計,有源碼

JPEG的硬體設(shè)計採用的是VHDL設(shè)計,有源碼

標(biāo)簽： JPEG VHDL 有源

上傳時間： 2016-01-18

上傳用戶：agent
使用FPGA設(shè)計WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)

使用FPGA設(shè)計WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)

標(biāo)簽： WiMax FPGA OFDM VHDL

上傳時間： 2016-01-22

上傳用戶：zhuyibin
一個簡單的游戲設(shè)計...好好玩的

一個簡單的游戲設(shè)計...好好玩的

標(biāo)簽：

上傳時間： 2013-12-31

上傳用戶：edisonfather
倒數(shù)計時器提供時間到關(guān)機(jī)的功能可自由設(shè)定是否關(guān)機(jī)或者提供警示

倒數(shù)計時器提供時間到關(guān)機(jī)的功能可自由設(shè)定是否關(guān)機(jī)或者提供警示

標(biāo)簽：

上傳時間： 2016-02-02

上傳用戶：lepoke
這是一個修改Oreilly Java 網(wǎng)路程式設(shè)計範(fàn)例的程式主要是將裡面的一個小程式加上視窗管理者介面方便使用使用環(huán)境：需有JRE的環(huán)境 path需有指到JAVA_HOME下bin/

這是一個修改Oreilly Java 網(wǎng)路程式設(shè)計範(fàn)例的程式主要是將裡面的一個小程式加上視窗管理者介面方便使用使用環(huán)境：需有JRE的環(huán)境 path需有指到JAVA_HOME下bin/ 如環(huán)境設(shè)定OK，在windows直接點選執(zhí)行即可如在其他OS(unix-like) java -jar nsLookUp.jar

標(biāo)簽： JAVA_HOME Oreilly Java path

上傳時間： 2014-01-15

上傳用戶：1966640071
最新程序最好的在線程序設(shè)計建議同學(xué)們好好看看。最好的

最新程序最好的在線程序設(shè)計建議同學(xué)們好好看看。最好的

標(biāo)簽： 程序

上傳時間： 2016-03-10

上傳用戶：zhuoying119
由遠(yuǎn)峰公司所設(shè)計的燒入flash軟體,歡迎使用2410/2440可用

由遠(yuǎn)峰公司所設(shè)計的燒入flash軟體,歡迎使用2410/2440可用

標(biāo)簽： flash 2410 2440

上傳時間： 2014-01-10

上傳用戶：dyctj
UML 2 for Dummies ( UML 理想設(shè)計方案 )

UML 2 for Dummies ( UML 理想設(shè)計方案 )

標(biāo)簽： UML Dummies for 方案

上傳時間： 2014-01-17

上傳用戶：ommshaggar

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