_Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設計教學文件
標簽： Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006
上傳時間： 2013-08-20
上傳用戶：lchjng
有時間顯示與設置、秒表、鬧鐘、日期顯示與設置功能，用6個數碼管顯示。
標簽： 鬧鐘
上傳用戶：ttpay
fpga功能實現有限字長響應FIR，用verilog編寫
標簽： fpga FIR 有限字長
上傳時間： 2013-08-24
上傳用戶：hz07104032
本文詳細分析了COOLRUNNER系列CPLD的結構,特點及功能,使用VHDL語言實現數字邏輯,實現了水下沖擊波記錄儀電路的數字電路部分.
標簽： COOLRUNNER CPLD
上傳時間： 2013-08-26
上傳用戶：亞亞娟娟123
自己設計的Smartcard功能模塊，已經通過vcs仿真和FPGA驗證，可以使用。
標簽： Smartcard 模塊
上傳用戶：小鵬
實現由ARM2410本身配置fpga的功能\r\nfpga型號是ECP35和1K50/1C6
標簽： 2410 fpga ARM
上傳時間： 2013-08-28
上傳用戶：ligi201200
50個各種不同功能的CPLD程序例子，拿來就可以用，每個都經過了綜合測試，非常實用
標簽： CPLD 程序
上傳時間： 2013-08-29
上傳用戶：yuanyuan123
智能機器小車主要完成尋跡功能，由機械結構和控制單元兩個部分組成。機械結構是一個由底盤、前后輔助輪、控制板支架、傳感器支架、左右驅動輪、步進電機等組成。控制單元部分主要由主要包含傳感器及其調理電路、步進電機及驅動電路、控制器三個部分。本設計的核心為控制器部分，采用Altera MAX7000S系列的EPM7064LC84-15作主控芯片。CPLD芯片的設計主要在MAX+plusⅡ10.0環境下利用VHDL語言編程實現。驅動步進電機電路主要利用ULN2803作為驅動芯片。
標簽： CPLD 設計實現 智能機
上傳時間： 2013-08-30
上傳用戶：ve3344
基于CPLD的多功能信號發生器設計.PDF
標簽： CPLD 多功能 信號發生器
上傳時間： 2013-09-02
上傳用戶：lnnn30
一個很好的VHDL實現的功能模塊程序,希望你可以用的上!
標簽： VHDL 模塊 程序
上傳用戶：gxy670166755
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