對(duì)鏈表進(jìn)行排序，時(shí)間復(fù)雜度O（n2),類似于插入排序的思想
標(biāo)簽： 排序
上傳時(shí)間： 2015-05-21
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中文版Verilog HDL簡明教程 第1章 簡介 第2章 HDL指南 第3章 Verilog語言要素 第4章 表 達(dá) 式 第5章 門電平模型化
標(biāo)簽： Verilog HDL 簡明教程 電平
上傳時(shí)間： 2015-05-22
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設(shè)計(jì)VHDL24小時(shí)的時(shí)鐘，去除了按鍵彈跳現(xiàn)象
標(biāo)簽： VHDL 24
上傳時(shí)間： 2013-12-23
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建立一個(gè)順序存儲(chǔ)的 線性表，實(shí)現(xiàn)線性表的 插入，刪除操作
標(biāo)簽： 順序存儲(chǔ) 線性
上傳時(shí)間： 2013-12-28
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注冊(cè)表使用大全，包括針對(duì)于windows系列的操作系統(tǒng)，有許多小技巧，值得一試，美化你的系統(tǒng)
標(biāo)簽： 注冊(cè)表
該測量儀是由一種多功能、多用途測量輕烴中含水量的智能化儀表。它的一次表采用進(jìn)口的水份和溫度傳感器。二次表為帶微控制器的數(shù)據(jù)處理顯示部分。采用51匯編編寫。
標(biāo)簽： 測量儀 多功能 含水量 分
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PIC16C711做的直流電壓表源程序,包括原理圖
標(biāo)簽： C711 PIC 16C 711
上傳時(shí)間： 2015-05-23
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PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計(jì)階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率, 降低因設(shè)計(jì)而重工之浪費(fèi).
標(biāo)簽： Layout 1.70 Rule PCB
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萬用表測試元器件大全.pdf 全面介紹萬用電表的電路及檢修！
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冒泡排序法 (C++) 求鏈表操作 srasedfeadfeafds
標(biāo)簽： srasedfeadfeafds 排序 操作
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